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        Cadence簽收解決方案為STMicroelectronics帶來(lái)上市優(yōu)勢(shì)

        • 全球電子設(shè)計(jì)創(chuàng)新Cadence設(shè)計(jì)系統(tǒng)公司 (NASDAQ: CDNS),日前宣布服務(wù)于廣泛電子應(yīng)用領(lǐng)域的全球半導(dǎo)體領(lǐng)先企業(yè)STMicroelectronics,通過(guò)改用Cadence的簽收解決方案將一款28納米系統(tǒng)級(jí)芯片(SoC)的設(shè)計(jì)周期縮短了數(shù)周時(shí)間。
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        CSR實(shí)現(xiàn)系統(tǒng)加速低功耗、混合信號(hào)芯片流片

        • 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ: CDNS)宣布,緊湊型、多媒體及云領(lǐng)域的創(chuàng)新芯片及軟件解決方案的全球供應(yīng)商CSR plc (LSE: CSR; NASDAQ: CSRE)使用Cadence Encounter Digital Implementation(EDI)系統(tǒng)、Cadence Incisive Enterprise Simulator(IES)以及Cadence Conformal Low Power(CLP)加速了一款復(fù)雜低功耗、混合信號(hào)芯片的流片。
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        Cadence推出驗(yàn)證調(diào)試器,實(shí)現(xiàn)顯著的效率提升和時(shí)間節(jié)省

        • 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ: CDNS),日前宣布推出Incisive?調(diào)試分析器,這是一款全新的面向RTL、測(cè)試平臺(tái)與SoC驗(yàn)證的創(chuàng)新驗(yàn)證調(diào)試產(chǎn)品,能實(shí)現(xiàn)調(diào)試時(shí)間與資源投入的大幅節(jié)省。
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        Cadence推出最新版Allegro印刷電路板(PCB)技術(shù)

        • 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ: CDNS),于近日宣布推出最新版Allegro?印刷電路板(PCB)技術(shù),解決客戶對(duì)于高效產(chǎn)品開(kāi)發(fā)的簡(jiǎn)化解決方案的需要。
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        Cadence發(fā)布OrCAD 16.6,PSpice性能提高達(dá)20%

        • 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(納斯達(dá)克:CDNS) 于2012年9月25日發(fā)布了具有一系列新功能的Cadence? OrCAD? 16.6 PCB設(shè)計(jì)解決方案,用戶定制功能增強(qiáng),模擬性能提高20%, 使用戶得以更快、更有預(yù)見(jiàn)性地創(chuàng)建產(chǎn)品。
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        Cadence首個(gè)DDR4 Design IP解決方案在28納米級(jí)芯片上得到驗(yàn)證

        • 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(Cadence Design Systems, Inc.) (NASDQ: CDNS) 日前宣布,Cadence DDR4 SDRAM PHY 和存儲(chǔ)控制器Design IP的首批產(chǎn)品在TSMC的28HPM和28HP技術(shù)工藝上通過(guò)硅驗(yàn)證。
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        Cadence助力Denso大幅提升IC設(shè)計(jì)效率

        •    Cadence設(shè)計(jì)系統(tǒng)公司日前宣布,汽車零部件生產(chǎn)商Denso公司在改用了Cadence定制/模擬與數(shù)字流程之后,在低功耗混合信號(hào)IC設(shè)計(jì)方面實(shí)現(xiàn)了質(zhì)量與效率的大幅提升。將Cadence Encounter RTL-to-GDSII流程應(yīng)用于設(shè)計(jì)的數(shù)字部分之后,Denso表示比之前采用的流程減小了10%的面積,功耗降低了20% 。在設(shè)計(jì)的模擬部分,根據(jù)多次測(cè)試的數(shù)據(jù)結(jié)果,Denso使用Cadence Virtuoso定制/模擬流程(6.1版)實(shí)現(xiàn)了30%的效率提升,并預(yù)計(jì)在實(shí)際設(shè)計(jì)上也有相
        • 關(guān)鍵字: Cadence  IC設(shè)計(jì)  

        Denso采用Cadence混合信號(hào)、低功耗解決方案

        • 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ: CDNS)日前宣布,汽車零部件生產(chǎn)商Denso公司在改用了Cadence定制/模擬與數(shù)字流程之后,在低功耗混合信號(hào)IC設(shè)計(jì)方面實(shí)現(xiàn)了質(zhì)量與效率的大幅提升。將Cadence Encounter RTL-to-GDSII流程應(yīng)用于設(shè)計(jì)的數(shù)字部分之后,Denso表示比之前采用的流程減小了10%的面積,功耗降低了20% 。
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        Cadence PCB設(shè)計(jì)使用筆記

        • 一、安裝:
          SPB15.2 CD1~3,安裝1、2,第3為庫(kù),不安裝
          License安裝:
          設(shè)置環(huán)境變量lm_license_file D:Cadencelicense.dat
          修改license中SERVER yyh ANY 5280為SERVER zeng ANY 5280二、用Design Entry CIS
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        Cadence PCB設(shè)計(jì)仿真技術(shù)介紹

        • Cadence PCB設(shè)計(jì)仿真技術(shù)提供了一個(gè)全功能的模擬仿真器,并支持?jǐn)?shù)字元件幫助解決幾乎所有的設(shè)計(jì)挑戰(zhàn),從高頻系統(tǒng)到低功耗IC設(shè)計(jì),這個(gè)強(qiáng)大的仿真引擎可以容易地同各個(gè)Cadence PCB原理圖輸入工具結(jié)合,加速了上市時(shí)間
        • 關(guān)鍵字: Cadence  PCB  仿真技術(shù)    

        富士通選用Cadence簽收解決方案應(yīng)用于最新參考設(shè)計(jì)流程

        • 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ: CDNS),日前宣布富士通半導(dǎo)體有限公司已經(jīng)采用Cadence Encounter Timing System(ETS)進(jìn)行時(shí)序簽收,此前富士通半導(dǎo)體集團(tuán)公司旗下的富士通半導(dǎo)體和富士通VLSI有限公司的工程師們完成了一系列ASIC/ASSP和SoC設(shè)計(jì)的全面對(duì)比。
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        CadenceRTL-to-GDSII流程幫助夏普縮短設(shè)計(jì)周期

        • 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ: CDNS),日前宣布夏普公司已經(jīng)采用Cadence? Encounter ?RTL-to-GDSII流程開(kāi)發(fā)其CMOS圖像傳感器,與過(guò)去的設(shè)計(jì)流程相比,在設(shè)計(jì)周期方面加快了兩倍。除了加快產(chǎn)品上市時(shí)間外,夏普在時(shí)序、面積和生產(chǎn)效率方面也獲得大幅改進(jìn)。
        • 關(guān)鍵字: Cadence  夏普  傳感器  

        Cadence Digital PHY Design IP被燦芯半導(dǎo)體所采用

        • 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司 (NASDAQ: CDNS),日前宣布與燦芯半導(dǎo)體共同合作,將Cadence DDR Soft DLL PHY IP應(yīng)用于中芯國(guó)際集成電路制造有限公司(SMIC)生產(chǎn)工藝的設(shè)計(jì)體系。
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        CADENCE PCB設(shè)計(jì)技術(shù)方案

        • CADENCE PCB設(shè)計(jì)解決方案能為解決與實(shí)現(xiàn)高難度的與制造密切相關(guān)的設(shè)計(jì)提供完整的設(shè)計(jì)環(huán)境,該設(shè)計(jì)解決方案集成了從設(shè)計(jì)構(gòu)想至最終產(chǎn)品所需要的一切設(shè)計(jì)流程,包含設(shè)計(jì)輸入元件庫(kù)工具、PCB編輯器和一個(gè)自動(dòng)/交互連布線
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        三星和Cadence發(fā)布20納米數(shù)字設(shè)計(jì)方法

        • 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(納斯達(dá)克: CDNS) 日前宣布,三星電子與Cadence合作推出20納米設(shè)計(jì)方法,包含雙重圖形光刻(double patterning)技術(shù),面向共同用戶的開(kāi)發(fā)和內(nèi)部測(cè)試芯片。Cadence與三星的合作為移動(dòng)消費(fèi)電子產(chǎn)品帶來(lái)了新的工藝進(jìn)展,使得20納米及未來(lái)工藝節(jié)點(diǎn)設(shè)計(jì)成為可能。
        • 關(guān)鍵字: Cadence  三星  20納米  
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