- XL4001 典型應用電路XL4002 典型應用電路XL4102典型應用電路XL4101 典型應用電路
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XL 4001 4002 4102
- 基于Verilog的順序狀態邏輯FSM的設計與仿真, 硬件描述語言Verilog為數字系統設計人員提供了一種在廣泛抽象層次上描述數字系統的方式，同時，為計算機輔助設計工具在工程設計中的應用提供了方法。該語言支持早期的行為結構設計的概念，以及其后層次化結構設計的
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FSM 設計 仿真 邏輯 狀態 Verilog 順序 基于
- 介紹了H.264的量化算法，并用Modelsim進行了仿真，結果與理論完全一致。分析了在FPGA開發板上的資源的消耗。由此可知，完全可以用FPGA實現H.264的量化。
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Verilog 264 AVC
- 基于FPGA和DDS的信號源設計,1 引言
直接數字頻率合成DDS(Direct Digital Synthesizer)是基于奈奎斯特抽樣定理理論和現代器件生產技術發展的一種新的頻率合成技術。與第二代基于鎖相環頻率合成技術相比，DDS具有頻率切換時間短、頻率分辨率
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設計 信號源 DDS FPGA 基于 FPGA，DDS，Verilog HDL
- 作為一個負責FPGA 企業市場營銷團隊工作的人，我不得不說，由于在工藝技術方面的顯著成就以及硅芯片設計領域的獨創性，FPGA 正不斷實現其支持片上系統設計的承諾。隨著每一代新產品的推出，FPGA 在系統中具有越來來越多的功能，可作為協處理器、DSP 引擎以及通信平臺等，在某些應用領域甚至還可用作完整的片上系統。
因此，在摩爾定律的作用下，FPGA 產業的門數量不斷增加，性能與專門功能逐漸加強，使得 FPGA 在電子系統領域能夠取代此前只有 ASIC 和 ASSP 才能發揮的作用。不過，說到底，F
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xilinx FPGA VHDL Verilog
- 直接數字頻率合成技術(Direct Digital Synthesize，DDS)是繼直接頻率合成技術和鎖相式頻率合成技術之后的第三代頻率合成技術。它采用全數字技術，并從相位角度出發進行頻率合成。隨著微電子技術和數字集成電路的飛速
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Verilog HDL DDS 仿真
- 全球全球領先的電子組件供應商泰科電子近日宣布推出全新MULTI-BEAM XLE連接器產品。作為泰科電子備受市場認可的MULTI-BEAM XL配電連接器的增強版，新產品的負載電流較標準型MULTI-BEAM XL配電連接器提升20%以上，而耐用度更是其他同類產品的兩倍之多。原有MULTI-BEAM XL產品負載電流為35安培，而新型連接器的每個觸點可負載高達50安培的電流。MULTI-BEAM XLE的觸點設計采用直角型垂直PCB插頭，以及線纜基座式插頭。此外，此款新型連接器還可提供20安培&ldq
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泰科 連接器 MULTI-BEAM XL
- 摘要：數字電位器由于可調精度高，更穩定，定位更準確，操作更方便，數據可長期保存和隨時刷新等優點，在某些場合具有模擬電位器不可比擬的優勢。論述對數字電位器ADN2850的一種方便的控制方法，通過計算機上的串口直
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串口 控制 ADN2850 數字電位器 Verilog HDL 基于
- 在工信部電子信息司的指導下，工業和信息化部軟件與集成電路促進中心(CSIP )聯合集成電路IP核標準工作組，現面向全國集成電路設計企業工程師、科研院所及高校師生，舉辦2009年“首屆中國開源IP核標準化設計競賽”，競賽報名工作已于6月3日啟動。報名及詳情咨詢可登錄競賽官方網站 http://www.ipmall.org.cn了解。據悉本次競賽獲獎者可分別獲得現金1萬元、5千元等獎勵，針對學生參賽者有機會獲得到IBM中國芯片設計中心實習的機會!
參賽者可以個人或團隊(不高于
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CSIP VHDL Verilog
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除法器是電子技術領域的基礎模塊，在電子電路設計中得到廣泛應用。目前，實現除法器的方法有硬件實現和軟件實現兩種方法。硬件實現的方法主要是以硬件的消耗為代價，從而有實現速度快的特點。用硬件的方
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Verilog 計算 精度可調 整數除法器
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USB(通用串行總線)是英特爾、微軟、IBM、康柏等公司1994年聯合制定的一種通用串行總線規范，它具有數據傳輸速度快，成本低，可靠性高，支持即插即用和熱插拔等優點，迅速得到廣泛應用。
在高速的數
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Verilog FPGA USB 高速接口
- 針對機器人伺服控制系統高速度、高精度的要求，介紹一種全數字化的基于神經網絡控制的直流電機速度伺服控制系統的設計方案。速度控制器采用BP網絡參數辨識自適應控制，并將其在FPGA進行硬件實現；同時用Nios II軟核處理器作為上位機，構成一個完整的速度伺服控制器的片上可編程系統(SOPC)。實驗結果表明，該控制系統具有較高的控制精度、較好的穩定性和靈活性。
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SOPC 系統 控制器 速度 神經網絡 電機 基于 神經網絡 伺服控制 現場可編程門陣列 Verilog HDL
- 引言
在軸承生產行業中，軸承振動噪聲的峰值檢測是一項重要的指標。以往，該檢測都是采用傳統的模擬電路方法，很難做到1：1地捕捉和保持較窄的隨機波形的最大正峰值。本文敘述了基于Verilog-HDL與高速A/D轉換器相結合所實現的快速軸承噪聲檢測方法。
1 振動噪聲電壓峰值檢測方案的確定
1.1 軸承振動噪聲的產生及檢測
圖1是軸承振動噪聲電壓峰值檢測系統的示意圖。由于加工設備、技術、環境等因素的影響，生產的軸承都程度不同地帶有傷疤。圖1中，假設某待測軸承有一處傷疤。由于傷痕的存在，軸
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Verilog 軸承 振動噪聲 電壓峰值檢測
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