博客園正式支持Verilog語法著色功能,以前在貼Verilog代碼時，都只能挑C++或者C#的語法著色，但兩者的主題詞畢竟不太一樣，透過dudu的幫助，我將Verilog 2001年的主題詞加上了，現在博客園也能漂亮的顯示Verilog代碼了!!介紹
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著色 功能 語法 Verilog 正式 支持 博客
ST-BUS總線接口模塊的Verilog HDL設計,ST-BUS是廣泛應用于E1通信設備內部的一種模塊間通信總線。結合某專用通信系統E1接口轉換板的設計，本文對ST-BUS總線進行了介紹，討論了ST-BUS總線接口收發模塊的設計方法，給出了Verilog HDL實現和模塊的時序仿真圖。
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HDL 設計 Verilog 模塊 總線 接口 ST-BUS
verilog中阻塞賦值和非阻塞賦值,阻塞和非阻塞語句作為verilog HDL語言的最大難點之一，一直困擾著FPGA設計者，即使是一個頗富經驗的設計工程師，也很容易在這個點上犯下一些不必要的錯誤。阻塞和非阻塞可以說是血脈相連，但是又有著本質的差別。理解
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阻塞 verilog
PLD/FPGA硬件語言設計verilog HDL,HDL概述 隨著EDA技術的發展，使用硬件語言設計PLD/FPGA成為一種趨勢。目前最主要的硬件描述語言是VHDL和verilog HDL及System Verilog。 VHDL發展的較早，語法嚴格;而Verilog HDL是在C語言的基礎上發展起來的一種硬
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verilog HDL 設計 語言 硬件 PLD/FPGA
Verilog HDL與VHDL及FPGA的比較分析, Verilog HDL 優點：類似C語言，上手容易，靈活。大小寫敏感。在寫激勵和建模方面有優勢。 缺點：很多錯誤在編譯的時候不能被發現。 VHDL 優點：語法嚴謹，層次結構清晰。 缺點：熟悉時間長，不夠靈
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比較 分析 FPGA VHDL HDL Verilog
基于FPGA和硬件描述語言Verilog的液晶顯示控制器的設計,本設計是一種基于FPGA(現場可編程門陣列)的液晶顯示控制器。與集成電路控制器相比，FPGA更加靈活，可以針對小同的液晶顯示模塊更改時序信號和顯示數據。FPGA的集成度、復雜度和面積優勢使得其日益成為一種頗具吸引力
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液晶顯示 控制器 設計 Verilog 語言 FPGA 硬件 描述 基于
本文為實現高速數據的實時遠程傳輸處理,提出了采用FPGA直接控制DM9000A進行以太網數據收發的設計思路，實現了一種低成本、低功耗和高速率的網絡傳輸功能，最高傳輸速率可達100Mbps。
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Verilog 9000A FPGA 9000
摘要：通用異步收發器UART常用于微機和外設之間的數據交換，針對UART的特點，提出了一種基于Ver4log HDL的UART設計方法。采用自頂向下的設計路線，結合狀態機的描述形式，使用硬件描述語言設計UART的頂層模塊及各個子
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Verilog UART HDL 模塊設計
好用的Verilog串口UART程序,==========================================================================
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程序 UART 串口 Verilog
怎樣實現Verilog模擬PS2協議,PS2協議讀鍵盤值相當簡單嘛，比模擬SPI、I2C簡單多了...下面介紹一下具體過程.1.明確接線關系，只需接4根線，VCC要+5V，3.3我測試過不能用，時鐘和數據線要用bidir雙向口線，FPGA可以不用外接上拉電阻。另外，USB鍵盤
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PS2 協議 模擬 Verilog 實現 怎樣
之前探討過PS/2鍵盤編解碼以及數據傳輸協議，這次自己動手實現了利用FPGA接收鍵盤編碼，然后通過串口傳輸到PC。做的比較簡單，只是通過FPGA把大寫字母A-Z轉換成相應的ASCII碼，只要字母按鍵被按下，就能在串口調試助
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程序 解碼 鍵盤 PS2 verilog
verilog-xl介紹
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