- Tensilica公司總裁兼CEO Chris Rowen博士 硅芯片技術的飛速發展給SOC設計帶來新的危機。為了保持產品的競爭力，新的通信產品、消費產品和計算機產品設計必須在功能、可靠性和帶寬方面有顯著增長，而在成本和功耗方面有顯著的下降。 與此同時，芯片設計人員面臨的壓力是在日益減少的時間內設計開發更多的復雜硬件系統。除非業界在SOC設計方面采取一種更加有效和更加靈活的方法，否則投資回報障礙對許多產品來說就簡直太高了。半導體設計和電子產品發明的全球性步伐將會放緩。 SOC設計團隊會面臨一系列嚴峻
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Tensilica SoC ASIC
- 結合采用低功耗元件和低功耗設計技術在目前比以往任何時候都更有價值。隨著元件集成更多功能，并越來越小型化，對低功耗的要求持續增長。當把可編程邏輯器件用于低功耗應用時，限制設計的低功耗非常重要。本文將討論減小動態和靜態功耗的各種方法，并且給出一些例子說明如何使功耗最小化。 功耗的三個主要來源是啟動、待機和動態功耗。器件上電時產生的相關電流即是啟動電流；待機功耗又稱作靜態功耗，是電源開啟但I/O上沒有開關活動時器件的功耗；動態功耗是指器件正常工作時的功耗。 啟動電流因器件而異
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FPGA 嵌入式 消費電子
- --全球領先的半導體專工廠采用93000進行高速數字信號和混合信號測試-- 安捷倫科技日前宣布，聯華電子已經購買一部Agilent 93000 SOC系列測試儀，進行基于結構的高速數字信號和混合信號測試。聯華電子將使用93000測試計算設備、PC和游戲控制臺使用的大容量復雜SOC。93000系列能夠擴容及測試廣泛的一系列應用，幫助聯華電子降低測試成本，加快其客戶的產品開發周期。 “Agilent 93000提供了混合信號結構測試解決方案，并兼容廣大客戶的高端模塊核心。聯華電子
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聯華 SoC ASIC
- 可編程System-on-Chip(產品可減少開發時間與成本，有助任天堂的價格點降至100美元以下 日前，賽普拉斯半導體公司 (Cypress Semiconductor ) 宣布全球互動娛樂領域的領導者任天堂公司 (Nintendo Co., Ltd.) 選用其PSoC(（可編程單片系統）混合信號陣列，為廣受歡迎的全新便攜式游戲機Game Boy(r) Micro采用。 任天堂采用PSoC器件來管理Gam
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賽普拉斯 SoC ASIC
- 美國高通（QUALCOMM）正式宣布已選擇韓國三星電子作為新的芯片制造委托廠商。目前尚未公布半導體代工相關合同的詳細內容，兩公司將就三星的90nm以后的工藝技術展開合作。 在美國無工廠半導體制造商業界團體FSA（Fabless semiconductor Association）發表的“無加工半導體制造商銷售十強”中，高通的無工廠半導體業務部門（QCT：QUALCOMM CDMA Technologies）近期一直
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三星 SoC ASIC
- 基于ARM7TDMI的SoC語音處理系統的設計,基于ARM7TDMI的SoC片內AC97模塊和片外CODEC-UCB1400，采用ITU-T的G.721算法設計語音處理系統;提出一種基于低端RISC核的語音系統設計方案。
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理系 設計 處理 語音 ARM7TDMI SoC 基于
- 隨著SoC設計的發展，ESL（電子系統級）設計成為大家關注的焦點。ESL設計是能夠讓SoC設計工程師以緊密耦合方式開發、優化和驗證復雜系統架構和嵌入式軟件的一套方法學。業內許多電子產品和器件制造商正在將他們的設計轉向ESL，他們認為，這是唯一能夠管理如今產品中日益復雜的硬件和嵌入式軟件的方法。 Coware公司是領先的ESL軟件工具和服務的供應商，他們提供的技術和服務能夠創建電子系統的算法和架構模型，使客戶能夠及早對系統進行評估和優化，并順利地進行軟件開發和硬件實現。Coware主要提供4個方面的ESL工
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Coware SoC ASIC
- 介紹了SDRAM的特點和工作原理，提出了一種基于FPGA的SDRAM控制器的設計方法，使用該方法實現的控制器可非常方便地對SDRAM進行控制。
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Verilog SDRAM FPGA 控制器
- AMBA BusMatrix和AMBA Designer技術令復雜SoC設計的關鍵階段得以實現自動化和簡化 ARM 公司在于加利福尼亞州圣塔克萊拉市舉行的第二屆ARM開發者年度大會上發布了用于嵌入式系統設計的ARM AMBA? BusMatrixTM和AMBA DesignerTM產品。AMBA BusMatrix互連使得系統架構師能夠對性能進行最優化，AMBA Designer工具則對子系統的快速配置提供了可能。 AMBA&
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ARM SoC ASIC
- 過去15 年來，許多人都曾預測8 位微控制器即將退出舞臺，然而這卻是電子產業失誤最大的預測之一；事實上，雖然16 和32 位產品已極為常見，8 位微控制器的需求仍繼續成長，總值約達到今日100 億美元全球微控制器市場的一半。推動8 位市場快速發展及成長的動力主要來自于8 位產品效能的大幅提升，特別是以8051 系列為基礎的產品，其它原因還包括芯片內建功能的加強以及不斷縮小的封裝體積。今天，這類組件已能提供高達100&
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SoC SoC ASIC
- 2005年10月18日 芯原微電子獲得ARM多個處理器授權(ARM7TDMI®、ARM922TTM和ARM926EJ-STM)，用于消費及汽車電子產品SoC設計服務。這一授權協議將幫助中國IC設計服務公司加快SoC設計速度，滿足消費及汽車電子產品市場的需求。
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ARM 處理器 SoC
- 毫米波多目標信號發生器通過模擬的方法產生多種類型高精度的雷達多目標回波信號，在實際雷達系統前端不具備的條件下對雷達系統后級進行調試，便于制導武器的性能測試，大大加快新武器的研制進程。毫米波多目標信號產生的關鍵是要求回波信號距離分辨率極高，常規的多目標信號產生方法如使用數字延時線產生多目標之間的延時，其控制不靈活，并且有些延時線需要接ECL電源，使用不方便也增加了設計的復雜度。使用分立元件實現延時則使電路元件過多，電路的穩定性及延時的精確性也會大大降低。本文介紹一種新的產生毫米波雷達模擬器的多目標信號的方法
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FPGA
- 本文討論的四種常用FPGA/CPLD設計思想與技巧：乒乓操作、串并轉換、流水線操作、數據接口同步化，都是FPGA/CPLD 邏輯設計的內在規律的體現，合理地采用這些設計思想能在FPGA/CPLD設計工作種取得事半功倍的效果。
FPGA/CPLD的設計思想與技巧是一個非常大的話題，由于篇幅所限，本文僅介紹一些常用的設計思想與技巧，包括乒乓球操作、串并轉換、流水線操作和數據接口的同步方法。希望本文能引起工程師們的注意，如果能有意識地利用這些原則指導日后的設計工作，將取得事半功倍的效果！
乒乓操作
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FPGA 嵌入式
- 利用FPGA 實現大型設計時，可能需要FPGA 具有以多個時鐘運行的多重數據通路，這種多時鐘FPGA 設計必須特別小心，需要注意最大時鐘速率、抖動、最大時鐘數、異步時鐘設計和時鐘/數據關系。設計過程中最重要的一步是確定要用多少個不同的時鐘，以及如何進行布線，本文將對這些設計策略深入闡述。
FPGA 設計的第一步是決定需要什么樣的時鐘速率，設計中最快的時鐘將確定FPGA 必須能處理的時鐘速率。最快時鐘速率由設計中兩個觸發器之間一個信號的傳輸時間P 來決定，如果P 大于時鐘周期T，則當信號在一個觸發
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