- 摘 要：本文設計實現了一種基于FPGA的直接序列擴頻基帶處理器，并闡述了其基本原理和設計方案。關鍵詞：擴頻；FPGA；數字匹配濾波器；基帶處理器引言擴頻通信技術具有抗干擾、抗多徑、保密性好、不易截獲以及可實現碼分多址等許多優點，已成為無線通信物理層的主要通信手段。本文設計開發了一種基于直接序列擴頻技術(DS-SS)的基帶處理器。直接序列擴頻通信直接序列擴頻通信系統原理框圖如圖1所示。該處理器由FPGA芯片，完成圖1中兩虛線框所示的基帶信號處理部分。擴頻方式為11位bar
- 關鍵字：
FPGA 基帶處理器 擴頻 數字匹配濾波器
- 摘 要：本文根據FPGA器件的特點，介紹了應用FPGA設計某通信設備中PCM碼流處理模塊的一種方案。并就設計中遇到的問題進行了分析。關鍵詞：FPGA；RAM引言由于FPGA器件可實現所有數字電路功能 ，具有結構靈活、設計周期短、硬件密度高和性能好等優點，在高速信號處理領域顯示出愈來愈重要的作用。本文研究了基于FPGA技術對PCM碼流進行處理的實現方法。變換后的數據寫入RAM，與DSP配合可完成復雜的信號處理功能。設計方案某新型通信設備中，在完成調度功能的板子上，需要進行
- 關鍵字：
FPGA RAM 存儲器
- 使用多個復雜的總線已經成為系統級芯片(SoC)器件的標準，這種總線結構的使用使測試工程師面臨處理多個時鐘域問題的挑戰。早期器件的測試中，工程師可以依賴某些自動化測試設備(ATE)的雙時域能力測試相對簡單的總線結構。目前測試工程師面臨更復雜的SoC器件，這些器件反應了越來越多使用多個高速總線結構的趨勢。使用有效的技術和下一代測試系統，如Credence(科利登)的Octet，測試工程師能夠成功地管理與復雜SoC器件(如北橋器件)中多總線結構相關的獨立時鐘域。通過掌握ATE的能力，測試開發過程中，測試工程師能
- 關鍵字：
SoC SoC ASIC
- 當今的設計師面對無數的挑戰：一方面他們必須滿足高技術產品不斷擴展的特性需求，另一方面卻不得不受到無線和電池裝置的電源限制。沒有任何技術在這方面的要求比SoC的設計更為明顯，在這種設計中，高級工藝比從前復雜的多。然而，上述技術造成了新的電源問題。現代SoC系統的關鍵之一就是：嵌入存儲器在芯片中的比例在不斷增長。當存儲器開始主導SoC時，應用節能技術使存儲器獲得系統電源變得十分重要。重要問題之一就是：在系統結構方面，是嵌入系統存儲器還是把存儲器放在SoC之外。在以前的技術中，電源不是要考慮的一個主要因素，而成
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Mosys SoC ASIC
- 摘 要：本文研究并開發了一款針對手持設備、內嵌ARM7TDMI內核的系統芯片。在設計這款芯片的過程中，MP3算法的軟硬件分割和芯片的低功耗設計是主要挑戰。本文介紹了該系統芯片的結構，并著重介紹了軟硬件分割和低功耗設計技術。關鍵詞：系統芯片；低功耗；ARM；MP3
引言隨著半導體技術的進步和芯片設計方法—IP重用技術的出現，SoC在消費類電子產品中已經越來越普遍。本課題組去年啟動了稱為Garfield的SoC項目。Garfield定義為一款面向中低端PDA的
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ARM MP3 低功耗 系統芯片 SoC ASIC
- 摘 要：本文介紹了一種SoC單片機控制的多功能數據采集卡，在輸入通道中增加程控濾波、程控增益放大器和多級陷波電路，采集卡的功能選擇和參數改變均由SoC單片機軟件控制。本文給出了關鍵部分的電路圖、元件參數和實測數據。關鍵詞：SoC 單片機；程控放大；程控陷波
引言目前大多數的數據采集卡并不能適應工業控制現場或像野外那樣存在多種噪聲干擾的使用環境，特別是對50Hz工頻干擾及其諧波干擾無法起到抑制作用。在這種情況下，采集到的數據往往有很多錯誤或者采集卡無法正常工作。本數據采
- 關鍵字：
SoC 單片機 程控放大 程控陷波 SoC ASIC
- 摘 要：本文重點介紹基于DSP和FPGA、采用中頻數字化方法，以及QPSK擴頻調制技術來實現圖像的無線傳輸。對擴頻通信系統的同步問題提出了一種實現方法，并給出了部分實驗結果。關鍵詞：圖像傳輸；擴頻通信；同步；FPGA；DSP
視頻通信是目前計算機和通信領域的一個熱點。而無線擴頻與有線相比,有其固有的優越性，如聯網方便、費用低廉等。所以開發無線擴頻實時圖像傳輸系統有很高的實用價值。
系統設計在短距離通信中，通常可以在收發端加入奇偶校驗、累加和校驗等出錯重發的防噪聲措施
- 關鍵字：
DSP FPGA 擴頻通信 同步 圖像傳輸
- 摘 要：本文首先介紹了一個32位嵌入式稅控機專用系統芯片C3118的功能、結構和特點，然后分析了一個自動化程度很高的SoC設計平臺——C*SoC200，對該平臺的主要結構和功能進行了分析。關鍵詞：IP；SoC；平臺；仿真
引言2003年7月，中國國家質量監督檢驗檢疫總局發布了由稅控機國家標準制定委員會制定的稅控收款機國家標準。并將陸續出臺一系列的管理法規。為了滿足國家標準的要求，各稅控機生產廠家都在積極使用32位MCU開發符合新規范的稅控機。而32位的嵌入式稅控機專用
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IP SoC 仿真 平臺 SoC ASIC
- 功能驗證已經成為開發SoC的主要問題。隨著一些復雜SoC的規模超過兩千萬門，以及對開發和集成嵌入式軟件的需求持續增加，軟件模擬器已經力所不及。在設計過程需要幾百萬個時鐘周期來充分測試和驗證軟件功能的情況下，軟件仿真器的性能下降到1-5Hz。按照這種速率，軟件調試需要幾年的時間。如果設計項目組不能夠投入這么多的時間，則意味著SoC芯片制造出來之后，在加電后的幾秒內就會出現錯誤。基于事務的驗證允許代表單個或者多個時鐘周期的大量數據不經多次調用而直接進入模擬器，極大地提高了模擬性能。到目前為止，驗證環境都是基于
- 關鍵字：
SoC
- 找到價格、性能和功耗的最佳結合點實際上就確保贏得了SoC設計，但說起來容易做起來難。在實際可用的雙芯核架構、可編程加速器和數百萬門FPGA出現以前，一種80:20法則用起來很奏效：如果計算負荷的80%為數據處理，那么選擇RISC架構，在RISC中實施信號處理。而當今面臨太多的架構選擇，差別甚微，用單一處理器架構來解決優化問題已不可能。一種較為成功的方法是通過將計算資源與特性集匹配來實現。將一種復雜系統映射到硅中，在相當程度上依賴于設計是在現有SoC上實現還是從頭做起。對于前一種情況，系統設計師應從了解四個
- 關鍵字：
TI SoC ASIC
- 摘 要：本文介紹了多相陣列FFT在星上多載波數字化分路中的應用，并針對星上處理的實時高速處理要求，提出了一種FFT的實現方案，并用一片FPGA芯片驗證了其正確性和可行性。關鍵詞：FFT；FPGA；頻分分路
多載波信號的數字化分路是衛星通信星上處理技術的關鍵技術之一，數字化分路技術主要有并行濾波器組分路、樹形濾波器組分路和多相陣列FFT分路三種。在通道數較多時，多相陣列FFT有效地使用了抽取技術，且FFT算法具有很高的計算效率，本文所討論的就是該方法中FFT的實現。
- 關鍵字：
FFT FPGA 頻分分路
- 摘 要：本文介紹了可編程定時器/計數器8253的基本功能，以及一種用VHDL語言設計可編程定時器/計數器8253的方法，詳述了其原理和設計思想，并利用Altera公司的FPGA器件ACEX 1K予以實現。關鍵詞：FPGA；IP；VHDL
引言在工程上及控制系統中，常常要求有一些實時時鐘，以實現定時或延時控制，如定時中斷，定時檢測，定時掃描等，還要求有計數器能對外部事件計數。要實現定時或延時控制，有三種主要方法：軟件定時、不可編程的硬件定時、可編程的硬件定時器。其中可編
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FPGA IP VHDL
- 利用嵌入式硅IP可以縮短SoC設計所需的開發時間，這已成為眾所公認的事實。但要從完工后的整個系統角度出發，整合及驗證來自多家廠商的元件，需要相當的時間和努力，然而它們卻常被忽略。這會對嵌入式軟件開發人員造成額外負擔，因為他們需要SoC的外圍和接口以及處理器的精確模型，才能在設計投片之前，針對正在開發的SoC，迅速完成應用固件的測試及除錯。如果SoC平臺以可配置處理器和外圍IP為基礎，這些IP又來自多家供貨商，這種情形就更加重要，因為設計人員必須確認在特定配置下，每個元件的功能不會影響到其它元件的工作。除此
- 關鍵字：
ARC SoC ASIC
- 摘 要：AMBA總線是目前主流的片上總線。本文給出的雙層AMBA總線設計能極大地提高總線帶寬，并使系統架構更為靈活。文章詳細介紹了此設計的實現，并從兩個方面對兩種總線方式進行了比較。關鍵詞：雙層AMBA總線;總線帶寬;SoC
引言一般說來，SoC芯片是由片上芯核、用戶設計的IP核以及將這兩者集成在一起的總線組成的。片上芯核決定了使用何種片上總線以及芯片的體系結構。ARM系列嵌入式微處理器憑借其高性能、低功耗的特點占據了市場的主要份額，ARM7TDMI因其相對低廉的價格
- 關鍵字：
SoC 雙層AMBA總線 總線帶寬 SoC ASIC
- 摘 要：本文提出了一種LED點陣屏實現256級灰度顯示的新方法。詳細分析了其工作原理。并依據其原理，設計出了基于FPGA 的控制電路。關鍵詞：256級灰度；LED點陣屏；FPGA；電路設計
引言256級灰度LED點陣屏在很多領域越來越顯示出其廣闊的應用前景，本文提出一種新的控制方式，即逐位分時控制方式。隨著大規?？删幊踢壿嬈骷某霈F，由純硬件完成的高速、復雜控制成為可能。
逐位分時點亮工作原理所謂逐位分時點亮，即從一個字節數據中依次提取出一位數據，分8次點亮對應的像
- 關鍵字：
256級灰度 FPGA LED點陣屏 電路設計 發光二極管 LED
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