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Altera的Stratix 10 SoC會(huì)和誰(shuí)競(jìng)爭(zhēng)?
- 2013年10月30日，Altera公司在其SoC上進(jìn)行了重大發(fā)布，宣布將推出第三代處理器系統(tǒng)（下圖），采用Intel 14nm三柵極工藝制造的Stratix 10 SoC器件將具有高性能四核64位ARM Cortex-A53處理器系統(tǒng)，并宣稱這與該器件中的浮點(diǎn)數(shù)字信號(hào)處理(DSP)模塊和高性能FPGA架構(gòu)相得益彰[1]。 ? 據(jù)悉，Altera高端的FPGA針對(duì)的是數(shù)據(jù)中心的計(jì)算加速、雷達(dá)系統(tǒng)和通信基礎(chǔ)設(shè)施等客戶，他們更關(guān)心的是運(yùn)行速度。 ? 這里有個(gè)問(wèn)題，Intel的通信和
- 關(guān)鍵字： Altera Stratix SoC Xilinx
Altera的Stratix SoC為何不加ADC？
- 2013年10月30日，Altera公司在其SoC上進(jìn)行了重大發(fā)布，宣布將推出第三代處理器系統(tǒng)，采用Intel 14nm三柵極工藝制造的Stratix 10 SoC器件將具有高性能四核64位ARM Cortex-A53處理器系統(tǒng) [1]。不過(guò)，我們注意到，不像其同行競(jìng)爭(zhēng)對(duì)手加入了高精度的Delta-Sigma ADC，Altera的SoC還是純數(shù)字，仍然沒(méi)有集成ADC。 ? Altera嵌入式處理營(yíng)銷資深總監(jiān)Chris Balough告訴《電子產(chǎn)品世界》編輯，首先，增加什么功能，主要看客戶的
- 關(guān)鍵字： Altera Stratix SoC ADC
Altera Quartus II軟件v13.1編譯時(shí)間縮短70%
- Altera公司 (NASDAQ: ALTR)今天宣布發(fā)布Quartus? II軟件13.1版，通過(guò)大幅度優(yōu)化算法以及增強(qiáng)并行處理，與前一版本相比，編譯時(shí)間平均縮短了30%，最大達(dá)到70%，進(jìn)一步擴(kuò)展了在軟件效能方面的業(yè)界領(lǐng)先優(yōu)勢(shì)。軟件還包括最新的快速重新編譯特性，適用于客戶對(duì)Altera Stratix? V FPGA設(shè)計(jì)進(jìn)行少量源代碼改動(dòng)的情形。采用快速重新編譯特性，客戶可以重新使用以前的編譯結(jié)果，從而保持性能，不需要前端設(shè)計(jì)劃分，進(jìn)一步將編譯時(shí)間縮短了50%。
- 關(guān)鍵字： Altera Quartus FPGA DSP
基于FPGA的基帶64×64數(shù)據(jù)分配矩陣設(shè)計(jì)方案
- 本文采用FPGA作為實(shí)現(xiàn)控制邏輯的核心部件，提出了基于FPGA的基帶64×64 數(shù)據(jù)分配矩陣設(shè)計(jì)方案，并介紹了上位機(jī) ...
- 關(guān)鍵字： FPGA 數(shù)據(jù)分配 矩陣設(shè)計(jì)
基于FPGA的多普勒測(cè)振計(jì)信號(hào)采集與處理系統(tǒng)設(shè)計(jì)方案
- 0 引言 傳統(tǒng)的淺海地形測(cè)量以船只為平臺(tái)，采用聲納技術(shù)進(jìn)行，這種測(cè)量方法對(duì)于一些船只難以駛?cè)氲膮^(qū)域便形 ...
- 關(guān)鍵字： FPGA 多普勒測(cè)振計(jì) 信號(hào)采集
基于FPGA的TDICCD8091 驅(qū)動(dòng)時(shí)序電路設(shè)計(jì)
- 0引言時(shí)間延時(shí)積分電荷耦合器件(TimeDelayandIntegra-tionChargeCoupledDevices,TDICCD)易于實(shí)現(xiàn)實(shí)...
- 關(guān)鍵字： FPGA TDICCD8091 驅(qū)動(dòng)時(shí)序
FPGA攻城拔寨，引領(lǐng)視頻監(jiān)控應(yīng)用潮流
- 通信領(lǐng)域歷來(lái)是FPGA應(yīng)用的傳統(tǒng)主流市場(chǎng)，也是業(yè)界領(lǐng)先FPGA廠商傾力爭(zhēng)奪的大市場(chǎng)。FPGA產(chǎn)業(yè)發(fā)展方興未艾，已經(jīng)由 ...
- 關(guān)鍵字： FPGA 視頻監(jiān)控
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