根據小波去噪的原理及特點，提出了用 FPGA實現小波實時信號處理的方法。實驗結果證明采用FPGA實現小波信號處理能在低信噪比的情況下有效去除噪聲，同時能夠滿足信號處理系統的實時性要求。
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小波去噪 信噪比 FPGA
主要介紹了HDB3 碼( 三階高密度雙極性碼) 的編碼原理，并提出了一種利用FPGA( 現場可編程門陣列) 實現HDB3編碼的設計方法。
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HDB3編碼 高密度雙極性碼 FPGA
采樣率變換器是多采樣率系統的一個重要組成部分。詳細討論了有理數采樣率變換器的原理，同時結合多采樣率系統網絡的等效變換和FIR濾波器的多相分解形式[1～2]，給出了適合于硬件實現的一種高效的多相結構，并在Altera公司的FPGA芯片EP1C3T144C6上進行了實現與驗證。
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多采樣率系統 多相結構 FPGA
由于電控汽油機在燃用不同比例甲醇汽油時受空燃比自適應調整的限制而不能正常運轉的問題，提出利用FPGA技術將電控單元輸出的噴油脈寬信號進行擴展處理，使得電控汽油機在燃用不同比例甲醇汽油時，空燃比能夠維持在理論空燃比附近，從而使得電控汽油機能夠正常運轉。本系統采用Altera公司的Cyclone系列FPGA芯片EP1C12Q240C8N，在Quatus II開發環境中給出硬件設計和功能仿真。經過測試，系統滿足對噴油脈寬信號的擴展處理要求且系統性能穩定。
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空燃比 噴油脈寬 FPGA
介紹了在激光告警系統中采用異步FIFO解決A/D數據采樣與FPGA數據處理模塊之間的不同速率匹配問題。在分析異步FIFO設計難點基礎上，提出利用Gray碼計數器作為讀寫地址編碼，有效地同步了異步信號，避免了亞穩態現象的產生，給不同速率間的數據傳輸提供了一種有效的解決方案。
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異步FIFO A/D數據采樣 FPGA
在雷達設計中，需要對接收到的信號首先進行模數轉換，其轉換速度和準確性直接決定了之后FFT等運算的準確性，最終影響雷達測量精度。介紹了一種基于FPGA，利用芯片ADS7890實現一種快速14位串行AD轉換，對系統的軟件和硬件做了說明。硬件部分主要為ADS7890的基本外圍電路以及芯片EP2C35F672C與其的控制連接，軟件部分利用Quartus II 8．0編程。
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AD轉換 毫米波雷達測距 FPGA
賽靈思公司(Xilinx)最新推出的ISE 12軟件設計套件，實現了具有更高設計生產力的功耗和成本的突破性優化。ISE設計套件首次利用“智能”時鐘門控技術，將動態功耗降低多達30%。此外，該新型套件還提供了基于時序的高級設計保存功能、為即插即用設計提供符合AMBA 4 AXI4 規范的IP支持，同時具備第四代部分重配置功能的直觀設計流程，可降低多種高性能應用的系統成本。
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Xilinx 設計套件 FPGA
通過對步進電機的驅動控制原理的分析，利用Verilog語言進行層次化設計，最后實現了基于FPGA步進電機的驅動控制系統。該系統可以實現步進電機按既定角度和方向轉動及定位控制等功能。仿真和綜合的結果表明，該系統不但可以達到對步進電機的驅動控制，同時也優化了傳統的系統結構，提高了系統的抗干擾能力和穩定性，可用于工業自動化、辦公自動化等應用場合。
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步進電機 Verilog FPGA
提出了一種高效并行的二維離散提升小波(DWT)變換結構，該結構只需要7 行數據緩存，即可實現行和列方向同時進行濾波變換。
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小波變換 數據緩存 FPGA IP核
介紹了一種基于FPGA的水聲信號數據采集與存儲系統的設計與實現，給出了系統的總體方案，并對各部分硬件和軟件的設計進行了詳細描述。系統以FPGA作為數據的控制處理核心，以存儲容量達2GB的大容量NAND型Flash作為存儲介質。該系統主要由數據采集模塊、數據存儲模塊和RS～232串行通信模塊組成，具有穩定可靠、體積小、功耗低、存儲容量大等特點，實驗證明該系統滿足設計要求。
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水聲信號數據采集 NANDFlash FPGA
設計了一種基于FPGA控制的高速數據存儲系統。該系統采用FPGA實現了對四個符合ATA-6規范的、RAID 0配置的IDE磁盤陣列的管理，并配合四個SDRAM實現對數據的高速穩定存儲。該磁盤陣列同時掛四個IDE硬盤，平均數據流達到200MB/s，峰值傳輸速率達到800MB/s，也可以擴展更多硬盤，構成大容量的磁盤陣列。
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高速數據存儲 IDE磁盤陣列 FPGA
提出一種實時數字化光纖傳輸系統，該系統分為發送端和接收端。發送端用A／D轉換器將輸入的模擬信號數字化，再用FPGA對數據進行處理，并通過光纖傳輸。同時，FPGA還控制A／D轉換器的工作。接收端用串行收發器TLK1501對接收數據進行解碼處理，還原有效信號。實驗表明，該系統實時性好、信號傳輸誤碼率低、工作性能穩定、抗干擾性強，系統具有可行性和有效性。
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光纖通訊 高速數字信號傳輸 FPGA
在數字下變頻系統實現方案中，輸入的模擬中頻信號經過高速A/D采樣數字化后與數控振蕩器NCO(Numerically Controlled Osillator)產生的正交本振信號混頻，然后再由抽取濾波模塊進行處理，以輸出低速的低頻或基帶信號。本文以軟件無線電數字下變頻技術為研究對象，參考GSM系統建立數字下變頻系統。
關鍵字：
數字變頻 軟件無線電 FPGA
基于FPGA硬件實現固定倍率的圖像縮放，將2維卷積運算分解成2次1維卷積運算，對輸入原始圖像像素先進行行方向的卷積，再進行列方向的卷積，從而得到輸出圖像像素。把圖像縮放過程設計為一個單元體的循環過程，在單元體內部，事先計算出卷積系數。降低了FPGA設計的復雜性，提高了圖像縮放算法的運算速度，增強了系統的實時性，已經應用于某款航空電子產品中，應用效果良好。
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圖像縮放 卷積運算 FPGA
設計了一種基于FPGA平臺的并行處理流水線結構，配合高速查表，可支持10Gbps接口的報文轉發。該設計已應用在國家863計劃重大課題“可擴展到T比特的高性能IPv4/v6路由器基礎平臺及實驗系統”中,并通過測試。
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并行流水線 高速查表 FPGA
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