Cadence推出了Cadence Low-Power Solution，這是用于低功耗芯片的邏輯設計、驗證和實現的業界第一套完全集成的、標準化的流程。Cadence Low-Power Solution將領先的設計、驗證和實現技術與Si2 Common Power Format （CPF）相集成，為IC工程師提供端到端的低功耗設計方案。CPF是在設計過程初期詳細定義節約功耗技術的標準化格式。通過在整個設計過程中保存低功耗
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Cadence CPF 解決方案
在ARM公司, Virage Logic Corporation 公司和Altos Design Automation公司的支持下,Cadence設計系統公司、Magma®公司和Extreme DA宣布，在Si2組織的Open Modeling Coalition框架下成功開發出一種全新的標準統計分析庫格式。這種開放的統計庫格式是基于電流源模型。其開發目的除了促進65納米及以下工藝節點的設計工具和方法學之
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CADENCE DA MAGMA和EXTREME Si2 電源技術 模擬技術 統計分析 行業標準庫格式
Cadence 設計系統公司與中芯國際集成電路制造有限公司宣布，兩家公司已經聯合開發出低功耗數字設計參考流程，支持SMIC先進的90納米工藝技術。該設計參考流程包含對Cadence® Encounter®時序系統的支持，以滿足設計師為計算機、消費電子、網絡及無線產品市場開發集成電路越來越高的需求。 該設計參考流程結合了Cadence Encounter數字IC設計平臺和Cadence可制造性設計(DFM）技術，攻克
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90納米 CADENCE 單片機 低功耗 工業控制 解決方案 嵌入式系統 通訊 網絡 無線 中芯國際 工業控制
Cadence設計系統有限公司今日宣布推出業界第一套完整的能夠推動SiP IC 設計主流化的EDA產品。 Cadence解決方案針對目前SiP設計中依賴 ‘專家工程’的方式存在的固有局限性，提供了一套自動化、 整合的、可信賴并可反復采用的工藝以滿足無線和消費產品不斷提升的需求。這套新產品包括Cadence® Radio Frequency SiP Methodology Kit， 兩款新的
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Cadence EDA IC設計 EDA IC設計
TensilicaÒ宣布增加了自動可配置處理器內核的設計方法學以面對90納米工藝下普通集成電路設計的挑戰。這些增加支持Cadence和Synosys工具的最新能力，包括自動生成物理設計流程腳本，自動輸入用戶定義的功耗結構以及支持串繞分析。 Tensilica利用Synopsys的Power Compiler™的低功耗優化能力，同時在Xtensa LX內核和所有設計者自定義的擴展功能中自動的插入精細度時鐘門控，從而降低動態功耗。新自動生成的Xtensa布線腳本可
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Cadence Synopsys Tensilica 支持
Cadence RF（射頻）設計方法學"Kits"（錦囊）可解決無線設計的關鍵問題。這個新設計包致力于應對新生技術域的挑戰。RF收發器是所有無線設備的一個核心模塊，而且2005 Gartner報告預測到2006年無線IC的需求將會達到461億美金。Cadence RF設計方法學錦囊可幫助無線芯片設計人員縮短設計周期，增加可預測性，并保證硅片性能達到設計目標。
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Cadence Kits RF
Cadence公司希望自己能夠成為全球電子行業不可或缺的伙伴，而非僅提供解決方案。通過開放式合作，Cadence公司與晶圓廠、系統供應商、IP供應商、設備供應商和半導體設計公司一起面對納米時代帶來的挑戰，幫助客戶取得成功。Cadence亞太區總裁居龍先生表示：“今年第二季度，公司收入比去年同期增長了15%，這表明Cadence的技術和戰略符合客戶的市場需求?！?Cadence提供革命創新及領先的EDA技術，以及完整和廣泛的產品線。為了滿足市場的需要，Cadence從最初提供點工具開始，到提供整個設計流程、
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Cadence
Cadence公司將于7月14日到8月2日在亞太舉辦今年“技術之旅（ToT）”系列活動。該活動前身是“亞太技術巡展（ACTS）”。創辦于2002年的該系列活動，規模巨大，每年舉辦一屆，在過去的三年中，它已經成功地吸引了5,300多位專業設計人士參加。本屆“技術之旅”的宗旨是向客戶展示Cadence最新技術和成果，幫助業內人士提升設計能力、促進生產效率、提高產量并縮短產品投放市場的周期。與會人士能借此機會深入了解Cadence公司的最新設計方法和流程，并與世界頂尖EDA公司資深工程師和業內人士進行深入的、面
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Cadence
Cadence Design Systems公司（紐約證券交易所代碼：CDN，納斯達克交易代碼：CDN）今天宣布：已經任命業界資深人士居龍（Lung Chu）先生擔任公司副總裁兼亞太區總裁，負責在整個亞太地區的銷售和現場運營工作?！熬育埖募用?，為Cadence公司帶了豐富的電子設計自動化領域的知識和成功經驗，并幫助公司通過更加深入的方式了解亞太區客戶、洞察新的商業契機，” Cadence全球現場運營部的執行副總裁Kevin Bushby說：“我對居龍加盟后的亞太區業務發展前景表示樂觀，相信在他的領導下，我
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Cadence
Cadence公司發布的帶有PSpice的OrCAD PCB Designer 和OrCAD PCB Designer 兩套新型產品，包含在新的OrCAD 10.3版本中。其中OrCAD PCB Designer包括自動布線程序SPECCTRA和設計輸入工具OrCAD Capture。而帶有Pspice的PCB Designer合并了PSpice A/D用于模擬/混合信號仿真。兩者對于整個OrCAD產品線的發展起到了促進作用。另外，OrCAD 10.3還為OrCAD Capture、OrCA
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Cadence PCB 電路板
IC設計產業發展迅速，但同時也遇到了越來越多的挑戰。特別是產品上市時間的壓力，迫使工程師必須考慮選擇更高效的EDA工具，以從煩瑣的工作當中解脫出來，并盡量使產品實現一次性成功。對此，在綜合、優化、驗證、仿真和布局布線等方面各具優勢的EDA廠商紛紛推出新技術和產品，以幫助設計工程師解決難題。構建完整的綜合系統作為近兩年發展迅速的EDA公司，Magma憑借其設計工具整合的環境、創新的架構和方法優勢，越來越受到IC設計廠商的歡迎。傳統的EDA工具流程前端和后端的迭代次數難以預測，這樣就延長了設計周期。Magma
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Cadence EDA IC設計
Cadence設計系統公司推出一種新型的高性能驗證環境，該驗證環境是針對Cadence Incisive Palladium加速/仿真系統而設計的，其功能包括增強的、基于事務的驗證加速(TBA)；帶IP的SpeedBridge驗證解決方案；與嵌入式軟件調試器的進一步整合；附加對多語言和多標準的支持等。上述環境功能大大提高了第一軟件和第一芯片設計成功的可能性。www.cadence.com
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Cadence公司宣布，其專為OrCAD產品線設計的、基于PSpice的新仿真技術—PSpice Enhancements 實現了模擬仿真與MathWork的MATLAB之間高水平的整合，其中Smoke工具標出了諸如功耗、二次崩潰限制、電流/電壓以及結溫限制等違規之處。借助PSpice Smoke選項，設計師們可進行電應力分析以驗證電子元件運行時是否滿足制造商們的“安全操作限制或降額限制”，從而可有效縮短電力電子、軍事/航天以及自動化等領域的PCB設計周期。www.cadence.com
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