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Cadence推出新一代Encounter RTL-to-GDSII流程
- 全球電子設(shè)計創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計系統(tǒng)公司(NASDAQ: CDNS)，日前宣布推出最新版Cadence? Encounter? RTL-to-GDSII流程，面向高性能千兆級設(shè)計，包括在20納米最新技術(shù)節(jié)點上的新設(shè)計。這種最新的RTL-to-GDSII設(shè)計、實現(xiàn)與簽收流程是與領(lǐng)先的IP與晶圓廠合作伙伴及客戶合作開發(fā)的，能更有效地進(jìn)行SoC開發(fā)，滿足并超越當(dāng)今市場所需的功耗、性能與面積需求。
- 關(guān)鍵字： Cadence RTL-to-GDSII
Cadence混合信號解決方案獲TowerJazz認(rèn)證
- 全球電子設(shè)計創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計系統(tǒng)公司，今天宣布全球集成電路頂尖專業(yè)晶圓廠TowerJazz已認(rèn)證Cadence混合信號解決方案，用于其TowerJazz參考設(shè)計流程2.0。新參考設(shè)計流程采用混合信號電源管理技術(shù)，應(yīng)用了Cadence Encounter Digital Implementation System及Virtuoso技術(shù)，將統(tǒng)一的定制/模擬與數(shù)字流程應(yīng)用于TowerJazz的TS018PM 180納米及TS035PM 350納米Bipolar-CMOS-DMOS(BCD)電源管理
- 關(guān)鍵字： Cadence IC
TowerJazz參考設(shè)計流程2.0全面認(rèn)證Cadence混合信號解決方案及工藝設(shè)計包
- 全球電子設(shè)計創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計系統(tǒng)公司 (NASDAQ: CDNS)，今天宣布全球集成電路頂尖專業(yè)晶圓廠TowerJazz已認(rèn)證Cadence混合信號解決方案，用于其TowerJazz參考設(shè)計流程2.0。新參考設(shè)計流程采用混合信號電源管理技術(shù)，應(yīng)用了Cadence Encounter? Digital Implementation System及Virtuoso?技術(shù)，將統(tǒng)一的定制/模擬與數(shù)字流程應(yīng)用于TowerJazz的TS018PM 180納米及TS035PM 350納米Bipolar-C
- 關(guān)鍵字： Cadence 電源管理
Cadence Palladium XP助力QLogic
- 全球電子設(shè)計創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計系統(tǒng)公司日前宣布 QLogic 已采用 Cadence Palladium XP 驗證計算平臺以便加快復(fù)雜網(wǎng)絡(luò)交換機的設(shè)計。QLogic制造光纖通道、10Gb以太網(wǎng)融合網(wǎng)絡(luò)和面向存儲和高性能計算 (HPC) 應(yīng)用的InfiniBand交換機。這些交換機提供了推動全球領(lǐng)先OEM和最終用戶的存儲、數(shù)據(jù)和HPC網(wǎng)絡(luò)向前發(fā)展所需的端口密度和性能。
- 關(guān)鍵字： Cadence 交換機 Palladium XP
Cadence Palladium XP支持QLogic快速開發(fā)先進(jìn)的網(wǎng)絡(luò)交換機
- 全球電子設(shè)計創(chuàng)新領(lǐng)先企業(yè) Cadence設(shè)計系統(tǒng)公司 (NASDAQ:CDNS) 日前宣布 QLogic 已采用 Cadence Palladium XP 驗證計算平臺以便加快復(fù)雜網(wǎng)絡(luò)交換機的設(shè)計。QLogic制造光纖通道、10Gb以太網(wǎng)融合網(wǎng)絡(luò)和面向存儲和高性能計算 (HPC) 應(yīng)用的InfiniBand交換機。這些交換機提供了推動全球領(lǐng)先OEM和最終用戶的存儲、數(shù)據(jù)和HPC網(wǎng)絡(luò)向前發(fā)展所需的端口密度和性能。使用Palladium XP系統(tǒng)，QLogic大幅縮短了與開發(fā)復(fù)雜的數(shù)百萬門 (multi-mi
- 關(guān)鍵字： Cadence 網(wǎng)絡(luò)交換機 QLogic
ARM與Cadence簽署了新的EDA技術(shù)應(yīng)用長期協(xié)議
- ARM與Cadence設(shè)計系統(tǒng)公司(NASDAQ: CDNS)日前宣布成功流片了業(yè)界首款基于ARM CortexTM-A15 MPCoreTM 處理器的20納米設(shè)計。該測試芯片面向TSMC的20納米工藝，由來自ARM、Cadence與TSMC的工程師使用Cadence RTL-to-signoff流程共同開發(fā)完成。今天的聲明是ARM和Cadence在優(yōu)化Cortex-A15處理器設(shè)計流程方面合作18個月的成果。 “Cortex-A15是我們迄今為止最高級的ARM處理器。ARM一直致力
- 關(guān)鍵字： Cadence EDA
ARM與Cadence實現(xiàn)行業(yè)里程碑
- ARM與Cadence設(shè)計系統(tǒng)公司今天宣布成功流片了業(yè)界首款基于ARM CortexTM-A15 MPCoreTM 處理器的20納米設(shè)計。該測試芯片面向TSMC的20納米工藝，由來自ARM、Cadence與TSMC的工程師使用Cadence RTL-to-signoff流程共同開發(fā)完成。今天的聲明是ARM和Cadence在優(yōu)化Cortex-A15處理器設(shè)計流程方面合作18個月的成果。
- 關(guān)鍵字： Cadence 處理器 Cortex-A15
X-FAB認(rèn)證Cadence物理驗證系統(tǒng)用于所有工藝節(jié)點
- 全球電子設(shè)計創(chuàng)新領(lǐng)先企業(yè)Cadence 設(shè)計系統(tǒng)公司 (NASDAQ: CDNS)，今天宣布頂尖的模擬/混合信號半導(dǎo)體應(yīng)用晶圓廠X-FAB，已認(rèn)證Cadence物理驗證系統(tǒng)用于其大多數(shù)工藝技術(shù)。晶圓廠的認(rèn)證意味著X-FAB已在其所有工藝節(jié)點中審核認(rèn)可了Cadence物理實現(xiàn)系統(tǒng)的硅精確性，混合信號客戶可利用其與Cadence Virtuoso和Encounter流程的緊密結(jié)合獲得新功能與效率優(yōu)勢。 “創(chuàng)造高級混合信號SoC意味著極大的挑戰(zhàn)，”X-FAB首席技術(shù)官Jens Kosch博士說，“我們的客戶
- 關(guān)鍵字： Cadence SoC
X-FAB認(rèn)證Cadence物理驗證系統(tǒng)用于所有工藝節(jié)點
- 2011年10月5日— 全球電子設(shè)計創(chuàng)新領(lǐng)先企業(yè)Cadence 設(shè)計系統(tǒng)公司 (NASDAQ: CDNS)，今天宣布頂尖的模擬/混合信號半導(dǎo)體應(yīng)用晶圓廠X-FAB，已認(rèn)證Cadence物理驗證系統(tǒng)用于其大多數(shù)工藝技術(shù)。晶圓廠的認(rèn)證意味著X-FAB已在其所有工藝節(jié)點中審核認(rèn)可了Cadence物理實現(xiàn)系統(tǒng)的硅精確性，混合信號客戶可利用其與Cadence Virtuoso和Encounter流程的緊密結(jié)合獲得新功能與效率優(yōu)勢。
- 關(guān)鍵字： Cadence 晶圓
Giantec采用Virtuoso流程實現(xiàn)了30%的效率提升
- 2011年9月19日 — 全球電子設(shè)計創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計系統(tǒng)公司(NASDAQ: CDNS)，今日宣布Giantec Semiconductor Corp.已采用Cadence Virtuoso 統(tǒng)一定制/模擬（IC6.1）以及Encounter 統(tǒng)一數(shù)字流程生產(chǎn)其混合信號芯片。Giantec最近采用Cadence軟件設(shè)計并成功流片了一款用于低功耗微控制器的存儲器產(chǎn)品，這款低功耗微控制器應(yīng)用于智能卡、智能電表和消費電子產(chǎn)品。使用Cadence Virtuoso統(tǒng)一定制/模擬流程開發(fā)其混合信號
- 關(guān)鍵字： Cadence 微控制器
Cadence推出28納米可靠數(shù)字端到端流程
- 全球電子設(shè)計創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計系統(tǒng)公司(NASDAQ: CDNS) ，宣布推出28納米的可靠數(shù)字端到端流程，推動千兆門/千兆赫系統(tǒng)級芯片(SoC)設(shè)計，在性能與上市時間方面都有著明顯的優(yōu)勢。在Cadence的硅實現(xiàn)方法的驅(qū)動下，在統(tǒng)一化設(shè)計、實現(xiàn)與驗證流程中，通過技術(shù)集成和對核心架構(gòu)與算法大幅改進(jìn)，基于Encounter的全新流程提供了更快、更具決定性的途徑實現(xiàn)千兆門/千兆赫硅片。
- 關(guān)鍵字： Cadence 28納米
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