lattice(萊迪思)半導體公司 文章 最新資訊
SYNPLICITY聯手LATTICE將項目擴展到DSP綜合技術領域
- SYNPLICITY和 LATTICE進一步加強合作，日前共同推出了面向 DSP 設計的高度優化的非專有 ESL 綜合流程技術 Synplify DSP。Synplicity 的 Synplify® DSP 軟件現可支持 LatticeECP2M 和 LatticeXP2 現場可編程門陣列 (FPGA) 器件，從而為航空航天、無線、電信及數字多媒體應用領域的 DSP 算法實施提供了功能強大的解決方案。 Lattice 公司的市場營銷副總裁 Stan Kop
- 關鍵字： 嵌入式系統 單片機 SYNPLICITY LATTICE DSP MCU和嵌入式微處理器
萊迪思為LatticeECP2低成本FPGA擴展市場
- --第二代 EConomy Plus器件降低了50%的價格并達到雙倍的密度 -- 萊迪思半導體公司近日公布了其第二代EConomy Plus 現場可編程門陣列 (FPGA)器件，LatticeECP2系列。用了富士通90納米CMOS工藝和300毫米硅片，在大批量的情況下，此系列使得FPGA價格降到每1000查找表（LUT）低于0.50美元。與130納米 LatticeECP FPGA相比，新的系
- 關鍵字： LatticeECP2 萊迪思 市場
萊迪思富士通發布LatticeSC和LatticeECP2
- －通力合作打造出難以超越的FPGA產品系列－ 萊迪思半導體公司近日宣布推出其新一代的90納米FPGA，包含兩個全新的FPGA器件系列。LatticeSC™ 系統芯片FPGA的設計宗旨是提供業界最佳的整體性能，而LatticeECP2™ FPGA則將業界成本最低的FPGA結構和高端的FPGA功能集于一身。這兩個器件系列都采用了富士通公司經過優化的工藝，既滿足了高容量FPGA對成本效率的要求，又能夠提供擁有數百萬門的系統級FPGA所需的千兆赫性能。這兩個器件系列將在
- 關鍵字： LatticeECP2 LatticeSC 富士通 萊迪思
用可編程的扭斜控制來解決時鐘網絡問題的方法
- 時鐘網絡管理問題提高同步設計的整體性能的關鍵是提高時鐘網絡的頻率。然而，諸如時序裕量、信號完整性、相關時鐘邊沿的同步等因素極大地增加了時鐘網絡設計的復雜度。傳統上，時鐘網絡的設計采用了簡單的元件，諸如扇出緩沖器、時鐘發生器、延時線、零延時緩沖器和頻率合成器。由于PCB走線長度不等而引起的時序誤差，采用蜿蜒走線設計的走線長度匹配方法來處理。走線阻抗與輸出驅動阻抗的不匹配經常通過反復試驗選擇串聯電阻來消除。多種信號的標準使得時鐘邊沿的同步更加復雜。至今，這三種挑戰會經常遇到，并且鮮有理想的解決方案。以下描述了
- 關鍵字： 萊迪思
可編程邏輯器件融合CPLD+FPGA最佳特性
- 可編程邏輯器件融合CPLD+FPGA最佳特性 Lattice(萊迪思)半導體公司近日推出了新的MachXO可編程邏輯器件系列產品，Lattice稱，這種新一代的跨越式可編程邏輯器件支持傳統上由高密度的CPLD或者低容量的FPGA所實現的應用。 據Lattice現場應用支持副總裁Jock Tomlinson介紹，MachXO邏輯器件建立在低成本的130nm嵌入式Flash處理工藝上。它能夠在單芯片中瞬時工作，這種特性對于許多CPLD應用來說是十分重要的。3.5ns的管腳至管腳的延時使得器件能夠滿足當代系統
- 關鍵字： Lattice(萊迪思)半導體公司
三端并聯穩壓器的隱藏應用
- 三端并聯穩壓器的隱藏應用 引言 眾多半導體公司均推出了三端并聯穩壓器 (three-terminal shunt regulator)。此類器件帶有內部基準精確度、運算放大器及內部并聯晶體管，以精確控制供電電壓。圖 1 給出了典型的電路應用。三端并聯穩壓器是廉價的半導體器件，除了并聯穩壓器以外，其還具備其他有用的電源設計應用。這種半導體器件可用作廉價的運算放大器，用于控制回路反饋。該器件還可同晶體管及無源組件協同使用，又可用于快速自舉電路。此外，這種器件經過配置，還可作為低功耗輔助電
- 關鍵字： 半導體公司
下一代成幀器/映射器：提升網絡傳輸效率
- 下一代成幀器/映射器：提升網絡傳輸效率 上司、公司和客戶無時無刻不在要求我們以較少的投入實現較高的產出。在以一種最佳的成本效益型方式來完成經由傳輸基礎設施的數據移動任務時，這種要求尤其明顯。 最初的傳輸網絡基于一種簡單的“配置完成便不再過問”的規則。它依靠的是SONET/SDH TDM（時分復用）能力。但是，向基于分組的傳輸要求的轉變迫使業界不得不開發新的標準和架構。而這反過來又促成了成幀器/映射器芯片在物理層水平上的發展，從而提供一條將現有的傳輸網絡更加有效地應用于數據業
- 關鍵字： 半導體公司
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