基于FPGA原型的GPS基帶驗證系統設計與實現

　　其次，ASIC和FPGA結構上的差異給驗證工作帶來了額外的負擔。驗證人員需要時刻保持ASIC和FPGA在版本上的一致性。原則上，ASIC上的任何的改動都要精準地反映在FPGA中，二者的一致性是相對的，驗證人員需要做到心中有數。要做好二者的一致性，要對模塊進行正確劃分。把從ASIC到FPGA需要調整的部分單獨劃分出來(不影響系統系能的前提下)。這樣，當ASIC部分進行代碼更新時，只要不涉及到需要調整的部分，全部替換即可。這樣即節省了時間，又保證了二者的一致性。

　　再次，FPGA平臺運行性能較差。在本系統中，CPU和AHB總線的時鐘可以穩定運行在100 MHz左右，但是，ARM7和FPGA之間布線延時造成ARM7最高運行在32 MHz左右，否則就不能保證功能以及時序上的正確性。因此，FPGA原型驗證在性能上要低于ASIC平臺。采取的方式是：在ARM7平臺上測試功能，在ARM9平臺上測試性能。采用ARM9芯片時，系統可以運行在100 MHz左右，完全滿足系統整體性能的要求。板級系統的可擴展性有助于解決在驗證過程中的某些問題。

　　經過充分的驗證，本系統實現了基于FPGA原型驗證平臺的GPS基帶芯片的導航定位功能。

　　參考文獻

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