在FPGA+DSP系統設計系統中，FPGA經常作為DSP的協處理器來輔助完成一些計算任務。而這些計算工作中最消耗時間的就是乘法運算，因此本實例的主要內容就是幫助讀者學會調用硬件乘法IP核。
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DSP 協同處理 FPGA 硬件乘法器
MIPS(Microprocessor without Interlocked Pipeline STages)是一種典型的RISC(Reduced InstructiON Set Computer)微處理器,在嵌入式系統領域中得到廣泛的應用。MIPS32TM指令集開放，指令格式規整，易于流水線設計，大量使用寄存器操作。與CISC(Complex Instruction Set Computer)微處理器相比，RISC具有設計更簡單、設計周期更短等優點，并可以應用更多先進的技術，開發更快的下一代處理器。
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流水線CPU 時序設計 FPGA
以上的接口中，比較常用的接口是EMIF和HPI。其中總線接口需要協議支持，開發難度較大，串行接口開發簡單，但是速率較慢。VPORT等特殊接口一般是在特定的場合下應用，不具備通用性，而且需要修改DSP驅動，開發周期較長。
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DSP 協同處理 FPGA 通信接口 EMIF HPI BlockRAM
本文介紹了數字下變頻的組成結構，并通過一個具體的實例，給出了FPGA實現的具體過程。
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數字變頻 VHDL FPGA
FPGA的一個重要的應用領域就是數字信號處理，隨著FPGA密度和速度的提高，現在FPGA已經可以勝任一些原來只有專用芯片或者多DSP才能完成的計算任務。
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DSP 協同處理 FPGA
時延估計是雷達、聲納等領域經常遇到的一個問題，提出了利用相關計算法實現時延估計，并通過互譜插值提高估計精度。結合FPGA器件特性，運用VHDL語言編程，實現了整個相關算法。利用QuartusⅡ和Mat
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時延估計 估計精度 FPGA 內插
SPI 接口應用十分廣泛，在很多情況下，人們會用軟件模擬的方法來產生SPI 時序或是采用帶SPI 功能模塊的MCU。但隨著可編程邏輯技術的發展，人們往往需要自己設計簡單的SPI 發送模塊。本文介紹一種基于FPGA 的將并行數據以SPI 串行方式自動發送出去的方法。
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SPI VHDL FPGA
面對似乎層出不窮的新 I/O 標準，目前嵌入式系統設計人員繼續依靠 FPGA 來部署系統日益重要的外部 I/O 接口.
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IO標準 可配置 FPGA
本節旨在設計實現了FPGA通過FX2 USB 2.0接口芯片與PC機進行高速數據通信，分為讀數據、寫數據和讀寫數據3部分內容。幫助讀者進一步了解USB接口芯片的工作原理和設計方法。
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USB2.0 FX2 FPGA 高速數據傳輸
本節旨在通過分析UART控制器，設計實現了FPGA通過RS-232C接口與PC機的通信。設計過程中用Modelsim對UART控制器進行仿真，幫助讀者進一步了解UART協議的具體時序。
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RS-232C接口 UART FPGA BlockRAM
A/D、D/A轉換器是FPGA系統設計中的常用器件，經常用來實現模擬信號和數字信號的相互轉換。根據應用場合的不同，A/D、D/A轉換芯片的性能指標參數差別比較大，因此接口格式也無法統一。
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轉換器接口 外同步模式 FPGA 內同步模式 環形緩存區
本白皮書討論用于實現基于ARM 的嵌入式系統的Altera 可編程芯片系統(SoC)方法。對于面臨產品及時面市、成本、性能、設計重用和產品長壽命等苛刻要求的嵌入式系統開發人員而言，單芯片方案是非常有價值的方法。
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硬核處理器 嵌入式系統 FPGA
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