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標(biāo)準(zhǔn)單元ASIC和FPGA的權(quán)衡及結(jié)構(gòu)化ASIC

標(biāo)準(zhǔn)單元ASIC和FPGA的權(quán)衡及結(jié)構(gòu)化ASIC,多種制造FPGA的深亞微米工藝，如Xilinx公司最新Spartan-3系列產(chǎn)品采用的90納米工藝（參考文獻(xiàn)1），使每塊芯片上的門電路數(shù)量變得越來越大。如果您的設(shè)計(jì)使用FPGA的嵌入式存儲(chǔ)器陣列和擴(kuò)散式模擬及數(shù)字功能模塊，如DL
關(guān)鍵字： ASIC 結(jié)構(gòu)化權(quán)衡 FPGA 標(biāo)準(zhǔn) 單元

FPGA Editor應(yīng)用技巧

FPGA Editor應(yīng)用技巧,工程師在設(shè)計(jì)過程中，經(jīng)常需要一定的創(chuàng)造力（你不妨稱之為數(shù)字管道膠帶）才能夠保證設(shè)計(jì)的順利完成。過去8年時(shí)間里，我曾經(jīng)目睹許多優(yōu)秀工程師利用這一方法出色地完成了許多工作，而他們采用的最主要工具就是FPGA Ed
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Xilinx發(fā)布Spartan-6 FPGA和Virtex-6 FPGA DSP開發(fā)套件

　　全球可編程平臺(tái)領(lǐng)導(dǎo)廠商賽靈思公司 (Xilinx, Inc. (NASDAQ:XLNX) )宣布推出三款新型開發(fā)套件，進(jìn)一步提升數(shù)字信號(hào)處理開發(fā)人員的實(shí)力，幫助他們方便地應(yīng)用 FPGA，進(jìn)而實(shí)現(xiàn)最高信號(hào)處理性能，成本與功耗優(yōu)化，并通過協(xié)處理技術(shù)解決系統(tǒng)瓶頸。因?yàn)橘愳`思目標(biāo)設(shè)計(jì)平臺(tái)是與業(yè)界領(lǐng)先的分銷商、設(shè)計(jì)服務(wù)、工具和硬件合作伙伴密切合作推出的，因此，賽靈思DSP產(chǎn)品的新套件將可以為開發(fā)人員提供硬件、工具和參考設(shè)計(jì)，以確保打造出一款適合各種不同 DSP 應(yīng)用的生產(chǎn)力高效的設(shè)計(jì)流程。　　賽靈思平臺(tái)解決
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Altera發(fā)售新的MAX V CPLD系列

　　擴(kuò)展其最受歡迎的CPLD產(chǎn)品的供應(yīng)，Altera公司今天宣布推出MAX? V器件系列。與競(jìng)爭(zhēng)CPLD相比，MAX V系列總功耗降低了一半，同時(shí)保持了最初MAX系列獨(dú)特的瞬時(shí)接通、單芯片和非易失特性。　　新的MAX V CPLD密度范圍在40到2,210個(gè)邏輯單元(LE)之間，具有低功耗和高性能特性，非常適合各類市場(chǎng)領(lǐng)域中的通用和便攜式設(shè)計(jì)，包括，固網(wǎng)、無線、消費(fèi)類、計(jì)算機(jī)/存儲(chǔ)、汽車電子和廣播等。
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基于NiosⅡ的學(xué)習(xí)型遙控器設(shè)計(jì)

摘要：以Altera FPGA系列Cyclone EPlCl2Q240C8器件為載體，通過SoPC技術(shù)構(gòu)建嵌入式軟核NiosⅡ處理器平臺(tái)，運(yùn)用Verilog HDL硬件描述語言設(shè)計(jì)等精度測(cè)量載波頻率IP核、紅外信號(hào)解調(diào)IP核、紅外編碼脈寬測(cè)量IP核和紅外發(fā)
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基于MATLAB在FPGA 算法上浮點(diǎn)定點(diǎn)轉(zhuǎn)換的實(shí)現(xiàn)

基于MATLAB在FPGA 算法上浮點(diǎn)定點(diǎn)轉(zhuǎn)換的實(shí)現(xiàn),浮點(diǎn)定點(diǎn)轉(zhuǎn)換是在 FPGA 上實(shí)現(xiàn)算法時(shí)最困難的地方（圖 1）。雖然 MATLAB 是一種強(qiáng)大的運(yùn)算開發(fā)工具，但其許多優(yōu)點(diǎn)卻在浮點(diǎn)定點(diǎn)轉(zhuǎn)換過程中被降低了。例如，由于定點(diǎn)算術(shù)中精度較低，新的數(shù)學(xué)誤差被引入算法。您必須重
關(guān)鍵字：定點(diǎn) 轉(zhuǎn)換實(shí)現(xiàn) 浮點(diǎn) 算法 MATLAB FPGA 基于

基于FPGA的誘發(fā)電位儀系統(tǒng)設(shè)計(jì)

摘要：設(shè)計(jì)了基于FPGA的誘發(fā)電位儀完整系統(tǒng)。首先給出了整個(gè)誘發(fā)電位儀的總體設(shè)計(jì)，討論了FPGA作為主芯片的各模塊集成設(shè)計(jì)，在此基礎(chǔ)上論述了ADSl258模／教轉(zhuǎn)換芯片的特點(diǎn)并給出了其與FPGA的接口電路設(shè)計(jì)。該誘發(fā)電位
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FPGA芯片EPXA10在圖像處理中的應(yīng)用

FPGA芯片EPXA10在圖像處理中的應(yīng)用, 本文所介紹的圖像驅(qū)動(dòng)和處理系統(tǒng)正是應(yīng)用了EPXA10的這些特點(diǎn)，充分發(fā)揮了FPGA邏輯控制實(shí)現(xiàn)簡(jiǎn)單、對(duì)大量數(shù)據(jù)做簡(jiǎn)單處理速度快的優(yōu)勢(shì)以及ARM軟件編程靈活的特點(diǎn)。
1 內(nèi)嵌ARM核的FPGA芯片EPXA10及其主要特點(diǎn)
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利用FPGA加密芯片的抗DPA攻擊電路設(shè)計(jì)

利用FPGA加密芯片的抗DPA攻擊電路設(shè)計(jì),0 引言
近年來，現(xiàn)場(chǎng)可編程門陣列(Field Programmable Gate Array，F(xiàn)PGA)由于其高性能、低價(jià)格、高開發(fā)速度、方便的編程方式等特點(diǎn)得到了廣泛的應(yīng)用。但對(duì)FPGA進(jìn)行DPA(Differential Power Analysis，差分功耗分
關(guān)鍵字：攻擊電路設(shè)計(jì) DPA 芯片 FPGA 加密利用

采用FPGA/MCU技術(shù)的光電式滾轉(zhuǎn)角測(cè)量?jī)x的解決方案

采用FPGA/MCU技術(shù)的光電式滾轉(zhuǎn)角測(cè)量?jī)x的解決方案,本文設(shè)計(jì)基于FPGA/MCU的光電式滾轉(zhuǎn)角測(cè)量?jī)x，安裝于實(shí)驗(yàn)轉(zhuǎn)臺(tái)上，實(shí)時(shí)輸出滾轉(zhuǎn)角度值，為彈體的滾轉(zhuǎn)角測(cè)量提供對(duì)照基準(zhǔn)，并可與上位機(jī)進(jìn)行通信，將數(shù)據(jù)傳送到主機(jī)中進(jìn)行后續(xù)處理。　　系統(tǒng)整體方案　　滾轉(zhuǎn)角測(cè)量?jī)x物
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FPGA低功耗設(shè)計(jì)注意事項(xiàng)

FPGA低功耗設(shè)計(jì)注意事項(xiàng),FPGA的功耗高度依賴于用戶的設(shè)計(jì)，沒有哪種單一的方法能夠?qū)崿F(xiàn)這種功耗的降低，如同其它多數(shù)事物一樣，降低功耗的設(shè)計(jì)就是一種協(xié)調(diào)和平衡藝術(shù)，在進(jìn)行低功耗器件的設(shè)計(jì)時(shí)，人們必須仔細(xì)權(quán)衡性能、易用性、成本、密度
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FPGA的TCP／IP通信協(xié)議與Matlab通信系統(tǒng)的研究

　O 引言　　近年來，隨著信息技術(shù)的發(fā)展，網(wǎng)絡(luò)化日加普遍，以太網(wǎng)被廣泛應(yīng)用到各個(gè)領(lǐng)域。例如在數(shù)據(jù)采集領(lǐng)域，一些小型監(jiān)測(cè)設(shè)備需要增加網(wǎng)絡(luò)實(shí)現(xiàn)遠(yuǎn)程數(shù)據(jù)傳輸?shù)墓δ埽灰切┰O(shè)備上增加一個(gè)網(wǎng)絡(luò)接口并實(shí)現(xiàn)了TCP／I
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基于FPGA和硬件描述語言Verilog的液晶顯示控制器的設(shè)計(jì)

基于FPGA和硬件描述語言Verilog的液晶顯示控制器的設(shè)計(jì),本設(shè)計(jì)是一種基于FPGA(現(xiàn)場(chǎng)可編程門陣列)的液晶顯示控制器。與集成電路控制器相比，F(xiàn)PGA更加靈活，可以針對(duì)小同的液晶顯示模塊更改時(shí)序信號(hào)和顯示數(shù)據(jù)。FPGA的集成度、復(fù)雜度和面積優(yōu)勢(shì)使得其日益成為一種頗具吸引力
關(guān)鍵字：液晶顯示控制器設(shè)計(jì) Verilog 語言 FPGA 硬件描述基于

FPGA的低功耗設(shè)計(jì)分析

FPGA的低功耗設(shè)計(jì)分析,FPGA的功耗高度依賴于用戶的設(shè)計(jì)，沒有哪種單一的方法能夠?qū)崿F(xiàn)這種功耗的降低，在進(jìn)行低功耗器件的設(shè)計(jì)時(shí)，人們必須仔細(xì)權(quán)衡性能、易用性、成本、密度以及功率等諸多指標(biāo)。　　盡管基于90nm工藝的FPGA的功耗已低于先
關(guān)鍵字：分析設(shè)計(jì) 功耗 FPGA

基于Flash構(gòu)架的模數(shù)混合的FPGA在心電監(jiān)控儀上的應(yīng)用設(shè)計(jì)

基于Flash構(gòu)架的模數(shù)混合的FPGA在心電監(jiān)控儀上的應(yīng)用設(shè)計(jì),Fution系列的FPGA是世界上首個(gè)基于Flash構(gòu)架的模數(shù)混合的FPGA，即在數(shù)字FPGA的基礎(chǔ)上加入了模擬電路部分，解決了傳統(tǒng)模擬電路和FPGA分離給設(shè)計(jì)帶來的諸多問題，降低了PCB板的制作難度，縮小了產(chǎn)品的體積。FPGA的可編
關(guān)鍵字：心電監(jiān)控應(yīng)用設(shè)計(jì) FPGA 混合 Flash 構(gòu)架模數(shù) 基于