FPGA設計中對輸入信號的處理-一般來說，在全同步設計中，如果信號來自同一時鐘域，各模塊的輸入不需要寄存。只要滿足建立時間，保持時間的約束，可以保證在時鐘上升沿到來時，輸入信號已經穩定，可以采樣得到正確的值。
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FPGA 全同步設計
3系列FPGA中使用LUT構建分布式RAM(4)-前面講了分布式RAM的方方面面，下面以RAM_16S為例，分別給出其在VHDL和Verilog HDL下面的模板代碼（在ISE Project Navigator中選擇 Edit--- Language Templates，然后選擇VHDL 或者Verilog, 最后是Synthesis Templates --- RAM，在中也有具體調用過程的描述）
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FPGA LUT RAM
3系列FPGA中使用LUT構建分布式RAM（3）-前面簡要介紹了Spartan-3系列FPGA中分布式RAM的基本特性。為什么不從更高級的Virtex系列入手呢？我仔細看了一下各個系列的介紹、對比，Spartan系列基本就是Virtex系列的精簡版，其基本原理是一樣的，所以從簡單的入手來融會貫通未嘗不是一個好辦法。
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FPGA LUT RAM
3系列FPGA中使用LUT構建分布式RAM（1）-在賽靈思Spartan-3、3E等系列的FPGA中，其邏輯單元CLB中一般含有不同數量的單端口RAM（SRAM）或者雙端口RAM（DRAM），這里的“單”或者“雙”是由我們開發人員定義的。
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FPGA LUT RAM
3系列FPGA中使用LUT構建分布式RAM（2）-帶有異步寫/同步讀的SRAM，其中的同步讀取可以使用與分布式RAM相關聯的觸發器實現。
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FPGA LUT RAM
工程師對于有關FPGA項目的九大感言-要和人配合。以我們做硬件的工程師為例，測試的時候一般都需要軟件的配合，一個對硬件來說無比復雜的工作，可能在軟件工程師看來就是幾行簡單的代碼。
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FPGA
未來只有懂FPGA開發的人才堪稱計算機專家？-由于微電子和超大規模集成電路工藝技術設備的缺失，使國人根本沒有條件能夠自由地進入這個領域體驗，這是一個嚴重的問題。
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FPGA 嵌入式 計算機
一個合格FPGA 工程師的基本要求-一個合格的FPGA工程師需要掌握哪些知識？這里根據自己的一些心得總結一下，其他朋友可以補充啊。
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FPGA Verilog
ARM、DSP、FPGA的區別是什么？-ARM（Advanced RISC Machines）是微處理器行業的一家知名企業，設計了大量高性能、廉價、耗能低的RISC處理器、相關技術及軟件。
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ARM DSP FPGA
FPGA/CPLD設計小技巧-這是一個在設計中常犯的錯誤列表這些錯誤常使得你的設計不可靠或速度較慢為了提高你的設計性能和提高速度的可靠性你必須確定你的設計通過所有的這些檢查 。
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FPGA CPLD
FPGA的結構特點與開發-我這個題目想說明的是，FPGA的內部的有其相應的Fabric，如何在開發過程中最好最大限度的使用它。
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FPGA SRL16 STARTUP
FPGA開發要注意的十大要點-FPGA器件選型的7個原則：器件供貨渠道和開發工具的支持、器件的硬件資源、器件的電氣接口標準、器件的速度等級、器件的穩定等級、器件的封裝和器件的價格。
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FPGA
6系列FPGA中使用塊RAM的心得(4)-然后調用sinplify，對其進行綜合，結果很不順利。首先是synplify報不支持器件，才發現synplify 9.6.2是2008年的產品，比Spartan6器件還要老。更新到Synplify Pro D-2010.03之后，器件是支持了，但是一綜合就報錯停止了，卻不提示有什么錯誤。
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FPGA RAM
6系列FPGA中使用塊RAM的心得(3)-接下來就是調用IPcore，來產生ROM的IP了。流程就不多講了，不清楚的同學可以看書，也可以簡單瀏覽一下。在建立IPcore的時候，選擇為Block Memory Generator，就進入了塊RAM的調用。
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