基于FPGA的QDPSK調制器的設計與實現
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經編譯后，可生成如圖5所示元件，元件名為QDPSK_PL，其中clk為系統時鐘；start為同步信號，高電平有效；datain_a和datain_b分別兩路輸入信號；dataout_a和dataout_b分別兩路輸出信號，其波形仿真圖如圖6所示。由圖6可以得到：當start為低電平時，兩路輸出信號都為0；當start信號為高電平時，對輸入信號(datain_a)有：datain_a=011111111001，此時dataout_a=010101010001，對輸入信號(datain_b)有：datain_b=011110111101，此時Dataout_b=010100101001，由此可以得出，元件QDSP_PL實現了由絕對碼到相對碼的變換。本文引用地址：http://www.104case.com/article/191008.htm
2．3 四相載波發生器的實現
由圖3可知，四相載波發生器主要產生4種頻率相同、相位互差π／2的載波信號。實現四相載波有很多種不同方法。可先由振蕩電路產生一定頻率的信號，再利用RC移相電路得到不同相位的波形；也可以利用NCO的Implementation項目設置啟用相位調制功能，通過設置相位調制精度輸出4種不同的相位。該系統利用QuartusⅡ5．2內部的PLL直接產生clk0和elk1兩路頻率相同、相位相差π／2的信號，再用2個非門分別對clk0和clk1取反，得到clk2和clk3。這樣就可以實現四相載波發生器的功能，其原理圖如圖7所示，圖8為輸出波形仿真圖。
把上述各部分所生的symbol在QuartusⅡ5．2提供的BlockDiagram／SchematicFile中用Graphic Editor編輯連接起來，就形成了圖1的虛線所示的部分，編譯后進行整體模塊仿真，經過器件編程，可將整體模塊程序燒寫到合適的FPGA芯片中，再配以相應的D／A器件及其他外圍電路，調試后即完成設計。
3 結束語
用FPGA來實現QDPSK信號發生器，電路簡單，設計靈活，便于修改和調試，可靠性高。另外，Ahera公司的QuartusⅡ5.2應用軟件具有較強大的開放性和綜合性。它可以利用其他各種EDA資源以及先進的設計方法，使其功能更加完善和強大。它可以實現從簡單的接口電路設計到復雜的狀態機，甚至“Sys-temon Chip”。它的可編程特性帶來了電路設計的靈活性，縮短了產品的“Time ToMarket”。
本文作者創新點：基于PLL提出了一種QDPSK的FPGA實現方案，采用自頂向下的設計思想，將系統分成串／并變換器、差分編碼器、邏輯選相電路、四相載波發生器等4大模塊，用原理圖輸入、VHDL語言設計和調用PLL核相結合的多種設計方法，分別實現了各模塊的具體設計，該方案極大地簡化了系統的設計過程和難度，甚至可做到不需要編寫任何程序實現QDPSK調制器的設計。
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