用數(shù)據(jù)說話:Intel AMD 臺積電三大芯片廠商制程技術(shù)發(fā)展對比
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關(guān)于摩爾定律：
本文引用地址：http://www.104case.com/article/101374.htm根據(jù)摩爾定律，集成電路技術(shù)每經(jīng)歷一次制程更新，電路尺寸便會縮小70%。除了晶體管的門極寬度尺寸之外，其中最令人感興趣的一個關(guān)鍵尺寸便是互連線彼此之間的間距尺寸。這個尺寸決定了電路中邏輯門電路的密度以及芯片中所能容納的晶體管數(shù)量。根據(jù)我們繪制的互連線間距尺寸發(fā)展圖，三家廠商的制程技術(shù)在這方面的進(jìn)展可謂不相上下，可見摩爾定律依然適用。
有趣的是，臺積電公司的互連線間距尺寸似乎要比其它兩家公司要更小一些，這大概是由于這家廠商主要面向SOC芯片，GPU/FPGA等產(chǎn)品的代工使然。盡管臺積電的制程技術(shù)制作出來的晶體管其運(yùn)行速度可能不及Intel或AMD，但其芯片產(chǎn)品內(nèi)部卻能集成數(shù)量超過10億支的大量晶體管。
新制程除了帶來電路關(guān)鍵尺寸的進(jìn)一步縮小之外，還衍生了很多新的制程技術(shù)。其中兩項(xiàng)具有重大意義的新技術(shù)便是漏源極嵌入硅鍺技術(shù) (eSiGe) 和high-k金屬門(HKMG)技術(shù)。eSiGe技術(shù)能增強(qiáng)PMOS晶體管的性能，而HKMG技術(shù)則有助于晶體管開關(guān)速度的提升，并可減小門極的漏電流。
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