- FPGA verilog實現的1602時鐘計數器-網上很少用人公開這一類代碼，一搜FPGA 1602，都是寫一個靜態的顯示，在實際應用中，是沒有用的，因此這個簡單的例子，給大家拋磚引玉了！
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FPGA 1602時鐘計數器
- 如何使用PlanAhead/Adept加速管腳排布-在排布FPGA管腳生成ucf文件的過程中，當FPGA管腳較多的時候，手工排布管腳不僅效率低，而且很容易出錯。借助PlanAhead和Adept等工具，可以很方便快速的實現管腳排布。
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PlanAhead Adept FPGA
- 組合邏輯設計中的毛刺現象-和所有的數字電路一樣，毛刺也是FPGA電路中的棘手問題，它的出現會影響電路工作的穩定性，可靠性，嚴重時會導致整個數字系統的誤動作和邏輯紊亂。
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毛刺 FPGA 電路
- FPGA管腳分配時需注意的一些事項-設計過FPGA的原理圖，看FPGA的手冊，說管腳的分配問題，如時鐘管腳要用GC類管腳，而且單端時鐘輸入時要用P類型的管腳，不能用N類型管腳等等。
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FPGA
- 學習FPGA需要注意的幾個重要問題-如何學好FPGA呢，很多人很困惑，多數停留在基礎位置徘徊，我就這方面問題給大家談幾點自己的看法。
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FPGA 數字電路 HDL語言
- FPGA專家教您如何在FPGA設計中使用HLS-Luke Miller并非一開始就是HLS（高層次綜合）的倡導者。在使用早期的工具版本的時候，他似乎有過一些糟糕的經歷。
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FPGA HLS
- 深度學習算法有望在FPGA和超級計算機上運行-由NSF資助的一個研究項目，目前正在研究如何使用RDMA高性能連接器將深度學習算法在FPGA和跨系統之間運行；另一個由Andrew Ng和兩個超算專家牽頭的項目，則希望把模型放在超級計算機上，給它們一個Python接口。
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FPGA 深度學習 人工智能
- 不可錯過的400Gbps以太網演示-在那里，毫無疑問你會駐足在賽靈思展位前（# 23）觀看一個基于賽靈思Virtex UltraScale VU095 FPGA評估板VCU109的Spirent 400G以太網測試系統，該系統連接四個100Gbps的住友電工 CFP4 LR4光模塊。
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賽靈思 FPGA 光模塊
- 一個FPGA中現在可集成多少32位RISC處理器？-Jan Gray是在FPGA中集成32位RISC處理器的專家，他寫了一篇博客叫作FPGA CPU 新聞，副標題為 “使用FPGA開發并行計算機體系架構”。
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FPGA RISC處理器
- 基于FPGA開放流程的SDN轉發引擎-博主Greg Ferro在其Ethereal Mind網頁上發布了一則關于 Corsa Technology簡短博客信息，提到Corsa公司制作了一對基于FPGA開放流程的SDN轉發引擎。Ferro同時簡單討論了此引擎是否適用于WANs網絡。
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SDN FPGA WAN
- 嵌入式視覺系統的構建模塊-在本文中我們將會介紹嵌入式視覺系統的高級元素；如何簡便快捷地使用軟件 API 和 IP 庫構建嵌入式視覺系統，如何把算法開發的增值部分添加到圖像處理鏈中。
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FPGA 嵌入式
- 片內時鐘的組合思路和設計技巧-我們都知道，當奇數個反相器串聯在一起，并且把最后一級的輸出反饋給第一級的輸入時，在邏輯上會產生震蕩，這樣的電路結構通常被稱為Ring OSC。
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FPGA RingOSC 片內時鐘
- DTU產品在橋隧監測系統中的應用-橋梁的應變監測系統中主要的部分就是橋梁應力信號的采集控制，通過對橋梁結構的應力監測系統特點進行詳細分析基礎上，，將FPGA嵌入式技術和無線網絡技術相結合，橋梁應力采集模塊實現橋梁應力數據采集以及A/D轉換，應力數據經串口到GPRS DTU，然后轉換為TCP/IP數據包，使用GPRSDTU通過GPRS 網絡傳送至Internet再發送數據到遠端的Web服務器，從而實現橋梁應力數據的實時遠程檢測監控。
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DTU產品 監測系統 FPGA 嵌入式技術
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