- 本文針對FPGA實際開發過程中，出現故障后定位困難、反復修改代碼編譯時間過長、上板后故障解決無法確認的問題，提出了一種采用仿真的方法來定位、解決故障并驗證故障解決方案。可以大大的節約開發時間，提高開發效率。
FPGA近年來在越來越多的領域中應用，很多大通信系統（如通信基站等）都用其做核心數據的處理。但是過長的編譯時間，在研發過程中使得解決故障的環節非常令人頭痛。本文介紹的就是一種用仿真方法解決故障從而減少研發過程中的編譯次數，最終達到準確定位故障、縮短解決故障時間的目的。文例所用到的軟件開發平臺
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FPGA 應用仿真
- 時鐘是整個電路最重要、最特殊的信號，系統內大部分器件的動作都是在時鐘的跳變沿上進行, 這就要求時鐘信號時延差要非常小, 否則就可能造成時序邏輯狀態出錯；因而明確FPGA設計中決定系統時鐘的因素，盡量較小時鐘的延時對保證設計的穩定性有非常重要的意義。
1.1 建立時間與保持時間
建立時間（Tsu：set up time）是指在時鐘沿到來之前數據從不穩定到穩定所需的時間，如果建立的時間不滿足要求那么數據將不能在這個時鐘上升沿被穩定的打入觸發器；保持時間（Th：hold time）是指數據穩定后
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FPGA 時鐘
- Altera公司今天宣布第二季度銷售額達到3.599億美元，比2008年第一季度增長7%，比2007年第二季度增長13%。在2008年第一季度0.839億美元凈收入和每股攤薄后收益0.27美元基礎上，第二季度凈收入增長到0.98億美元，每股攤薄后收益0.32美元。和2007年第二季度相比，今年第二季度凈收入增長22%，每股攤薄后收益增長43%。
上半年運營現金流為2.268億美元。第二季度，Altera以140萬美元回購其65,000普通股。到目前為止，在第三季度，Altera已經以1004萬美
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Altera FPGA Stratix
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視頻采集的主流實現方案有兩種：一是基于ASIC，該方案一般采用意法、AMD等公司的專用視頻處理芯片；二是基于DSP，主要采用TI、ADI等公司的DSP信號處理器。它們作為輔處理器，可在主CPU控制下進行視頻信號的采集壓縮。隨著FPGA的發展，通過SOPC技術實現視頻采集已成為一種易于開發、設計靈活的方案。而這主要得益于IP復用技術的發展。在FPGA上構建復雜嵌入式系統可利用既有的功能模塊及其驅動程序。該方案具有更大的集成度和靈活性，因而必將成為電子設計發展的一大趨勢。
本文介紹了
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SOPC 視頻采集 DSP ASIC FPGA
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數控電火花(electrical discharge machining，EDM)機床是一種實現工件精密加工的特種加工工具。早期的電火花成型加工機床的脈沖電源電路是用分立元件組成，或者是用單片機來實現。分立元件電路設計復雜，電路調試困難，基于單片機或者是32位的嵌入式CPU的脈沖電源性能有了很大的提高，也具有了很高的智能性，但對于不同的處理器，其移植性不太好，而且如果硬件電路一旦完成就不能進行更改與升級。而采用現場可編程門陣列FPGA在很好的繼承單片機或者是嵌入式CPU設計的電源的優點
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FPGA 脈沖電源 EDM 數控機床 嵌入式
- 隨著下一代視頻壓縮標準問世，行業從基本視頻處理向更復雜的集成處理解決方案轉移，這使得系統的要求超越了獨立DSP力所能及的視頻性能。FPGA以不到30美元的價格提供20GMACs以上的DSP性能，從而為成本敏感型軍事、汽車、醫療、消費、工業和安全應用填補了這一空白。只有FPGA能夠為整套端對端視頻解決方案提供邏輯、嵌入式處理、OS支持和驅動器。
妨礙開發人員將FPGA用于視頻應用的因素并非他們缺乏對FPGA性能優勢的了解，而是缺乏使用其設計流程的經驗，對于那些習慣于用C語言編程的傳統DSP程序開發
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FPGA 視頻套件 VSK Simulink
- 全球電子設計創新領先企業Cadence設計系統公司（納斯達克: CDNS），今天宣布推出Cadence® C-to-Silicon Compiler，這是一種高階綜合產品，能夠讓設計師在創建和復用系統級芯片IP的過程中，將生產力提高10倍。C-to-Silicon Compiler中的創新技術成為溝通系統級模型之間的橋梁，它們通常是用C/C++ 和SystemC寫成的，而寄存器傳輸級（RTL）模型通常被用于檢驗、實現和集成SoC。這種重要的新功能對于開發新型SoC和系統級IP，用于消費電子、無
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Cadence RTL SoC IP
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圖像處理系統的一個關鍵問題就是數據量龐大，數據處理相關性高，實時實現比較困難。即使采用高速單片機也無法滿足實時處理的需求，而DSP芯片則具有速度快，信號處理功能強大，實時性好等特點，因此，將DSP用于圖像處理可使這一難題得到較好的解決。
1 系統構成
本系統采用基于CameraLink接口的圖像輸出相機。DSP采用TI的TMS320C6711，這是一種高性能DSP處理器，其工作頻率為150 MHz，最大處理能力高達900MFLOps，該DSP既可滿足高速處理要求，又可滿足高
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DSP 圖象采集與處理 Camera Link USB FPGA
- 可定制微處理器內核有兩個特性：可配置性和可擴展性。可配置性是指設計工程師可以更改處理器的現有特性。可擴展性是指能加入處理器本身沒有的功能特點，從而增加處理器的基本功能。
從底層修改CPU結構的能力使得用戶可定制處理器很顯著地區別于傳統的結構固定的CPU，設計工程師在設計處理器功能時有更大的自由度，例如：在設計時可以根據具體的應用需要定義一組指令；加入新的通用寄存器；定義新的條件代碼；根據在仿真器上運行的軟件反饋信息來精細地調整指令和數據緩存的大小和結構；在SRAM或邏輯電路內實現內核寄存器文件以
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微處理器 內核 IP 緩存
- Tech Insights/Embedded Systems Design 2008年嵌入式市場調研報告表明，嵌入式系統設計人員在2008年要參與更多項目的開發，按期完成開發任務是他們最大的問題，有一半以上（大于50%）的開發項目不能按期完成。?
調查結果表明：自2005年以來，2008年新項目對應項目改進的比例是這幾年中最高的。在所有開發項目中，新開發項目占46%，剩余54%為以往開發項目的升級和改進。項目的改進和升級主要是針對新的軟件特性（占81%），或因采用了新處理器（55%），
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嵌入式 設計 工程師 商用OS 定制OS FPGA DSP MCU
- 一、概述
視覺技術是近幾十年來發展的一門新興技術。機器視覺可以代替人類的視覺從事檢驗、目標跟蹤、機器人導向等方面的工作，特別是在那些需要重復、迅速的從圖象中獲取精確信息的場合。盡管在目前硬件和軟件技術條件下，機器視覺功能還處于初級水平，但其潛在的應用價值引起了世界各國的高度重視，發達國家如美國、日本、德國、法國等都投入了大量的人力物力進行研究，近年來已經在機器視覺的某些方面獲得了突破性的進展，機器視覺在車輛安全技術、自動化技術等應用中也越來越顯示出其重要價值。本文根據最新的CMOS圖像采集芯片設
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機器人 機器視覺 CMOS 圖像傳感器 FPGA
- 1 UMTS版本的演進
早在上世紀90年代初期，歐洲電信標準協會(ETSI)就開始為3G標準征求技術方案，并將3G技術稱為UMTS(通用移動通信系統)。WCDMA(帶寬5MHz)建議是多種方案之一。其后，日本的積極參與極大地推動了3G標準的全球化步伐。1998年，日本和歐洲在寬帶CDMA建議的關鍵參數上取得一致，使之正式成為UMTS體系中FDD(頻分雙工)頻段空中接口的入選技術方案，并由此通稱為WCDMA。
UMTS是IMT-2000家族最主要的三種技術標準之一。作為一個完整的3G移動通
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IP 多媒體子系統 3G UMTS IMS
- 引言
隨著網絡技術的發展，各種分布式的網絡和局域網都得到了廣泛的應用[1]。分布式數據采集系統廣泛應用于船舶、飛機等采集數據多、實時性要求較高的地方。同步采集是這類分布式數據采集系統的一個重要要求，數據采集的實時性、準確性和系統的高效性都要求系統能進行實時數據通信。因此，分布式數據采集系統中的一個關鍵技術就是實現數據的同步傳輸。
由于產生時鐘的晶振具有頻率漂移的特性，故對于具有多個采集終端的分布式系統，如果僅僅在系統啟動時進行一次同步，數據的同步傳輸將會隨著系統運行時間的增長而失步。因此時
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數據采集 分布式 時鐘同步 FPGA
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ATM異步傳遞方式是建立在電路交換和分組交換基礎上的一種面向連接的快速分組交換技術，它采用定長分組作為傳輸和交換的單位，并具有端到端QOS保證、完善的流量控制和擁塞控制，以及較好的技術綜合能力等優勢，這些都是目前的IP技術所不及的。和傳統的STM電路相比，ATM技術對數據交換中猝發分組的適應能力和傳輸線路的利用率都是很高的。雖然，由于靈活性和價格的原因，ATM技術沒有獲得預期的成功，但其流量控制機制對當前變長分組骨干網的流量控制還是具有重要的參考價值，所以有必要對ATM的流量控制及其實
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IP核 ATM 流量控制器 CPLD FPGA
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