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基于FPGA的FIR數(shù)字濾波器設(shè)計(jì)與實(shí)現(xiàn)
- 簡要介紹了FIR數(shù)字濾波器的結(jié)構(gòu)特點(diǎn)和基本原理，提出基于FPGA和DSP Builder的FIR數(shù)字濾波器的基本設(shè)計(jì)流程和實(shí)現(xiàn)方案。在Mat lab／Simulink環(huán)境下，采用DSP Builder模塊搭建FIR模型，根據(jù)FDATool工具對FIR濾波器進(jìn)行了設(shè)計(jì)，然后進(jìn)行系統(tǒng)級(jí)仿真和ModelSim功能仿真，其仿真結(jié)果表明其數(shù)字濾波器的濾波效果良好。通過SignalCompiler把模型轉(zhuǎn)換成VHDL語言加入到FPGA的硬件設(shè)計(jì)中，從QuartusⅡ軟件中的虛擬邏輯分析工具SignalTapⅡ中得到數(shù)
- 關(guān)鍵字： 設(shè)計(jì) 實(shí)現(xiàn) 濾波器 數(shù)字 FPGA FIR 基于
基于FPGA實(shí)現(xiàn)異步串行通信
- 為了適應(yīng)全數(shù)字化自動(dòng)控制更加廣泛的應(yīng)用，采用現(xiàn)場可編程門陣列(FPGA)對異步串行通信控制器(UART)進(jìn)行多模塊的系統(tǒng)設(shè)計(jì)的方法，使串口通信的集成度更高。對UART系統(tǒng)結(jié)構(gòu)進(jìn)行了模塊化分解，可分為三個(gè)模塊：FPGA波特率發(fā)生器控制模塊、FPGA數(shù)據(jù)發(fā)送模塊及數(shù)據(jù)接收模塊。采用Venlog語言描述硬件功能，利用Xilinx公司的FPGA芯片，在Xilinx ISE Design Suite 13. 4環(huán)境下進(jìn)行設(shè)計(jì)、編譯、綜合、下載。采用第三方仿真工具M(jìn)odelSim進(jìn)行模擬仿真。
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基于FPGA的實(shí)時(shí)視頻圖像采集與顯示系統(tǒng)的設(shè)計(jì)與實(shí)
- 主要針對目前視頻圖像處理發(fā)展的現(xiàn)狀，結(jié)合FPGA技術(shù)，設(shè)計(jì)了一個(gè)基于FPGA的實(shí)時(shí)視頻圖像采集與顯示系統(tǒng)。系統(tǒng)采用FPGA作為主控芯片，搭栽專用的編碼解碼芯片進(jìn)行圖像的采集與顯示，主要包括解碼芯片的初始化、編碼芯片的初始化、FPGA圖像采集、PLL設(shè)置等幾個(gè)功能模塊。采用FPGA的標(biāo)準(zhǔn)設(shè)計(jì)流程及一些常用技巧來對整個(gè)系統(tǒng)進(jìn)行編程。重點(diǎn)在于利用FPFA開發(fā)平臺(tái)對普通相機(jī)輸出的圖像進(jìn)行采集與顯示，最終能在連接的RCA端口顯示屏顯示。
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基于FPGA的手持式示波器設(shè)計(jì)
- 在此設(shè)計(jì)的低成本手持式示波器是以ADC128S022模／數(shù)轉(zhuǎn)換芯片為數(shù)據(jù)采集前端；使用FPGA片內(nèi)雙口內(nèi)建RAM進(jìn)行數(shù)據(jù)存儲(chǔ)、有限狀態(tài)機(jī)實(shí)現(xiàn)示波器的觸發(fā)控制和顯示驅(qū)動(dòng)；最后再用LCD12864液晶模塊完成終端的低成本圖形顯示。在DE0-Nano FPGA(Altera Cyclone IV)開發(fā)板上的測試結(jié)果表明，所設(shè)計(jì)的手持式示波器可以實(shí)現(xiàn)模擬信號(hào)任意電平上升沿或下降沿的觸發(fā)測量；垂直靈敏度和掃描速度調(diào)節(jié)、波形參數(shù)的直接讀出等功能。
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京微雅格重磅之作―新版FPGA/CAP設(shè)計(jì)套件Primace5
- 簡介作為國內(nèi)唯一一家具有完全自主知識(shí)產(chǎn)權(quán)的FPGA與可配置應(yīng)用平臺(tái)CAP(Configurable Application Platform)產(chǎn)品供應(yīng)商，京微雅格一直在快節(jié)奏的改進(jìn)與產(chǎn)品配套的軟件開發(fā)環(huán)境。最近，新一代FPGA/CAP設(shè)計(jì)套件Primace5
- 關(guān)鍵字： 京微雅格 FPGA CAP設(shè)計(jì)套件 Primace5.0
車載計(jì)算機(jī)主板測試系統(tǒng)設(shè)計(jì)
- 針對當(dāng)前車載計(jì)算機(jī)主板的故障測試問題，設(shè)計(jì)了一個(gè)基于DSP控制的車載計(jì)算機(jī)主板檢測系統(tǒng)。該系統(tǒng)通過采集BIOS上電自檢的結(jié)果獲取故障代碼，以此判斷主板核心部件的好壞；通過設(shè)計(jì)外圍模塊的仿真測試板及測試程序來檢測主板外圍模塊的功能；最后的檢測結(jié)果通過維修檢測經(jīng)驗(yàn)數(shù)據(jù)庫給出輔助維修建議，也可通過無線數(shù)據(jù)傳輸獲取遠(yuǎn)程的專家維修指導(dǎo)。應(yīng)用結(jié)果表明：該檢測系統(tǒng)能檢測主板的常見故障，顯示主板的故障位置，并根據(jù)維修建議便于實(shí)際維修，較好地解決了該類主板的檢測維修問題。
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基于FPGA的八通道超聲探傷系統(tǒng)設(shè)計(jì)
- 文中提出了一種基于FPGA的八通道超聲探傷系統(tǒng)設(shè)計(jì)方案。該系統(tǒng)利用低功耗可變增益運(yùn)放和八通道ADC構(gòu)成高集成度的前端放大和數(shù)據(jù)采集模塊；采用FPGA和ARM作為數(shù)字信號(hào)處理的核心和人機(jī)交互的通道。為了滿足探傷系統(tǒng)實(shí)時(shí)、高速的要求，我們采用了硬件報(bào)警，缺陷回波峰值包絡(luò)存儲(chǔ)等關(guān)鍵技術(shù)。此外，該系統(tǒng)在小型化和數(shù)字化方面有顯著提高，為便攜式多通道超聲檢測系統(tǒng)設(shè)計(jì)奠定基礎(chǔ)。
- 關(guān)鍵字： 系統(tǒng) 設(shè)計(jì) 探傷 超聲 FPGA 通道 基于
基于大容量FPGA的多節(jié)點(diǎn)系統(tǒng)的遠(yuǎn)程升級(jí)的實(shí)現(xiàn)
- 引言 多節(jié)點(diǎn)系統(tǒng)，在目前的很多電子系統(tǒng)應(yīng)用場合都可以看到。這種多節(jié)點(diǎn)系統(tǒng)由于具有結(jié)構(gòu)可擴(kuò)展性、 ...
- 關(guān)鍵字： FPGA 多節(jié)點(diǎn)系統(tǒng) 遠(yuǎn)程升級(jí)
基于DSP的列車應(yīng)變力測試系統(tǒng)設(shè)計(jì)方案
- 摘 要：本文介紹了基于TMS320VC33 DSP芯片的應(yīng)變力測試系統(tǒng)的設(shè)計(jì)，給出了結(jié)構(gòu)原理框圖，并圍繞DSP設(shè)計(jì)了測試系統(tǒng) ...
- 關(guān)鍵字： DSP 列車應(yīng)變力 測試系統(tǒng)
Cadence FSP:FPGA-PCB系統(tǒng)化協(xié)同設(shè)計(jì)工具介紹
- Cadence FPGA System Planner（FSP）是一款完整性高的FPGA-PCB系統(tǒng)化協(xié)同設(shè)計(jì)工具。此次主要為大家介紹FPGA Sys ...
- 關(guān)鍵字： Cadence FSP:FPGA-PCB 設(shè)計(jì)工具
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