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        cpld/fpga 文章 最新資訊

        基于FPGA技術的RS 232接口時序電路設計

        • 摘要:RS 232接口是現在最常用的一種通信接口。隨著FPGA技術的高速發展,一些常見的接口電路的時序電路可以通過FPGA實現,通過這種設計可減少電路系統元件的數量,提高系統集成度和可靠性。詳細闡述了如何通過FPGA實
        • 關鍵字: FPGA  232  接口時序  電路設計    

        基于FPGA的LCD測試用信號發生器設計

        • 摘要:在檢測液晶屏特性和質量時,需要控制液晶屏顯示一些標準信號。已有的一些信號產生設備產生的是AV信號、VGA信號或YPhPr信號等模擬制式的信號。模擬制式的信號需要經過圖形處理器(GPU)轉換成數字LVDS信號,然后輸
        • 關鍵字: FPGA  LCD  測試  信號發生器    

        基于FPGA的數字穩定校正單元的實現

        • 摘要:為了實現對非相干雷達的接收相參處理,基于數字穩定校正(DSU)的原理,采用ALTERA公司的StratixⅡ系列芯片和VHDL編程語言,設計了一種基于FPGA的DSU硬件實現方法。實驗結果表明基于FPGA的DSU方法可以提高程序的
        • 關鍵字: FPGA  數字穩定校正    

        基于ARM+FPGA的高速同步數據采集方案

        • 標簽:ARM+FPGA 數據采集大多數的勘探、觀測工作都是在嚴苛的環境中進行的,對數據的準確性、實時性都有著較高的要求,并且大多情況下要求多參數同步測量。北京恒頤針對勘探、測控等行業的特點,推出了基于ARM+FPGA
        • 關鍵字: 數據采集  方案  同步  高速  ARM  FPGA  基于  

        嵌入式與邊界設備提供了測試機會

        • 有兩類應用提出了設計與測試挑戰,雖然它們并不要求最高的帶寬、數據速率和存儲器深度。據Agilent技術公...
        • 關鍵字: 嵌入式系統  測試與測量  FPGA  

        Altera發售業界最快、具有背板功能收發器的Stratix V FPGA

        •         2012年8月1號,北京——Altera公司(Nasdaq: ALTR)今天宣布,開始批量發售FPGA業界性能最好、具有背板功能的收發器。Altera的Stratix® V FPGA是業界唯一能夠提供14.1 Gbps收發器帶寬的FPGA,也是唯一支持最新一代光纖通道協議(16GFC)的FPGA。背板、交換機、數據中心、云計算應用、測試測量系統以及存儲區域網的開發人員采用Altera最新一
        • 關鍵字: Altera  FPGA  

        利用FPGA搭建高等級視頻監控系統

        • 標簽:HD PCB全視頻幀速率下的高分辨率(HD)安全監控處理系統對處理器件的要求越來越高,單芯片DSP處理已經無法適應,多芯片、多核或者CPU+DSP的方式雖然在某些情況下能夠滿足需求,但其在PCB成本、系統資源占用以及
        • 關鍵字: 視頻  監控系統  高等級  搭建  FPGA  利用  

        基于CPLD的雙口模塊設計

        • 摘要:文章介紹了設計Multibus雙口模塊的方法。通過采用CPLD技術來實現模塊內部邏輯,簡化了模塊的邏輯電路設計,提高了整個模塊的穩定性和可靠性。達到了優化傳統Multibus總線模塊采用邏輯門電路和觸發器來實現內部
        • 關鍵字: CPLD  雙口  模塊設計    

        基于FPGA的34位串行編碼信號設計與實現

        • 摘要:為實現某專用接口裝置的接口功能檢測,文中詳細地介紹了一種34位串行碼的編碼方式,并基于FPGA芯片設計了該類型編碼的接收、發送電路。重點分析了電路各模塊的設計思路。電路采用SOPC模塊作為中心控制器,設計
        • 關鍵字: FPGA  串行  編碼  信號設計    

        基于FPGA的DDC設計及仿真

        • 摘要:在軟件無線電數字接收機中,從AD前端采集過來的數字信號頻率高達72 MHz,如此高的頻率使得后端DSP不能直接完成相關的數字信號處理任務。因此合理的設計基于FPGA的DDC,以降低數字信號頻率,方便后端DSP實時完成
        • 關鍵字: FPGA  DDC  仿真    

        基于FPGA部分動態可重構的信號解調系統的實現

        • 摘要:針對調制樣式在不同環境下的變化,采用了FPGA部分動態可重構的新方法,通過對不同調制樣式信號的解調模塊的動態加載,來實現了不同環境下針對不同調制樣式的解調這種方式比傳統的設計方式具有更高的靈活性、可
        • 關鍵字: FPGA  部分動態可重構  信號解調系統    

        基于CPLD的臭氧電源控制系統方案設計

        • 臭氧發生器供電電源是臭氧發生器的重要組成部分,供電電源的電壓、頻率和波形是影響臭氧發生器效率的重要因素。發生器的結構、氣源和冷卻系統確定后,電源系統的性能與品質就成為影響發生器效率的關鍵。  1 系統硬
        • 關鍵字: 控制系統  方案設計  電源  臭氧  CPLD  基于  

        基于Verilog HDL語言的CAN總線控制器設計及驗證

        • 摘要:在此利用VerilogHDL設計了一款CAN總線控制器,首先根據協議把整個CAN總線控制器劃分為接口邏輯管理、寄...
        • 關鍵字: CAN總線  控制器  FPGA  Verilog  HDL  

        基于FPGA的雙模式光伏電池測試儀

        • 摘要:為了解決傳統的光伏測試儀功能單一,只能夠測量光伏電池基本參數的問題,采用了增加采樣信道,由FPGA控制采樣模式的方法,設計完成了一款雙模式的光伏電池測試儀。在完成光伏電池I-V曲線等參數測量的同時可以實
        • 關鍵字: FPGA  雙模式  光伏電池  測試儀    

        MP3數字播放機系統的FPGA設計介紹

        • MP3數字播放機系統的FPGA設計介紹,1 引 言

          MPEG(活動影像專業人員組織)是為數字音頻確定單一編碼和解碼(壓縮/解壓縮)方法于1988年建立的。1992年,國際標準組織(ISO)和國際電工委員會(IEC)為音頻和視頻編碼建立了MPEG1(ISO/IEC11172)標準
        • 關鍵字: 設計  介紹  FPGA  系統  數字  播放機  MP3  
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