引 言
隨著半導體制造工藝的發展，以FPGA(現場可編程門陣列)為代表的新一代可編程邏輯器件(PLD)的邏輯資源密度不斷增加，使得可編程技術很自然地就與系統芯片集成技術(SoC)的結合日益緊密，并逐步成為可配置平臺技術(configurable platform)的主流。
目前，各主要PLD廠商基于FPGA的可配置平臺雖然大都采用“微處理器十可編程邏輯”的架構，但在開發基于FPGA的嵌入式系統時，卻采用了各自不同的方式來整合處理器系統與片上的其他邏輯資源(大多數以用
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IP核 FSL MicoBlaze FPGA RISC OPB LMB
設計并實現一個能完成IP協議功能的ASIC器件；討論器件的穩定工作條件。任何數字化的工業設備都可以使用個IP協議器件直接連接到基于IP的網絡中。
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嵌入式系統 IP ASIC
? 為幫助設計人員提高集成度，進一步創新，Altera公司今天發布了業界的首款40-nm FPGA和HardCopy? ASIC。Stratix? IV FPGA和HardCopy IV ASIC都提供收發器，在密度、性能和低功耗上遙遙領先。Stratix IV系列有680K邏輯單元(LE)，比Altera的Stratix III系列高2倍，是目前市場上密度最大的FPGA。HardCopy IV ASIC系列在密度上和Stratix IV器件等價，具有1330萬邏輯門。Alte
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Altera 40-nm FPGA ASIC
引 言
視頻監控系統的設計方案有很多種，但是市場產品的主流一般選擇兩種方案：一是基于CPU和專用的視頻編解碼ASIC芯片。該方案選擇以ARM為核心的CPU和專用媒體處理芯片搭建。優點是開發時間相對較短，但由于采用ASIC，靈活性較差，產品一旦定型，很難更改。二是采用面向媒體處理的專用DSP。其開發時間不長，優點是由于算法是軟件代碼，所以可以不斷對產品性能進行升級，重復開發成本較低。由全球最大的DSP制造商德州儀器（TI）推出的TMS320DM642（以下簡稱DM642）作為一款高性價比、專用于多
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多媒體 處理器 視頻監控 ASIC CPU DSP CCS DM642
若要問：半導體業哪個領域最有趣？我認為FPGA。作為記者，大家一提起FPGA公司就很興奮，太充滿活力了，有時過分得充滿戲劇性。
當中國第一高樓——上海金茂大廈剛剛落成時，A公司在上海成立辦事處，邀請記者從北京到上海觀摩，下榻金茂。一周后，X公司也宣布已經成立上海辦事處，也盛情邀請記者去那里看看，也同樣入住金茂。
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FPGA 半導體 ASIC CPLD
引 言
在基于MicroBlaze的SOPC系統中，將用戶IP核整合到基于MicroBlaze的嵌入式軟核處理器系統中，通常有兩種方法：一種是將IP核連接到OPB總線；另一種是將用戶IP連接到MicroBlaze專用的FSL總線上。盡管OPB和FSL總線都是MicroBlaze軟核與FPGA其他片上邏輯資源連接的主要途徑，但它們的分工足不同的。OPB總線適用于將要求低速和低性能的設備連接到MicroBlaze系統中；而FSL總線則適用于將對時間要求高的用戶自定義IP核，整合到基于MicroBla
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FSL UART IP核 SOPC OPB MicroBlaze
隨著醫療儀器設備向智能化、微型化、系列化、數字化和多功能方向的發展，醫療設備中邏輯控制器件也由采用中、小規模的集成芯片發展到應用現場可編程門陣列FPGA(Field Programmable Gate Array)。使用FPGA器件可以大大縮短醫療設備的研制周期，減少開發成本，同時還可以很方便地對設計進行在線修改，因此FPGA在醫療設備中有很廣泛的應用[1]。
本文主要搭建一個多生理參數測量系統的數據處理平臺，在FPGA中嵌入一個32位Nios II軟核處理器，用于控制數據的傳輸、存儲及顯示。主
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Nios 多生理參數處理 FPGA 傳感器 VGA IP核 SoPC
0引言
對于一個普通的GPS(全球定位系統)接收機來說，其對信號的捕獲和追蹤均由硬件進行處理，主要是用ASIC(專用集成電路)實現。用ASIC的主要好處之一是它的有效性，能夠對GPS信號進行有效處理，但它的造價較高，而目前GPS技術還在高速發展，各種算法還在不斷研究，如果都用ASIC來實現，顯然并不現實。而使用軟件來模擬搭建GPS的接收系統，不但可以方便地對現有的一些算法進行比較，而且也能快速地應用到實際中。在該系統中，用A／D轉換器將輸入的模擬信號數字化，然后交由軟件接收機處理，由此重構的系統
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GPS ASIC A／D轉換器 MATLAB
引 言
80C51系列單片機是一類經典的8位微處理器，其設計方法和體系結構一直是其他各類單片機設計的參考典范，自從20世紀80年代面世以后，得到了極大的發展與應用。直到今天，市場上還有一大部分單片機應用成品將其作為處理核心?；?0C51系列單片機無知識產權保護、市場應用廣泛等優點，對其進行功能拓展，既有利于經濟上節約成本，也有利于成果的推廣使用。而隨著單片機應用日趨復雜化，傳統的51系列單片機在設計上的不足逐漸顯現出來。如在現有128字節內部RAM基礎上，處理一些比較復雜的算法就顯不足。鑒于此
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RAM 單片機 微處理器 IP核 仿真測試
Catalyst半導體繼續快速擴展電壓監控產品線，為微處理器、微控制器，ASIC器件和其它系統處理器的應用新增一款高精度超低功耗5通道監控器件。5通道電壓監控被整合于一個小尺寸的8引腳MSOP封裝之內，CAT885能有效降低系統成本、節約電路板空間。
CAT885具備低有效漏極開路輸出及手動復位輸入的特點，可針對各種電子產品完成系統復位和監控功能。CAT885可以監控多達5通道的系統電壓，若所有被監控的電源電壓已經超過額定電平值，并且隨后被啟動的器件內部計時器超時溢出后，有效的復位輸出才會終止，
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Catalyst 電壓監控器 微處理器 微控制器 ASIC
許多通信系統都要用到多速濾波器(multirate filter)，多速濾波器是指輸出數據速率與輸入數據速率不相等的濾波器，常用于某個物理接口如數模轉換器(DAC)或模數轉換器(ADC)的接口處。
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ASIC DSP PLD 濾波器設計
世界級ASIC設計晶圓廠及定制解決方案供應商VeriSilicon Holdings Co., Ltd.（VeriSilicon）“已經加盟功耗前鋒倡議”（ Power Forward Initiative，PFI），計劃為其ASIC客戶提供基于通用功率格式（Common Power Format，CPF）的設計解決方案。
VeriSilicon采用Cadence低功耗解決方案，是業界領先的完整的設計流程，以Si2標準的CPF為基礎，貫穿邏輯設計、驗證、實現等技術。這種針
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晶圓 VeriSilicon ASIC 低功耗 CPF
IP（Intellectual Property），即常說的知識產權。在PLD領域中，IP核是指將數字系統中常用但比較復雜的一些功能塊設計成參數可調并以HDL源文件或加密網表形式存在的可供其他用戶直接調用的軟件模塊。由于已經過嚴格的測試和優化，使用IP核可以顯著減小設計和調試時間，提高開發效率，降低產品成本。本文以一款結構經參數化的全功能硬件掃描鍵盤控制器的開發為例，闡述IP核設計的一般方法與步驟。
1 設計的意義與可行性
鍵盤是計算機系統中最常用的人機交互輸入設備。在嵌入式系統中，用R+
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掃描鍵盤，IP核
ASIC和SoC器件成本的逐步上升迫使半導體供應商必須進一步開拓各個器件的市場以尋求滿意的投資回報。日益增長的軟件使用為此提供了有效的機制，因為增加的軟件內容等同于更多的功能和軟件變化提供了特定市場產品的差異化。
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ASIC SoC 原型設計 軟件技術
asic ip核介紹
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