智能系統基礎設施軟件提供商RTI公司近日公布，Connext Drive? 3.1已經達到APISCE CL1標準，在新一代汽車開發過程中足以為OEM提供更高的可靠性和靈活性。基于數據分發服務(DDS?)標準，Connext Drive 提供最高的質量、功能安全性和信息安全性，非常適合用于建構和開發軟件定義汽車。RTI公司產品管理總監Niheer Patel指出：“軟件標準絕不僅僅是一些功能特性，它必須遵循嚴格的功能安全性和信息安全性要求，同時足以成為汽車開發與運行的堅實基礎。Connext Drive采
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RTI公司 汽車軟件 DDS
現在，雖然相位累加器非常精確，但輸出受到查找表中條目數量有限的影響：從一個條目轉到下一個條目時，輸出值會“跳躍”。 這對于低輸出頻率特別敏感，但也會影響高輸出頻率，這會在輸出頻譜中引入不需要的頻率。我們將解決這個問題。 為了便于理解，讓我們回到 15 位相位累加器。// sine without linear interpolationreg [14:0] phase_acc; ? ?// 15bitalways @(posedge clk) phase_acc <= phase
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FPGA DDS 插值
DDS的第二個技巧是長相位累加器。 它允許來自DDS輸出的信號頻率非常靈活。我們將通過一個示例了解它是如何工作的。 讓我們從這個簡單的代碼開始。reg [10:0] cnt; ? // 11bit counteralways @(posedge clk) cnt <= cnt + 11'h1;sine_lookup my_sine(.clk(clk), .addr(cnt), .value(sine_lookup_output));計數器實際上是一個“相位累加器”。 那是因為它每次
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FPGA DDS 相位累加器
為了生成任意信號，DDS 依賴于兩個主要技巧。LUT第一個 DDS 技巧是 LUT（查找表）。 LUT 是一個表格，用于保存我們想要生成的模擬信號的形狀。在FPGA中，LUT是作為blockram實現的。 在上圖中，我們使用了 512x10 位 LUT，它通常適合一個或兩個物理 FPGA 模塊。正弦波最常產生的信號形狀是正弦波。 它很特別，因為它有兩個對稱性，可以很容易地利用它們來使 LUT 看起來更大。在正弦波中，第一個對稱性是sin（α）=sin（π-α）。假設我們的 “my_DDS_LUT” blo
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FPGA DDS LUT
讓我們看看FPGA DSS實現是多么容易。DAC接口好的，您的新FPGA板具有快速DAC（數模轉換器）模擬輸出。 下面是一個運行頻率為10MHz的100位DAC的電路板設置。在100MHz頻率下，FPGA每10ns向DAC提供一個新的10位值。DAC輸出模擬信號，對于周期性信號，奈奎斯特限值表示可以達到高達50MHz的速度。一個簡單的DDSDDS 通常用于生成周期性信號。 現在，讓我們嘗試一些簡單的東西并生成一個方波。module SimpleDDS(DAC_clk, DAC_data);input DA
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FPGA DDS DAC接口
直接數字頻率合成技術 (Direct Digital Synthesis)，簡稱 DDS，它是一種基于數字電子電路的頻率合成技術，用于產生周期性波形，通常應用在一些頻率激勵 / 波形發生、頻率相位調諧和調制、低功耗 RF 通信系統、液體和氣體測量；還有接近度、運動和缺陷檢測等傳感器場合也可以找到 DDS 的身影。總體而言，目前從低頻到幾百 Mhz 的正弦波、三角波產生，絕大多數都使用了 DDS 芯片。本文將由ADI代理商駿龍科技的工程師Luke Lu引領大家更進一步地了解 DDS。DDS 的核心思想對于一
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DDS AD9834 電子電路
在涉及射頻(RF)的硬件測試中，選擇可配置、已校準的可靠信號源是其中最重要的方面之一。本文提供了基于Raspberry Pi的高度集成解決方案，其可用于合成RF信號發生器，輸出DC至5.5 GHz的單一頻率信號，輸出功率范圍為0 dBm至-40 dBm。所提出的系統基于直接數字頻率合成(DDS)架構，并對其輸出功率與頻率特性進行了校準，可確保在整個工作頻率范圍中，輸出功率保持在所需功率水平的±0.5 dB以內。簡介RF信號發生器，尤其是微波頻率的RF信號發生器，以前通常是基于鎖相環(PLL)頻率合成器1來
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ADI RF測試 DDS
因鎖相環可以實現輸出信號頻率對輸入信號頻率的自動跟蹤，所以鎖相環通常用于閉環跟蹤電路。鎖相環在工作的過程中，當輸出信號的頻率與輸入信號的頻率相等時，輸出電壓與輸入電壓保持固定的相位差值，即輸出電壓與輸入電壓的相位被鎖住，這就是鎖相環名稱的由來。因鎖相環可以實現輸出信號頻率對輸入信號頻率的自動跟蹤，所以鎖相環通常用于閉環跟蹤電路。鎖相環在工作的過程中，當輸出信號的頻率與輸入信號的頻率相等時，輸出電壓與輸入電壓保持固定的相位差值，即輸出電壓與輸入電壓的相位被鎖住，這就是鎖相環名稱的由來。 什么是PL
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PLL
簡介市場對更高帶寬和更高數據速率的需求日益增加，系統頻率和調制速率要求不斷提高。隨著曾經用于軍事和國防領域的應用進入消費市場，低功耗變得至關重要。在滿足這些要求的同時，還需要保證：不會犧牲電氣性能或功能。為了滿足這些要求，除了改善進信噪比(SNR)、誤碼率(BER)和用戶熟悉的優質服務外，還必須改善本地振蕩器(LO)的相位噪聲。?新推出的?ADF5610?是一款集成式鎖相環(PLL)和壓控振蕩器(VCO)，充分體現了ADI致力于解決這些問題最終取得的成果。頻率覆蓋范圍ADF5
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SNR LO VCO LUT PLL
全球最大的智能機器及應用系統軟件框架提供商RTI公司近日宣布，與Indy自動駕駛汽車挑戰賽（Indy Autonomous Challenge ，IAC)）攜手合作，推進相關技術研發，同時助力汽車行業新一代領先者脫穎而出。Indy自動駕駛汽車挑戰賽是一項為期兩年、獎金高達150萬美元的賽事。RTI公司為全球500多名學生提供軟件，支持他們對Dallara IL-15賽車的控制系統進行改造以實現完全自動駕駛。學生們將于2021年10月在全球最大的賽車場——印第安納波利斯賽車道（Indianapolis Mo
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IAC DDS
鎖相環(PLL)電路是由壓控振蕩器(VCO)和鑒相器組成的反饋系統，振蕩器信號跟蹤施加的頻率或相位調制信號是否具有正確的頻率和相位。需要從固定低頻率信號生成穩定的高輸出頻率時，或者需要頻率快速變化時，都可以使用PLL。典型應用包括采用高頻率、電信和測量技術實現濾波、調制和解調，以及實現頻率合成。圖1所示為基于PLL的頻率合成器框圖。VCO生成輸出信號。通過PLL將其保持在設定頻率，并鎖定到基準頻率。基準頻率通常由非常精準的石英振蕩器提供。在鎖相環電路的反饋路徑部分，在鑒相器前通過分頻器提供可調的VCO分頻
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VCO PLL
RTI公司(Real-Time Innovations) 近日宣布加入百度阿波羅自動駕駛合作伙伴生態系統。RTI公司是最大的智能機器-現實系統互連軟件框架提供商。阿波羅是百度公司針對無人駕駛汽車提供的開源全棧軟件解決方案。RTI公司將與原始設備制造商、一級供應商、開發者平臺和創新企業組成精英團隊，共同努力加速阿波羅無人駕駛操作平臺及自動駕駛技術的開發和應用。百度公司從2013年開始研發自動駕駛技術，其阿波羅計劃已經成為全球規模最大的開源自動駕駛平臺。阿波羅擁有強大的全球生態系統，包括全球各地近200家合作
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OEM IIoT AVP DDS
系統管理員一致認為：部署和管理大型分布式系統非常復雜。如果您有數百個應用程序，則很難手動執行所有操作。為了克服這個問題，容器技術已被廣泛應用于各種行業的大規模分布式系統中。 容器是打包應用程序及其依存關系的軟件部署單元。容器技術對于數據分發服務（Data Distribution Service?）系統可能很有用，尤其是在您擁有大型系統并且需要遠程部署、更新和擴展它的情況下。在這方面，RTI公司已經探索Docker和Kubernetes已有相當一段時間了。 作為RTI研究團隊內工作的一
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DDS CNCF NAT
Teledyne e2v 今日再次拓展旗下的數位類比轉換器（DAC）IC 產品。透過其附帶的評估平臺，工程師可以提早將新的硬體應用于設計專案中。該公司將在近期開始提供第一波的 EV12DD700 雙通道 DAC 樣本，其運作頻率最高可達 Ka 波段。此 DAC 支援波束成形應用，主要用于任務關鍵性的微波系統。其擁有 25GHz 的輸出頻寬與僅僅 3dB 的衰減值。在衰減值僅些微高于 3dB 的情況下，頻寬可更進一步大幅提升。每一個 DAC 皆內建一系列發展成熟的信號處理功能，包括可程式化的 an
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