- 電子產品世界,為電子工程師提供全面的電子產品信息和行業解決方案,是電子工程師的技術中心和交流中心,是電子產品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網絡家園
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流水線 指令譯碼器 ARM
- 1 MAX1200的特點功能 新型ADC正在朝著低功耗、高速、高分辨率的方向發展，新型流水線結構正是實現高速低 ...
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流水線 高速 低功耗 ADC
- 摘要：在對低噪聲CMOS圖像傳感器的研究中，除需關注其噪聲外，目前數字化也是它的一個重要的研究和設計方向，設計了一種可用于低噪聲CMOS圖像傳感器的12 bit，10 Msps的流水線型ADC，并基于0．5mu;m標準CMOS工藝進行
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ADC 設計 及其 驗證 流水線 傳感器 噪聲 CMOS 圖像 用于
- 快速傅里葉變換(FFT)算法實現的流水線結構FFT處理器在實時專用處理器中得到了廣泛應用.Bi和Jones提出一種固定1024點流水線FFT處理器結構，該結構在運算的每級只采用一個復數乘法器.基于此結構Hasan設計了一種能夠進行
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1024 FFT 流水線 處理器
- 摘要：對多標準無線通信系統中的A／D轉換器進行了研究，根據無線通信系統的特點，構建了一個新型可重構流水線A／D轉換器結構，該A／D轉換器的可重構功能是通過在低分辨率下關斷子級流水線來實現的。轉換器的系統指標
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設計 ADC 流水線 重構
- 摘要：行為級仿真是提高流水線(pipeline)ADC設計效率的重要手段。建立精確的行為級模型是進行行為級仿真的關鍵。本文采用基于電路宏模型技術的運算放大器模型，構建了流水線ADC的行為級模型并進行仿真。為驗證提出模
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仿真 行為 ADC 流水線
- 引 言圖像的編解碼技術是多媒體技術的關鍵，H．264／AVC是國際上最先進的視頻壓縮技術，其主要特點是采用小尺寸整數余弦變換、1／4像素的運動估計精度、多參考幀預測，基于上下文可變長度編碼和環路內去塊效應濾波器
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264 流水線 濾波技術 效應
- 1 引言 在數字化飛速發展的今天，人們對微處理器的性能要求也越來越高。作為衡量微處理器 性能的主要標準，主頻和乘法器運行一次乘法的周期息息相關。因此，為了進一步提高微處 理器性能，開發高速高精度的乘法器
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FPGA 流水線 浮點 乘法器設計
- 快速傅里葉變換(FFT)算法實現的流水線結構FFT處理器在實時專用處理器中得到了廣泛應用.Bi和Jones提出一種固定1024點流水線FFT處理器結構，該結構在運算的每級只采用一個復數乘法器.基于此結構Hasan設計了一種能夠進行
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1024 FFT 流水線 處理器
- 摘要：采用TSMC 0．18 mu;m 1P6M工藝設計了一個12位50 MS／s流水線A／D轉換器(ADC)。為了減小失真和降低功耗，該ADC利用余量增益放大電路(MDAC)內建的采樣保持功能，去掉了傳統的前端采樣保持電路，采用時間常數匹配
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流水線 轉換器 CMOS MS 12位 一種
- 電子產品世界,為電子工程師提供全面的電子產品信息和行業解決方案,是電子工程師的技術中心和交流中心,是電子產品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網絡家園
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數據集成 流水線 內存控制
- 本文給出了電子產品流水線上使用的自動送板機設計方案。描述了硬件系統和軟件系統，通過測試表明，該系統能夠完成對電子產品流水線上自動貼片機／插裝機的自動送板。可有效提高生產效率，降低工人勞動強度。
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設計 自動 流水線 電子產品
- 本文設計了一個可用于12 bit，20 MS／s流水線ADC中的采樣／保持電路。該電路使用CSMC公司的0.5μm CMOS工藝庫，在20 MS／s采樣頻率下，當輸入信號的頻率為9.8193 MHz時，SFDR為76 dB，精度達0.012％，完全滿足12 bit要求。本文運用增益增強型折疊式運算放大器，以獲得較高的增益和帶寬。同時采用柵壓自舉開關，并通過對電路中的開關組合優化，極大的提高了電路的線性性能；采用全差分結構、底極板采樣來消除電荷注入和時鐘饋通。該采樣保持電路能夠直接應用于高速高精度模／數轉換
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保持 電路 設計 采樣 ADC bit 流水線 適用于
- 本工程設計完全符合IP核設計的規范流程，而且完成了Verilog HDL建模、功能仿真、綜合、時序仿真等IP核設計的整個過程，電路功能正確。實際上，本系統在布局布線后，其系統的最高時鐘頻率可達80MHz。雖然使用浮點數會導致舍入誤差，但這種誤差很小，可以忽略。實踐證明，本工程利用流水線結構，方便地實現了高速、連續、大數據量浮點數的加法運算，而且設計結構合理，性能優異，可以應用在高速信號處理系統中。
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FPGA 流水線 浮點 加法器
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