安富利電子元件 (Avnet Electronics Marketing) 與賽靈思公司(Xilinx, Inc.)再次攜手舉辦X-Fest 2010系列研討會，并將展開亞洲之旅。此次環球研討會的亞洲行將于2010年1月12日在北京拉開帷幕，隨后將在中國大陸、臺灣、韓國、新加坡、澳大利亞及印度的其他十個城市相繼舉辦。
這次X-Fest技術研討會在全球37個城市舉辦，其中包括亞洲地區的11個城市。這為期一天的研討會為FPGA、DSP和嵌入式系統設計人員提供實用的技能培訓，它將提供多種時長75分鐘的
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Avnet FPGA DSP
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FPGA 電動機 微機保護 實現方法
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FPGA 路由 查找算法
全球可編程邏輯解決方案領導廠商賽靈思公司(Xilinx, Inc.)日前宣布，作為公司目標設計平臺最新一步的發展，賽靈思同時推出六大領域優化開發套件。目標設計平臺是賽靈思公司幫助開發人員在FPGA 設計時專注于產品創新與差異化的創新理念。這些面向Virtex-6 和 Spartan-6 系列的開發平臺可大幅縮短實現最佳系統性能所需的時間，同時還確保片上系統 (SoC) 開發階段的低功耗水平。這些最新套件主要針對嵌入式處理、DSP，以及構建要求高速串行連接功能的系統，為設計團隊提供了專門針對設計流程而精
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Xilinx 開發套件 Virtex FPGA
Altera 公司今天宣布推出其面向 Stratix?IV FPGA 的最新開發套件。Stratix IV E FPGA 開發套件具有業界最高密度、最高性能的 FPGA。該套件為用戶提供了全面的設計環境，其中包括迅速開始其高密度原型產品設計所需的硬件和軟件。
Stratix IV E FPGA 開發套件基于高性能、高密度的 Stratix IV EP4SE530 FPGA。該 FPGA 具有 530K 邏輯元件 (LE)，比當前市場上同類競爭產品的 FPGA 性能平均高 25%。S
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Altera Stratix FPGA
0引言 測頻和測脈寬現在有多種方法。通常基于MCU的信號參數測量，由于其MCU工作頻率很低，所以能夠達到的精度也比較低，而基于AD10200和FPGA的時域測量精度往往可達10 ns，頻率測量精度在100 kHz以內。適應信號
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FPGA ADC 脈沖信號 測量
摘要：在數字通信的數據傳輸過程中，需要保持數據在傳輸過程中的同步，因此要在數據傳輸過程中插入幀同步字進行檢測，從而有效避免發送數據和接收數據在傳輸過程中出現的異步問題。文中提出了一種采用流水線技術、
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FPGA 高速數字
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FPGA 802 16d 定時同步算法
基于FPGA和DDS的信號源設計,1 引言
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設計 信號源 DDS FPGA 基于 FPGA，DDS，Verilog HDL
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控制系統 研究 軸承 磁浮 FPGA 基于 FPGA
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EPCS FPGA 編程 可重構
供應商、企業以及服務提供商認為100G系統最終會在市場上得到真正實施。推動其實施的主要力量是用戶持續不斷的寬帶需求。各種標準組織正在制定傳送網和以太網以及光接口100G標準。對于希望在標準發布之前，先期設計
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引言在全球競爭和經濟因素環境下，當今高技術產品利潤和銷售在不斷下滑，工程設計團隊在向市場推出低成本產品方面承受了很大的壓力。新產品研發面臨兩種不同的系統挑戰：利用最新的技術和功能開發全新的產品，或者采
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FPGA 功耗 系統
最近出現的 FPGA設計工具和 IP有效減少了計算占用的資源，大大簡化了浮點數據通路的實現。而且，與數字信號處理器不同， FPGA能夠支持浮點和定點混合工作的 DSP數據通路，實現的性能超過了 100 GFLOPS。在所有信
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FPGA 浮點 IP內核
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