基于EDA的數(shù)據(jù)傳輸系統(tǒng)的HDB3編碼器
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在此，以四連“0”的可能性通過如表1所列的多“0”消息代碼進行分析，并利用EDA工具對VHDL源程序進行編譯、適配、優(yōu)化、邏輯綜合與仿真。仿真結果顯示其完全可以達到編碼要求。其仿真圖如圖6所示。而將HDB3編碼硬件描述下載到CPLD或FPGA目標芯片中，然后連接好CC4052進行實際應用測試(用示波器測得)的編碼波形如圖7所示。
4 結束語
將基于VHDL的HDB3編碼用在光纖通信系統(tǒng)中作為誤碼儀測試誤碼的HDB3轉換器，能滿足實際測試的需要。且運用基于VHDL的可編程芯片開發(fā)技術將相關的信號處理電路進行硬件描述，并用CPLD/FPGA技術實現(xiàn)數(shù)字通信系統(tǒng)，不僅可以實現(xiàn)多種數(shù)字邏輯功能，而且可大大提高工作效率，減少電路設計的時間和可能發(fā)生的錯誤，同時也可降低開發(fā)成本。
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