參考時鐘對SERDES性能的影響-我們知道，SERDES對參考時鐘有嚴格的相位噪聲性能要求。通常，SERDES供應商會根據其SERDES采用的PLL以及CDR架構特點，以及性能數據，提出對參考時鐘的相位噪聲的具體要求。
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SERDES 參考時鐘 XILINX
詳細解讀Zynq的三種啟動方式(JTAG,SD,QSPI)-本文介紹zynq上三種方式啟動文件的生成和注意事項，包括只用片上RAM（OCM）和使用DDR3兩種情況。 JTAG方式 JTAG方式是調試中最常用的方式，在SDK中 在“Project Explorer”窗口工程上右鍵->Debug As->Debug Configurations可以看到以下窗口 首次打開左邊窗口中Xilinx C/C++ application(GDB)下沒有子項，這時雙擊Xilinx C/C++ application(GD
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Xilinx RAM
FPGA的過去，現在和未來-自Xilinx在1984年創造出FPGA以來，這種可編程邏輯器件憑借性能、上市時間、成本、穩定性和長期維護方面的優勢，在通信、醫療、工控和安防等領域占有一席之地，在過去幾年也有極高的增長率。而進入了最近兩年，由于云計算、高性能計算和人工智能的繁榮，擁有先天優勢的FPGA的關注度更是到達了前所未有的高度。本文從基礎出發談及FPGA的過去、現在與未來。
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fpga xilinx 英特爾
面向Zynq IIoT應用電源解決方案參考設計-Xilinx Zynq-7000全可編程SoC器件自從面向市場以來受到了很大歡迎，被應用到很多系統設計當中，是針對各類系統設計問題的最智能化解決方案，無與倫比的集成、高性能和低功耗等優勢。
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Zynq IIoT 電源
System generator如何與MATLAB進行匹配？-system generator是xilinx公司的系統級建模工具，它是擴展mathworks公司的MATLAB下面的simulink平臺，添加了XILINX FPGA專用的一些模塊。加速簡化了FPGA的DSP系統級硬件設計。
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xilinx 賽靈思 MATLAB
ZYNQ器件的啟動配置方法-無任是用CPU作為系統的主要器件，還是用FPGA作為系統的主要器件，系統設計中首先要考慮到的問題就是處理器的啟動加載問題。
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FPGA XILINX 賽靈思
Board從入門到精通（五）：軟硬件協同設計-Zynq最大的優勢在于，同時具備軟件、硬件、IO可編程，即All Programmable。在設計Zynq過程中，同樣要建立一種意識，就是從原來單純的軟件思維（或單純的硬件思維）中解脫，轉向軟硬件協同設計的開發方法。
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Board Zynq FPGA
關于高阻態和OOC（out of context）綜合方式-Xilinx Vivado工具支持僅將系統設計的一部分進行綜合，即OOC（out of context）綜合方式。OOC綜合方式的流程就是將設計的某個模塊單獨完成綜合操作，這會帶來如下可能性
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高阻態 OOC Xilinx
RFSoC正式發貨 2017年10月9日，All Programmable技術和器件的全球領先企業賽靈思公司(Xilinx)宣布其 Zynq UltraScale+ RFSoC 系列開始發貨，該系列通過一個突破性的架構將 RF 信號鏈集成在一個單芯片SoC 中，從而為 5G 無線、有線 Remote-PHY 及其它應用的加速實現提供了可能。 實際上，今年2月Xilinx已經預發布
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Xilinx RFSoC
All Programmable技術和器件的全球領先企業賽靈思公司(Xilinx, Inc.，(NASDAQ:XLNX))今天宣布其Zynq UltraScale+ RFSoC系列開始發貨，該系列是通過一個突破性的架構將RF信號鏈集成在一個單芯片SoC中，致力于加速5G無線、有線Remote-PHY及其它應用的實現。基于16nm UltraScale+ MPSoC架構的All Programmable RFSoC在單芯片上
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Xilinx 5G
賽靈思、Arm、Cadence和臺積公司今日宣布一項合作，將共同構建首款基于臺積7納米FinFET工藝的支持芯片間緩存一致性(CCIX)的加速器測試芯片，并計劃在2018年交付。這一測試芯片旨在從硅芯片層面證明CCIX能夠支持多核高性能Arm CPU和FPGA加速器實現一致性互聯。 關于CCIX 出于功耗及空間方面的考慮，在數據中心內對應用進行加速的需求日益增長，諸如大數據分析、搜索、機器學習、4G/5G無線、內存內數據處理、視頻分析及網絡處理等應用，都已受益于可在多個系統部件中無縫移動
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Xilinx Arm
賽靈思、Arm、Cadence和臺積公司今日宣布一項合作，將共同構建首款基于臺積7納米FinFET工藝的支持芯片間緩存一致性(CCIX)的加速器測試芯片，并計劃在2018年交付。這一測試芯片旨在從硅芯片層面證明CCIX能夠支持多核高性能Arm CPU和FPGA加速器實現一致性互聯。
出于功耗及空間方面的考慮，在數據中心內對應用進行加速的需求日益增長，諸如大數據分析、搜索、機器學習、4G/5G無線、內存內數據處理、視頻分析及網絡處理等應用，都已受益于可在多個系統部件中無縫移動數據的加速器引擎。CC
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Xilinx 臺積電
近日，由教育部高等學校電子信息類專業教學指導委員會和中國電子學會聯合主辦，arm、Xilinx、ST、ADI、Google等公司協辦的 2017年第二屆“全國大學生智能互聯創新大賽”在重慶郵電大學舉行了全國總決賽，最終在四個組別的激烈角逐中十六支隊伍獲得了一等獎，三支隊伍贏得了企業特別獎。第二屆全國大學生智能互聯創新大賽從2017年1月份啟動，歷時8個月，共吸引了560余支隊伍參賽。從參數的隊伍數量和學生人數上均比去年有顯著提升。本次大賽在吸收前一屆比賽的經驗基礎上，分成了智能交通、智能醫療、智能家居、智
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arm Xilinx ST ADI
All Programmable技術和器件的全球領先企業賽靈思公司(Xilinx, Inc.)今天在2017年度OpenHW 設計大賽和學術峰會上宣布，此次大會將著重展示賽靈思 All Programmable 技術面向新加坡智慧城市和智慧校園計劃的優勢。這個由賽靈思大學計劃(XUP)所發起的競賽和大會系與新加坡科技設計大學(SUTD)聯合主辦，并得到新加坡經濟發展局(EDB)的支持，致力于通過產學研結合，共同推動基于賽靈思開放式All&nb
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Xilinx OpenHW
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