利用四進程和結構化設計兩種不同的VHDL程序設計方法，對HDB3編碼器進行了設計、實現和功能分析。設計的兩種編碼器在Quartus Ⅱ7．2中進行了功能分析，并且下載到EP2C5T144C6中實現了HDB3編碼轉換功能。分析與實驗結果表明，所設計的兩種HDB3編碼器，具有好的編碼功能。其中，結構化設計的HDB3編碼器對FPGA邏輯單元、寄存器的占用分別減少了18．5％和14．8％，具有較好的資源利用特性。
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VHDL HDB3編碼器 結構化設計
介紹了SDRAM的存儲體結構、主要控制時序和基本操作命令，并且結合實際系統，給出了一種用FPGA實現的通用SDRAM控制器的方案。
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VHDL 狀態機 SDRAM
本文介紹了數字下變頻的組成結構，并通過一個具體的實例，給出了FPGA實現的具體過程。
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數字變頻 VHDL FPGA
SPI 接口應用十分廣泛，在很多情況下，人們會用軟件模擬的方法來產生SPI 時序或是采用帶SPI 功能模塊的MCU。但隨著可編程邏輯技術的發展，人們往往需要自己設計簡單的SPI 發送模塊。本文介紹一種基于FPGA 的將并行數據以SPI 串行方式自動發送出去的方法。
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SPI VHDL FPGA
在EAST分布式中央定時同步系統中，時鐘分頻和觸發延遲電路是分布式節點的核心。為了完成對基準時鐘信號進行多路任意整數倍的等占空比的分頻，并對輸入的觸發脈沖進行多路任意時間的延遲輸出，本設計中采用VHDL語言進行編程，實現了多路時鐘分頻信號的輸出和多路延遲輸出，特別是提高了奇數分頻和觸發延遲的時間精度，最后在QuartusⅡ9．0軟件上時設計的波形進行分析，驗證了該設計的可行性。
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觸發延遲 中央定時同步系統 VHDL
要實現不同的編碼方式關鍵是要找到合適的算法，并且要求算法必須簡潔亦兼容。筆者在這里主要采用了對比、聯合和模塊化的設計方法，使每一種編碼成為一個獨立模塊，但又共用同一個或多個時鐘。由此，大大節約了程序的存儲空間，減少了程序的調試時間。
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仿真波形 編碼 VHDL
Verilog HDL是硬件描述語言的一種，用于數字電子系統設計。它允許設計者用它來進行各種級別的邏輯設計，可以用它進行數字邏輯系統的仿真驗證、時序分析、邏輯綜合。它是目前應用最廣泛的一種硬件描述語言之一。Verilog HDL是在1983年由GDA公司的Phil Moorby首創的。
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VerilogHDL VHDL Verilog-XL 華清遠見
AVS 視頻標準中，自適應環路器在實現時存在許多條件運算（如濾波強度的計算、邊界閾值和跳轉等的計算）及其對于數據的訪問比較繁瑣，使得濾波器的算法復雜度很高。并且塊效應可能會出現在每個8x8 塊的邊界上。而該濾波器以8x8 塊為單位進行濾波，減少對存儲器的訪問，加快了處理速度，大大節省了算法的硬件實現面積。并且適當增加片上存儲空間來緩解外存的壓力來提高濾波模塊的效率，采用VHDL 語言進行設計、仿真，通過FPGA驗證。綜合仿真結果表明，該設計占用資源較少。
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AVS 環路濾波 VHDL
智能溫室是近年逐步發展起來的一種資源節約型高效農業發展技術,目前國內大多以單片機、通用計算機作為溫室系統處理器,由于基于單因子和成本問題,其智能化和效率有待提高。在此通過對目前智能溫室控制器的分析研究,提出并設計了一款16位的的單總線專用CPU,且專門針對于智能溫室測控系統設計了一個浮點運算器和n個Comparray比較器,并使用VHDL
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VHDL 溫室控制系統 浮點運算器 Comparray比較器
分析了I2C串行總線的數據傳輸機制，用VHDL設計了串行總線控制電路，其中包括微處理器接口電路和I2C總線接口電路。采用ModelSim Plus 6.0 SE軟件進行了前仿真和調試,并在Xilinx ISE 7.1i開發環境下進行了綜合、后仿真和CPLD器件下載測試。 結果表明實現了I2C串行總線協議的要求。
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I2C總線控制 VHDL 仲裁
介紹了采用一種自主研發多功能IP核實現總線全地址響應的設計方案,其可在FPGA中靈活配置,配備外圍電路后可以方便實現各種功能.設計采用VHDL硬件描述語言進行編程,采用綜合工具ISE Foundation對設計進行綜合、優化,在ModelSim - SE 6.1g中進行時序仿真,并且最后在FPGA上實現.
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多功能IP核 VHDL ModelSim
基于FPGA設計了一款通用鍵盤IP核,該核主要實現對鍵盤輸入信號的計算與存儲功能,并在quartusⅡ環境下使用VHDL語言,采用自頂向下設計方式,編輯生成RTL原理圖,并做了相關的時序仿真驗證。經驗證此IP核具有較強的魯棒性和較高的反應速度,可作為基礎輸入模塊,為其他模塊提供有力控制輸入與數據支持。
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鍵盤IP核 VHDL FPGA
本文針對傳統的四相移鍵控(QPSK)的調制解調方式提出一種基于高速硬件描述語言(VHDL)的數字式QPSK調制解調模型。這種新模型便于在目標芯片FPGA/CPLD上實現QPSK調制解調功能。文中介紹了QPSK調制解調的原理,并基于FPGA實現了QPSK調制解調電路。并給出了可編程邏輯器件FPGA的最新一代集成設計環境QuartusⅡ進行系統仿真的仿真結果。
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四相移鍵控 VHDL 調制解調模型
溫度測量儀是一種常用的檢測儀器，文章中利用FPGA器件和DS18B20傳感器設計實現了一種數字溫度測量儀，用于室溫的檢測。該測量儀具有結構簡單、抗干擾能力強、精確性高、轉換速度快、擴展性好等優點。
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溫度傳感器 VHDL FPGA
近年來，隨著集成電路技術和EDA技術的不斷發展，集設計、模擬、綜合和測試功能為一體的VHDL語言，已作為IEEE標準化的硬件描述語言。因此，對VHDL設計中簡化電路結構，優化電路設計的問題進行深入探討，很有必要。
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電路優化 VHDL 硬件描述
vhdl-ams介紹
即IEEE 1076.1標準。
VHDL-AMS是VHDL的一個分支，它支持模擬、數字、數模混合電路系統的建模與仿真。
http://www.eda.org/vhdl-ams/
Verilog-AMS與之類似。支持模擬、數字、數模混合電路系統的建模與仿真。
http://www.eda.org/verilog-ams/
The VHDL-AMS language [
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