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        用于以太網物理層時鐘同步PLL的VCO設計

        • 摘要:研究了一種基于以太網物理層時鐘同步的高帶寬低噪聲壓控振蕩器(VCO),該VCO采用交叉耦合的電流饑餓型環形振蕩器,通過級聯11級環路電路和改善其控制電壓變換電路,優化了VCO的輸出頻率范圍以及降低了輸出時鐘的
        • 關鍵字: PLL  VCO  設計  同步  時鐘  以太網  物理  用于  

        PLL陷波濾波器用于阻攔不需要的頻率

        • 經常有要阻擋某些頻率信號的情況,其中最常見的是50Hz或60Hz的電力線工頻。圖1中的PLL陷波濾波器可以用于阻攔不需要的頻率。IC1 LM567C是一只音調解碼器。C1、R1A和R1B等元件決定了IC1探測的頻率F:F=1/[C1(R1A
        • 關鍵字: 需要  頻率  阻攔  用于  濾波器  PLL  

        AD9779A的寄存器配置及PLL頻帶優化

        • 隨著科學技術的發展,通信、測量等各個領域對信號源的要求越來越高,高速任意波形發生器成為市場的熱點。高速DAC作為任意波形發生器的關鍵部分,其性能對高速信號有著極大的影響。AD9779A是目前國內能買到的性能較
        • 關鍵字: 頻帶  優化  PLL  配置  寄存器  AD9779A  

        一種基于PLL的測試測量時鐘恢復方案

        • 不管是放到測試設置中,還是作為被測設備的一部分,時鐘恢復都在進行準確的測試測量時發揮著重要作用。由于...
        • 關鍵字: PLL  時鐘恢復  測試測量  

        基于PLL技術的合成頻率源設計

        • 1 引言  頻率源是現代射頻和微波電子系統的心臟,其性能直接影響整個電子系統的功能,成為非常重要的部件。  頻率源分為二大類:自激振蕩源和合成頻率源。常見的自激振蕩源有晶體振蕩器、腔體振蕩器、介質振蕩器、
        • 關鍵字: PLL  合成  頻率源    

        PLL-VCO設計及制作第二部分

        • VCO電路的設計VCO電路為使用上章的備注欄所介紹的庫拉普振蕩電路。將線圈與電容組合,使達到設計規格的40M~60 ...
        • 關鍵字: PLL-VCO  

        PLL-VCO設計及制作第一部分

        • 在此說明以晶體振蕩器做為基準振蕩器,將其與VCO以及PLL電路組合成為信號產生器的情形也被稱為頻率合成器。此 ...
        • 關鍵字: PLL-VCO  

        基于PLL的測試測量時鐘恢復方案

        •  不管是放到測試設置中,還是作為被測設備的一部分,時鐘恢復都在進行準確的測試測量時發揮著重要作用。由于大多數千兆位通信系統都是同步系統,因此系統內部的數據都使用公共時鐘定時。不管是沿著幾英寸的電路板傳
        • 關鍵字: PLL  測試測量  時鐘恢復  方案    

        基于壓控振蕩器(VCO)的高性能鎖相環(PLL)設計

        • 簡介
          “鎖相環”(PLL)是現代通信系統的基本構建模塊。PLL通常用在無線電接收機或發射機中,主要提供“本振”(LO)功能;也可用于時鐘信號分配和降噪,而且越來越多地用作高采樣速率模數(A/D)轉換
        • 關鍵字: VCO  PLL  壓控振蕩器  性能    

        基于異步FIFO和PLL的雷達數據采集系統

        • 1引言隨著雷達系統中數字處理技術的飛速發展,需要對雷達回波信號進行高速數據采集。在嵌入式條件...
        • 關鍵字: 異步FIFO  PLL  雷達數據采集  

        基于DDS+PLL實現跳頻信號源的設計方法

        •   航空通信設備包括短波通信、超短波通信設備,短波、超短波通信設備又分為常規通信方式和跳頻通信方式,跳頻通信因具有抗干擾性強、抗偵測能力好、頻譜利用率高和易于實現碼分多址等優點被稱為無線電通信的ldquo
        • 關鍵字: 設計  方法  信號源  實現  DDS  PLL  基于  

        航空系統跳頻信號源的方案

        • 電子產品世界,為電子工程師提供全面的電子產品信息和行業解決方案,是電子工程師的技術中心和交流中心,是電子產品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網絡家園
        • 關鍵字: 跳頻通信  信號源  DDS+PLL  鎖相環  

        基于CSMC工藝的零延時緩沖器的PLL設計

        •  1 引言  本文在傳統鎖相環結構的基礎上進行改進,設計了一款用于多路輸出時鐘緩沖器中的鎖相環,其主 要結構包括分頻器、鑒頻鑒相器(PFD)、電荷泵、環路濾波器和壓控振蕩器(VCO)。在鑒相器前采用預 分頻結構減小
        • 關鍵字: CSMC  PLL  工藝  零延時    

        PLL-VCO設計及制作

        • 在此說明以晶體振蕩器做為基準振蕩器,將其與VCO以及PLL電路組合成為信號產生器的情形也被稱為頻率合成器。
          此一PLL-VCO電路的設計規格如表l所示。振蕩頻率范圍為40M~60MHz內的10MHz寬。每一頻率階段(step)寬幅為10
        • 關鍵字: PLL-VCO    
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