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如何滿足復(fù)雜系統(tǒng)的高性能時(shí)序需求
- 時(shí)鐘設(shè)備設(shè)計(jì)使用 I2C 可編程小數(shù)鎖相環(huán) (PLL)，可滿足高性能時(shí)序需求，這樣可以產(chǎn)生零 PPM(百萬分之一)合成誤差的頻率。高性能時(shí)鐘 IC 具有多個(gè)時(shí)鐘輸出，用于驅(qū)動(dòng)打印機(jī)、掃描儀和路由器等應(yīng)用系統(tǒng)的子系統(tǒng)，例如處理器、FPGA、數(shù)據(jù)轉(zhuǎn)換器等。此類復(fù)雜系統(tǒng)需要?jiǎng)討B(tài)更新參考時(shí)鐘的頻率，以實(shí)現(xiàn) PCIe 和以太網(wǎng)等其它諸多協(xié)議。 時(shí)鐘 IC 屬于 I2C 從器件，需要主控制器來
- 關(guān)鍵字： I2C PLL
如何根據(jù)數(shù)據(jù)表規(guī)格算出鎖相環(huán)（PLL）中的相位噪聲
- 也許你也會(huì)跟我一樣認(rèn)為典型數(shù)據(jù)表中的某些規(guī)格難以理解，這是因?yàn)槠渲泻w了一些你不太熟悉的隱含慣例。對(duì)許多RF系統(tǒng)工程師而言，其中一種規(guī)格便是鎖相環(huán)(PLL)中的相位噪聲。當(dāng)信號(hào)源被用作本機(jī)振蕩器(LO)或高速時(shí)鐘時(shí)，相位噪聲性能對(duì)滿足系統(tǒng)要求起到了重要作用。最初從數(shù)據(jù)表中推斷出該規(guī)格時(shí)似乎就像一個(gè)獨(dú)立的項(xiàng)目。下面我來講解一下如何通過讀取PLL的相位噪聲規(guī)格來對(duì)您的無線電或高速應(yīng)用可達(dá)到的性能進(jìn)行初步評(píng)估。 注意，PLL是一種控制回路，這種系統(tǒng)具備頻率響應(yīng)功能。參考路徑中生成的噪聲受控于回路中對(duì)系統(tǒng)輸
- 關(guān)鍵字： PLL VCO
PLL回路濾波器設(shè)計(jì)的調(diào)整指南
- 假設(shè)您已經(jīng)通過迭代信息傳遞相位邊限和回路帶寬在鎖相環(huán)(PLL)上花費(fèi)了一些時(shí)間。但遺憾地是，還是無法在相位噪聲、雜散和鎖定時(shí)間之間達(dá)成良好的平衡。感到泄氣?想要放棄?等一下!你是否試過伽馬優(yōu)化參數(shù)? 伽馬優(yōu)化參數(shù) 伽馬是一個(gè)數(shù)值大于零的變量。當(dāng)伽馬等于1時(shí)，相位邊限在回路頻處會(huì)達(dá)到最大值(圖1)。很多回路濾波器設(shè)計(jì)方法把伽馬值設(shè)為1，這是個(gè)很好的起點(diǎn)，但還有進(jìn)一步優(yōu)化的空間。 圖1：伽馬等于1時(shí)的波德圖 伽馬能夠有效用于優(yōu)化帶內(nèi)相位噪聲，尤其是因壓控振蕩器 (VCO) 帶來
- 關(guān)鍵字： PLL 回路濾波器
PLL回路濾波器設(shè)計(jì)的調(diào)整指南
- 假設(shè)您已經(jīng)通過迭代信息傳遞相位邊限和回路帶寬在鎖相環(huán)(PLL)上花費(fèi)了一些時(shí)間。但遺憾地是，還是無法在相位噪聲、雜散和鎖定時(shí)間之間達(dá)成良好的平衡。感到泄氣?想要放棄?等一下!你是否試過伽馬優(yōu)化參數(shù)? 伽馬優(yōu)化參數(shù) 伽馬是一個(gè)數(shù)值大于零的變量。當(dāng)伽馬等于1時(shí)，相位邊限在回路頻處會(huì)達(dá)到最大值(圖1)。很多回路濾波器設(shè)計(jì)方法把伽馬值設(shè)為1，這是個(gè)很好的起點(diǎn)，但還有進(jìn)一步優(yōu)化的空間。 圖1：伽馬等于1時(shí)的波德圖 伽馬能夠有效用于優(yōu)化帶內(nèi)相位噪聲，尤其是因壓控振蕩器 (VCO) 帶來
- 關(guān)鍵字： PLL 濾波器
【E問E答】模擬鎖相環(huán)電路鎖定檢測問題解答
- 模擬鎖相環(huán)電路鎖定檢測問題解答 1.PLL鎖定有那些檢測方法，它們特點(diǎn)是什么? 一種是最為簡單的數(shù)字檢測，它利用輸入?yún)⒖嫉姆诸l信號(hào)與VCO反饋的分頻信號(hào)，在PFD里鑒相的結(jié)果，通過連續(xù)結(jié)果時(shí)鐘周期檢測到鑒相的脈寬小于某值，作為鎖定的有效判決規(guī)則。這種檢測方式，判決方式簡單，判斷的結(jié)果只有鎖定和非鎖定兩種情況。 另一種方式是模擬鎖定檢測，也稱為N溝道漏級(jí)開路檢測，它的實(shí)現(xiàn)原則是通過對(duì)于PFD輸出的超前和滯后脈沖做XOR操作，直接將得出的結(jié)果輸出。由于XOR的結(jié)果有是一串高低的脈沖，所以需要外部電路
- 關(guān)鍵字： 鎖相環(huán) PLL
定時(shí)決定一切：如何使用部分 PLL 創(chuàng)建調(diào)制波形
- 我們可能都見到過需要隨時(shí)間變化掃描頻率的情況。如果您遇到這樣的問題，可以考慮雷達(dá)等應(yīng)用，在這類應(yīng)用中發(fā)送的信號(hào)不僅可由目標(biāo)反射回來，而且還能夠與接收到的信號(hào)進(jìn)行比較，如下圖 1 所示。觀察頻率 (Df) 差異
- 關(guān)鍵字： PLL 調(diào)制波形 波形調(diào)制
用于PLL/VCO和時(shí)鐘IC供電的超低噪聲線性調(diào)節(jié)器
- 寬帶通信系統(tǒng)通常需要超低噪聲調(diào)節(jié)器來為VCO和PLL供電。調(diào)節(jié)器還必須能夠抑制其輸入端出現(xiàn)的任何紋波。在一般系統(tǒng)中，交流輸入轉(zhuǎn)換為隔離式直流供電軌，例如-48 V直流。該供電軌繼而轉(zhuǎn)換為隔離式12 V系統(tǒng)軌，為通信
- 關(guān)鍵字： 超低噪聲調(diào)節(jié)器 PLL VCO 時(shí)鐘IC 供電軌
基于ADIsimPLL 3．1的鎖相環(huán)環(huán)路濾波器設(shè)計(jì)
- 對(duì)鎖相環(huán)環(huán)路濾波器進(jìn)行簡單分析，對(duì)ADIsimPLL 3．1模擬軟件的功能特點(diǎn)做了簡要介紹，并利用仿真軟件對(duì)一款頻率合成器的環(huán)路濾波器進(jìn)行仿真設(shè)計(jì)，結(jié)果表明該軟件在設(shè)計(jì)應(yīng)用中方便快捷，能夠幫助設(shè)計(jì)出滿足指標(biāo)要求且性能穩(wěn)定的環(huán)路濾波器。
- 關(guān)鍵字： 環(huán)路帶寬 PLL 環(huán)路濾波器 壓控靈敏度
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