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Crydom PCB固態(tài)繼電器可減少控制柜空間
- CustomSensors&Technologies(CST)下屬公司、北美地區(qū)固態(tài)繼電器廠商Crydom宣布：品種最為齊全的標(biāo)準(zhǔn)及定制PCB電源固態(tài)繼電器已投放歐洲及亞洲市場。這些繼電器可提供從1安培到25安培(強制通風(fēng))的額定電流，其線電壓可高達660伏(交流)，這些繼電器設(shè)計緊湊小巧，適用于高密度PCB應(yīng)用產(chǎn)品。另外，這些繼電器不含活動部件，因此，運行時不會發(fā)出噪音。與大多數(shù)機電繼電器相比，這些繼電器在滿負荷電流條件下的預(yù)期使用壽命要高50多倍。 &
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基于FPGA的UARTl6550的設(shè)計
- 1 引 言 UART(Universal Asynchronous Receiver/Transmitter，通用異步收發(fā)器)是用于控制CPU與串行設(shè)備通信的芯片，將由CPU傳送過來的并行數(shù)據(jù)轉(zhuǎn)換為輸出的串行數(shù)據(jù)流。將系統(tǒng)外部來的串行數(shù)據(jù)轉(zhuǎn)換為字節(jié)，供系統(tǒng)內(nèi)部使用并行數(shù)據(jù)的器件使用。他可以在輸出的串行數(shù)據(jù)流中加人奇偶校驗位和啟停標(biāo)記，并對從外部接收的數(shù)據(jù)流進行奇偶校驗以及刪除啟停標(biāo)記。常見UART主要有INS8250，PC16450和PCI6550，其中16550發(fā)送和接收都帶有16 B的FIFO
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FPGA的DSP性能揭秘
- “今天，F(xiàn)PGA越來越多地應(yīng)用在多種DSP中。我們預(yù)計這一趨勢在未來幾年會更加明顯。”美國調(diào)查機構(gòu)Berkeley設(shè)計技術(shù)公司做了上述預(yù)測。以Xilinx和Altera為主的兩大FPGA廠商多年前就涉足了DSP應(yīng)用領(lǐng)域，近一、兩年，隨著3G通信、視頻成像等領(lǐng)域的發(fā)展，F(xiàn)PGA for DSP(FPGA的DSP)再次成為了熱點。為什么會用FPGA做DSP？Xilinx中國區(qū)運營總經(jīng)理吳曉東從DSP的概念上進行了分析：DSP表示數(shù)字信號處理器，也可以表示為數(shù)字信號處理—并不代表某一種芯片。實際上，數(shù)字信號處理
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FPGA for DSP的精彩問答
- 問：現(xiàn)在DSP跟微處理器結(jié)合的情況比較多，實現(xiàn)DSP功能的FPGA是否也要和微處理器合作？答：現(xiàn)在90%以上的FPGA都運用在處理器上，這也正是FPGA這方面的優(yōu)勢。你可以用FPGA的邏輯搭建一個軟處理器，也可以選用具有內(nèi)嵌硬處理器的產(chǎn)品。因此，可以很容易在FPGA上實現(xiàn)微處理器的性能。 問：FPGA已經(jīng)能夠?qū)崿F(xiàn)DSP，為何還要專門開發(fā)為DSP應(yīng)用的FGPA？答：首先，所有的FPGA都有乘法器，如果你可以拿這些乘法器做數(shù)字信號處理，但是不是最優(yōu)化的。例如，如果你選擇Xilinx Spartan的產(chǎn)品，你
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基于FPGA的二值圖像連通域標(biāo)記快速算法實現(xiàn)
- 摘 要：針對高速圖像目標(biāo)實時識別和跟蹤任務(wù)，需要利用系統(tǒng)中有限的硬件資源實現(xiàn)高速、準(zhǔn)確的二值圖像連通域標(biāo)記，提出了一種適合FPGA實現(xiàn)的二值圖像連通域標(biāo)記快速算法。算法以快捷、有效的方式識別、并記錄區(qū)域間復(fù)雜的連通關(guān)系。與傳統(tǒng)的二值圖像標(biāo)記算法相比，該算法具有運算簡單性、規(guī)則性和可擴展性的特點。利用FPGA實現(xiàn)該算法時，能夠準(zhǔn)確有效的識別出圖像中復(fù)雜的連通關(guān)系，產(chǎn)生正確的標(biāo)記結(jié)果。在100MHz工作時鐘下，處理384
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基于FPGA的高速可變周期脈沖發(fā)生器的設(shè)計
- 1 引 言 要求改變脈沖周期和輸出脈沖個數(shù)的脈沖輸出電路模塊在許多工業(yè)領(lǐng)域都有運用。采用數(shù)字器件設(shè)計周期和輸出個數(shù)可調(diào)節(jié)的脈沖發(fā)生模塊是方便可行的。為了使之具有高速、靈活的優(yōu)點，本文采用Atelra公司的可編程芯片F(xiàn)PGA設(shè)計了一款周期和輸出個數(shù)可變的脈沖發(fā)生器。經(jīng)過板級調(diào)試獲得良好的運行效果。 2 總體設(shè)計思路 脈沖的周期由高電平持續(xù)時間與低電平持續(xù)時間共同構(gòu)成，為了改變周期，采用兩個計數(shù)器來分別控制高電平持續(xù)時間和低電平持續(xù)時間。計數(shù)器采用可并行加載初始值的N位減法計數(shù)器。設(shè)定：當(dāng)要求的高電平
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FPGA所需的電源供應(yīng)：深入分析
- 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
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EMI/EMC設(shè)計講座(四)印刷電路板的映像平面
- 一個映像平面（image plane）是一層銅質(zhì)導(dǎo)體（或其它導(dǎo)體），它位于一個印刷電路板（PCB）里面。它可能是一個電壓平面，或鄰近一個電路或訊號路由層（signal routing layer）的0V參考平面。1990年代，映像平面的觀念被普遍使用，現(xiàn)在它是工業(yè)標(biāo)準(zhǔn)的專有名詞。本文將說明映像平面的定義、原理和設(shè)計。 映像平面的定義 射頻電流必須經(jīng)由一個先前定義好的路徑或其它路徑，回到電流源；簡言之，這個回傳路徑（return path）就是一種映像平面。映像平面可能是原先的走線的鏡像（mi
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基于FPGA的IDE硬盤接口卡的實現(xiàn)
- 引言 本文采用FPGA實現(xiàn)了IDE硬盤接口協(xié)議。系統(tǒng)提供兩套符合ATA-6規(guī)范的IDE接口，一個與普通IDE硬盤連接，另一個與計算機主板上的IDE接口相連。系統(tǒng)采用FPGA實現(xiàn)接口協(xié)議，完成接口數(shù)據(jù)的截獲、處理（在本文中主要是數(shù)據(jù)加密）和轉(zhuǎn)發(fā)，支持PIO和Ultra DMA兩種數(shù)據(jù)傳輸模式。下面重點介紹用FPGA實現(xiàn)接口協(xié)議的方法。 1 IDE接口協(xié)議簡介 1.1 IDE接口引腳定義 IDE（Integrated Drive Electronics）即“電子集成驅(qū)動器”，又稱為ATA接口。表1列
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