- PLD/FPGA硬件語言設計verilog HDL,HDL概述 隨著EDA技術的發展，使用硬件語言設計PLD/FPGA成為一種趨勢。目前最主要的硬件描述語言是VHDL和verilog HDL及System Verilog。 VHDL發展的較早，語法嚴格;而Verilog HDL是在C語言的基礎上發展起來的一種硬
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verilog HDL 設計 語言 硬件 PLD/FPGA
- 基于DSP+FPGA的紅外圖像小目標檢測系統設計,研究單幀紅外圖像小目標的檢測問題。對傳統基于數學形態學的Top-hat算子進行分析和實驗，并利用一種最大類間方差方法確定分割閾值，進行圖像分割和目標檢測。在Matlab仿真中發現，這種方法能夠在一定程度上提高單幀圖像目標檢測的成功率，并且在一定程度上能夠適應不同環境的需要，在實際應用中具有一定的魯棒性。同時描述一種基于DSP+FPGA的紅外圖像處理系統，該結構在一定程度上可滿足實時性和靈活性的要求，具有很強的通用性和可擴展性。介紹了該系統的總體結構，并且給
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目標 檢測系統 設計 圖像 紅外 DSP FPGA 基于
- 實際上，推動某項或幾項技術發展方向的真正動力是市場與技術的綜合因素，技術本身或內在的發展慣性并不是最重要的，或者說并非唯一決定性因素。
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FPGA DSP
- Altera公司日前宣布，開始提供業界第一款集成增強前向糾錯(EFEC) IP內核，該內核針對高性能Stratix IV和Stratix V系列FPGA進行了優化。EFEC7和EFEC20是Altera Newfoundland技術中心 (以前的Avalon Microelectronics) 開發的多維IP內核，專門面向城域和長距離光傳送網(OTN)等100G應用而設計?！?/li>
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Altera FPGA
- 隨著軟件無線電技術和FPGA、DSP、AD 等技術的高速發展，數字接收機的應用日益廣泛。為了擴大數字接收機的ADC 動態范圍，廣泛采用了自動增益控制(AGC) ，使接收機的增益隨著信號的強弱進行調整，其性能的好壞直接
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FPGA AGC 動態 數控
- 本文給出的視頻采集和顯示模塊在設計時，選取分辨率為768times;494像素的NTSC制式， 并選用輸出像素為640times;480的CCD攝像頭； FPGA選取Altera CyclONeⅡ系列Ep2c35F672c36 (內含35000個邏輯單元)； 主動串行配
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FPGA 視頻采集 顯示模塊
- 摘要：對傳統的數字化轉角測量方法進行了簡要介紹，提出了一種能夠提高測角分辨率的脈沖細分技術，并結合激光陀螺輸出信號對該方法進行了誤差分析。接著利用FPGA對此項技術進行了硬件實現，具體描述了電路各部分的工
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FPGA 脈沖 電路
- 摘要：根據現代電子系統對信號源的頻率穩定度、準確度及分辨率越來越高的要求，結合直接數字式頻率合成器(DDS)的優點，利用FPGA芯片的可編程性和實現方案易改動的特點，提出了一種基于FPGA和DDS技術的任意波形發生器
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FPGA DDS 任意波形發生器
- 摘要：為了取代傳統利用單片機驅動微型打印機，使用Altera公司的FPGA芯片EP3C225Q240C8N設計驅動打印機的硬件控制電路，并正確控制微型打印機的工作時序。軟件使用硬件描述語言VHDL實現對微型打印機的時序控制，并通
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FPGA VHDL 微型打印機 驅動設計
- 摘要：提出一種基于FPGA的簡易數字示波器設計方法，硬件上采用以Altera公司的EP2C8Q208CN現場可編程門陣列芯片作為核心器件，同時結合FPGA和NIOS軟核的優勢，設計高效的片上可編程系統(SoPC)對高速A／D所采集的數據進
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FPGA 數字示波器
- 設計了一種基于FPGA的1024點16位FFT算法，采用了基4蝶形算法和流水線處理方式，提高了系統的處理速度，改善了系統的性能。提出了先進行前一級4點蝶形運算，再進行本級與旋轉因子復乘運算的結構。合理地利用了硬件資源。對系統劃分的各個模塊使用Verilog HDL進行編碼設計。對整個系統整合后的代碼進行功能驗證之后，采用QuartusⅡ與Matlab進行聯合仿真，其結果是一致的。該系統既有DSP器件實現的靈活性又有專用FFT芯片實現的高速數據吞吐能力，在數字信號處理領域有廣泛應用。
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FPGA FFT 算法 硬件實現
- 摘要：介紹了一種基于ARM平臺、以太網和GPRS無線通信技術的智能家居遠程監控系統，給出了系統的組成及工作原理，著重闡述了系統主要硬件和軟件的設計。智能家居遠程監控系統的核心是嵌入式Web服務器。通過該嵌入式We
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FPGA 跳頻通信 頻率合成器
- 摘要：FPGA可以通過串行接口進行配置。本文對傳統的配置方法進行了研究，并從更新配置文件的方法入手，提出了利用處理機通過網絡更新的方法，給出了一個用CPLD和Flash對FPGA進行配置的應用實例。
關鍵詞：現場可編程
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Flash CPLD FPGA
- 分析了擴頻測距理論原理與優勢，給出了一種基于FPGA的快速擴頻測距模型。通過運用FFT IP Core計算收發序列間的互相關函數，可以實現快速捕獲。仿真結果表明，該方法具有速度快、誤差小、設計靈活、效率高的特點。
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FPGA 擴頻 快速捕獲 仿真研究
- 介紹了一種基于可編程邏輯器件FPGA和硬件描述語言VHDL的32位ALU的設計方法。該ALU采取層次化設計方法，由控制模塊、邏輯模塊、加減法模塊、乘法模塊和除法模塊組成，能實現32位有符號數和無符號數的加減乘除運算，另外還能實現9種邏輯運算、6種移位運算以及高低字節內容互換。該ALU在QuartuslI軟件環境下進行了功能仿真，通過驗證表明，所設計的ALU完全正確，可供直接調用。
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FPGA ALU 軟核
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