為了達到可靠的數據傳輸，借助存儲器來完成跨時鐘域通信也是很常用的手段。在早期的跨時鐘域設計中，在兩個處理器間添加一個雙口RAM或者FIFO來完成相互間的數據交換是很常見的做法。如今的FPGA大都集成了一些用戶可靈活配置的存儲塊，因此，使用開發商提供的免費IP核可以很方便的嵌入一些常用的存儲器來完成跨時鐘域數據傳輸的任務。使用內嵌存儲器和使用外部擴展存儲器的基本原理是一樣的，如圖1所示。
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圖1 借助存儲器的跨時鐘域傳輸
雙口RAM更適合于需要互通信的設計，只要雙方
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FPGA 存儲器
如果你是一名研究現場可編程門陣列(FPGA)的工程師，你就應該知道這些器件的高效運行需要優化的電源序列。使用離散組件來滿足這些特定的電源需求通常需要一個額外的離散排序器或微控制器。然而，對于小外形尺寸應用來說，找到合適的部件常常會增加成本、時間，甚至外形尺寸，而這樣就不能滿足客戶的技術規格了。
如果你不想這么麻煩，不妨考慮一下電源管理集成電路(PMIC)。它主要有三方面的優勢：
這是一款滿足你整個系統電源需要的單芯片解決方案。
他提供對所有電壓軌的電源監控，使你能夠確認電源軌在系統技
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PMIC FPGA
隨著光通信行業的大力發展，光纜大規模部署，光網絡如何全面地測試成了運營商面臨的主要問題。傳統的測試方式有兩種：光損測試和OTDR測試法。光損測試采用光源和光功率計相結合來測試光鏈路的損耗，其優點是設備價格低廉，使用簡單，但是需要兩名技術人員才能完成，并且無法準確定位光鏈路的故障點及其原因。OTDR測試可以測量光纖長度、傳輸衰減、接頭衰減和故障定位，具有測試時間短、速度快和精度高等優點，但是使用OTDR測試，測試人員對測試結果有不同的解讀，很大程度上取決于使用者的經驗和能力，只有專家級的測試人員才能準確
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OTDR FPGA
摘要：針對目前市場上越來越多針對SDI信號的應用需求，提出了多路SDI電信號單波長光纖傳輸的實現方案，就方案中出現的由于FIFO“寫滿”或“讀空”引起的SDI信號傳輸誤碼，提出了一種基于FPGA內部PLL的可控時鐘，利用該時鐘作為FIFO的讀時鐘，實現SDI信號無損傳輸。
引言
串行數字接口(Serial Digital Interface，簡寫為SDI)是針對演播室環境提出的用單根電纜來傳輸數字視音頻信號的方式。在SMTPE-259M標準中
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SDI FPGA 光纖 FIFO PLL 數據還原 201503
摘要：大約三分之一的嵌入式設計人員考慮在嵌入式應用中采用FPGA，他們認為在設計中使用FPGA過于昂貴。但是，從系統級了解總體擁有成本(TCO) (由產品生命周期中的開發、改進、替換和維護成本來衡量)，您會發現FPGA是分立微控制器(MCU)/數字信號處理器(DSP)/ASSP產品靈活的競爭方案。
引言
工業自動化和過程控制生產商一直面臨持續的全球競爭和經濟壓力，商業模式和利潤不斷受到威脅，不得不應對成本挑戰，包括：
● 利潤和研發投入;
● 產品及時面市壓力以適應經濟狀況的變
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嵌入式 FPGA 工業以太網 DSP TCO MCU 201503
摘要：當前全球制造業發展越來越呈現數字化、網絡化和智能化的新特征，美國提出“工業互聯網”戰略、德國提出“工業4.0”戰略，主要意圖就是搶占智能制造這一未來產業競爭制高點。工業4.0革命將建立一個高度靈活的數字化、個性化產品與服務的生產模式，并將重組產業鏈分工。
第四次工業革命是綠色工業革命，一系列生產函數發生從自然要素投入為特征，到以綠色要素投入為特征的躍遷，并普及至整個社會。其核心特征應該是高效節能，網絡化與模塊化。
工業4.0將會通過自動
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工業4.0 物聯網 FPGA 處理器 201503
在特權的上篇博文《基于FPGA的跨時鐘域信號處理——專用握手信號》中提出了使用專門的握手信號達到異步時鐘域數據的可靠傳輸。列舉了一個簡單的由請求信號req、數據信號data、應答信號ack組成的簡單握手機制。riple兄更是提出了req和ack這兩個直接的跨時鐘域信號在被另一個時鐘域的寄存器同步時的亞穩態問題。這個問題估計是整個異步通信中最值得探討和關注的。
很幸運，特權同學找到了很官方的說法——《Application Note42:Metast
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FPGA 亞穩態
一、為啥要說任意分頻
也許FPGA中的第一個實驗應該是分頻實驗，而不是流水燈，或者LCD1602的"Hello World"顯示，因為分頻的思想在FPGA中極為重要。當初安排流水燈，只是為了能讓大家看到效果，來激發您的興趣(MCU的學習也是如此)。
在大部分的教科書中，都會提到如何分頻，包括奇數分頻，偶數分頻，小數分頻等。有些教科書中也會講到任意分頻(半分頻，任意分數分頻)原理，用的是相位與的電路，并不能辦到50%的占空比，也不是很靈活。
但沒有一本教科書會講到精
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FPGA DDS
不得不說，SDRAM的設計是我接觸FPGA以來調試最困難的一次設計，早在一個多月以前，我就開始著手想做一個SDRAM方面的教程，受特權同學影響，開始學習《高手進階，終極內存技術指南》這篇論文，大家都知道這篇文章是學習內存入門的必讀文章，小墨同學花了一些時間在這上面，說實話看懂這篇文章是沒什么問題的，文件講的比較直白，通俗易懂，很容易入手。當了解了SDRAM工作方式之后，我便開始寫代碼，從特權同學的那篇經典教程里面，我認真研讀代碼的來龍去脈，終于搞懂了特權同學的設計思想，并花了一些時間將代碼自己敲一遍，
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FPGA RISC
致力于在電源、安全、可靠和性能方面提供差異化半導體技術方案的領先供應商美高森美公司(Microsemi Corporation)宣布為其旗艦SmartFusion®2 SoC FPGA和IGLOO®2 FPGA 器件的領先網絡安全功能組合加入Intrinsic-ID, B.V授權許可的物理不可克隆功能(Physically Unclonable Function, PUF) 。Intrinsic-ID是基于其專利硬件固有安全技術(Hardware Intrinsic Security
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美高森美 FPGA
OFDM(正交頻分復用)是一種高效的多載波調制技術，其最大的特點是傳輸速率高，具有很強的抗碼間干擾和信道選擇性衰落能力。OFDM最初用于高速MODEM、數字移動通信和無線調頻信道上的寬帶數據傳輸，隨著IEEE802.11a協議、BRAN(Broadband Radio Access Network)和多媒體的發展，數字音頻廣播(DAB)、地面數字視頻廣播((DVB-T)和高清晰度電視((HDTV)都應用了OFDM技術。
OFDM利用離散傅立葉反變換/離散傅立葉變換(IDFT/DFT)代替多載波調
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OFDM FPGA
O 引 言
隨著各種FFT算法的出現，DFT在現代信號處理中起著越來越重要的作用。在B3G和4G移動通信中所采用的0FDM技術，更是以IDFT/DFT來進行OFDM調制和解調制，IDFT/DFT的精度直接影響基帶解調的性能。
在硬件實現中，通常影響定點化FFT算法精度的有量化誤差、舍入誤差和溢出誤差。一旦決定了量化方式和數據位寬后，量化誤差和舍入誤差都是可估計的，而溢出誤差則隨著輸入信號功率的增大而急劇增加，造成SNR嚴重惡化。
中射頻接收時，通常使用AAGc和DAGC來改善ADC正
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OFDM FPGA
O 引言
正交頻分復用(OFDM)是一種正交多載波調制技術，它將寬帶頻率選擇性衰落信道轉換成一系列窄帶平坦衰落信道，在克服信道多徑衰落所引起的碼間干擾，實現高數據傳輸等方面具有獨特的優勢。但是由于OFDM信號頻譜重疊，對信道變化很敏感，在高速移動下，信道的時變特性更加明顯，此時OFDM系統載波間的正交性會遭到破壞，出現載波間干擾(ICI)，這會導致系統性能明顯降低。為了消除ICI，必須采用適當的均衡技術以補償ICI。國內外許多學者對這些問題進行了大量的研究，提出了各種不同的方法，得到了一些階段性
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OFDM FPGA
一、 引言
現代通信技術、微電子技術和計算機技術的飛速發展，促進了無線通信技術從數字化走向軟件化。軟件無線電的出現掀起了無線通信技術的又一次革命，它已經成為目前通信領域中最為重要的研究方向之一。所謂軟件無線電，是指構造一個通用的、可重復編程的硬件平臺，使其工作頻段、調制解調方式、業務種類、數據速率與格式、控制協議等都可以進行重構和控制，選用不同的軟件模塊就可以實現不同類型和功能的無線電臺，其核心思想是在盡可能靠近天線的地方使用寬帶A/D和D/A變換器，并盡可能地用軟件來定義無線功能[1]。
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FPGA 無線電
軟件無線電的出現，是無線電通信從模擬到數字、從固定到移動后，由硬件到軟件的第三次變革。簡單地說，軟件無線電就是一種基于通用硬件平臺，并通 過軟件可提供多種服務的、適應多種標準的、多頻帶多模式的、可重構可編程的無線電系統。軟件無線電的關鍵思想是，將AD(DA)盡可能靠近天線和用軟件來 完成盡可能多的無線電功能。
蜂窩移動通信系統已經發展到第三代，3G系統進入商業運行一方面需要解決不同標準的系統間的兼容性;另一方 面要求系統具有高度的靈活性和擴展升級能力，軟件無線電技術無疑是最好的解決方案。用ASI
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FPGA Virtex-4 PowerPC
fpga：quartusⅡ介紹
您好，目前還沒有人創建詞條fpga：quartusⅡ!
歡迎您創建該詞條，闡述對fpga：quartusⅡ的理解，并與今后在此搜索fpga：quartusⅡ的朋友們分享。
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