- 0 引言 統一潮流控制器(Unified Power Flow Con-troller，簡稱UPFC)是一種可以較大范圍地控制電流使之按指定路經流動的設備，它可在保證輸電線輸送容量接近熱穩定極限的同時又不至于過負荷?？刂葡到y是UPFC的核
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IP 設計 控制器 UPFC FPGA 基于
- 1引言在同步輻射加速器的電源設備中，舊的脈沖電源控制系統采用通用的邏輯元器件進行設計，電路復雜，調試...
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FPGA VHDL 脈沖電源
- j基于FPGA EP2S60的SoPC系統設計的綜合優化方案,為了提高設計性能(有時甚至只是為了達到設計要求)，對所設計的SOPC系統進行綜合優化是非常必要的。論文結合具體工程，以Altera公司的FPGA EP2S60為例，探討了SOPC系統設計的綜合優化方法。
1 綜合優化設計的一般流
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綜合 優化 方案 設計 系統 FPGA EP2S60 SoPC 基于
- 摘要 基于IEEE浮點表示格式及FFT算法，提出一種基2FFT的FPGA方法，完成了基于FPGA高精度浮點運算器的FFT的設計。利用VHDL語言描述了蝶形運算過程及地址產生單元，其仿真波形基本能正確的表示輸出結果。
關鍵詞 快速
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FPGA FFT 高精度 浮點運算器
- 智能驅動器以及許多汽車和 ISM 廠商正面臨著滿足新的市場需求和不斷發展的標準要求所帶來的重重挑戰。在現代工業和汽車應用中，電機必須具有高效、低噪聲、速度范圍寬、可靠性高、成本合理等特性。在當今工廠里，電機
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FPGA 驅動控制 系統設計
- 摘要 針對測井中信號傳輸速度低、操作繁瑣等問題，提出一種高速數據采集與傳輸的新方法。該設計系統采用高速AD轉換，以靈活、高效性價比FPGA芯片-EP1C6為平臺，利用USB傳輸，實現了基于Verilog的聲幅測井系統。最終，
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FPGA 高速數據 采集 傳輸
- 以最低的功耗獲得業界最好的性能?，F在開始成品批量發售Stratix? V FPGA，它在高端應用中實現了業界最大帶寬和最高系統集成度，非常靈活，降低成本和總功耗。
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FPGA DSP
- 萊迪思半導體公司(NASDAQ: LSCC)在2月28日至3月1日于德國紐倫堡舉辦的嵌入式世界展上，宣布發布升級版萊迪思HDR-60攝像機開發套件，新增加了Helion的圖形用戶界面(GUI)。
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萊迪思 FPGA HDR-60
- 摘要：LCD 顯示離不開背光源的輔助，而現在絕大多數顯示器采用恒定亮度背光源，存在顯示效果動態模糊以及低對比度等問題，并且耗能也較為嚴重。文章著重敘述一種基于視頻內容逐幀分析，然后選擇最佳背光亮度的一種由
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驅動 電路設計 及其 光源 FPGA 動態 基于
- 摘要：利用FPGA并行處理的特點及其豐富的I／O接口，在此設計了一種針對捷聯慣導系統的組合數據采集和控制系統。該系統能夠實時采集慣導系統所需的IMU和GPS數據，能夠根據需要產生任意占空比的PWM控制信號，該系統預留
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FPGA 組合 數據采集 控制系統設計
- 基于DSP和FPGA的導航計算機系統設計,摘要：為提高導航的精度和實時性，設計了基于DSP和FPGA的導航計算機模塊，成功實現了低成本、小型化的捷聯慣性導航系統。通過描述硬件的設計原理和軟件的框架及流程，簡要介紹了系統的設計和實現方法。經驗證，該系統
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計算機系 設計 導航 FPGA DSP 基于
- XUP(Xilinx大學計劃部)攜手Digilent China(上海德致倫)于2012年3月4日，在上海浦東軟件大廈Xilinx上海分公司舉辦首期TTP(Target Teaching Platform)課程培訓。
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Digilent FPGA
- MathWorks近日宣布推出HDL Coder，該產品支持MATLAB 自動生成 HDL 代碼，允許工程師利用廣泛應用的 MATLAB 語言實現 FPGA 和 ASIC 設計。MathWorks還宣布推出了HDL Verifier，該產品包含用于測試 FPGA 和 ASIC 設計的 FPGA 硬件在環功能。有了這兩個產品，MathWorks現在可提供利用 MATLAB 和 Simulink 進行 HDL 代碼生成和驗證的能力。
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MathWorks FPGA HDL
- 為創新設計和構建需要大量帶寬的應用，Altera公司(NASDAQ: ALTR)今天宣布，在世界上首次演示公司的光FPGA技術。與Avago技術公司聯合開發，這一演示展示了Altera的光互連可編程器件怎樣大幅度提高互連帶寬，同時減小系統復雜度，降低功耗和價格。這一技術演示是Altera公司最近的系列創新之一，這些創新包括，業界為FPGA開發的第一個OpenCL程序，以及28-Gbps收發器技術，實現了業界最高數據速率以及優異的信號完整性。Altera于上一季度在部分用戶中進行演示，并將于2012年3月6
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Altera FPGA
- 利用FPGA實現大型設計時，可能需要FPGA具有以多個時鐘運行的多重數據通路，這種多時鐘FPGA設計必須特別小心，需要注意最大時鐘速率、抖動、最大時鐘數、異步時鐘設計和時鐘/數據關系。設計過程中最重要的一步是確定要
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FPGA 大型 策略 多時鐘
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