- 全球可編程平臺領導廠商賽靈思公司 （Xilinx, Inc. (NASDAQ:XLNX) ）在 2011 年 NIWeek 大會期間宣布，美國國家儀器公司 (NI) 推出采用賽靈思旗艦型Spartan?-6 FPGA的業界首款多核、性能最高的 NI CompactRIO 系統和最小型化的 NI Single-Board RIO器件，進一步豐富了其可重配置 I/O (RIO) 高級控制與監控產品系列。
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賽靈思 Spartan-6 FPGA
- 基于Verilog簡易UART的FPGA/CPLD實現,目標：在xo640上實現一個簡單的Uart，能夠解析串口數據，并在寄存器中存儲，用FIFO實現數據的傳遞。那么后期可以通過開發板上的串口經CPLD訪問各種數據。比如PC=CPLD=EEPROM等等，極大方便后期的開發和調試。
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FPGA/CPLD 實現 UART 簡易 Verilog 基于
- 摘要：FPGA既具有門陣列的高邏輯密度和高可靠性，又具有可編程邏輯器件的用戶可編程性，可以減少系統的設計和維護風險，降低產品成本，縮短設計周期。文中給出了利用FPGA設計漢明距離的計算電路，同時給出與通過有效
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FPGA 漢明距離 電路
- 基于FPGA嵌入式系統的雷達目標模擬器的設計,人為地對雷達進行測試時，有時只對雷達的某個和某些參數感興趣，希望在回波中表征感興趣的參數強一些，這時就應該在回波中去掉雜波和噪聲的影響，而這在實際的外場試飛過程中是不可能實現的，這也是雷達信號模擬器對
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目標 模擬器 設計 雷達 系統 FPGA 嵌入式 基于
- 基于TMS320DM642的Flash編程,本文首先介紹常見的Flash編程方法,然后詳細介紹本文方法的原理,以及DSP系統上電加載原理,最后給出整個實現過程并分析了Flash編程時需要注意的一些問題。 Flash編程方法 常見的Flash編程方式 Flash在正常使用
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編程 Flash TMS320DM642 基于
- 引言 目前，市場上的中小規模LED顯示系統，一般采用傳統的單片機作為主控芯片。對LED大屏幕顯示屏來說，由于數據傳輸量大，要求掃描速度快，而單片機內部的資源較少、運行速度較慢，難于滿足系統要求。以FPGA
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顯示屏 控制系統 圖文 LED MCU FPGA 基于
- 摘要：在現代數字通信系統中，為了擴大信道的傳輸容量提高信號傳輸效率，常采用數字復接的技術。在分析了PCM30／32...
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FPGA PCM30 信號同步
- 研究了雷達多目標模擬系統中數字射頻存儲(DRFM)單元的設計與實現，根據模擬系統的設計要求, 提出一種基于高性能 FPGA數字射頻存儲單元設計方法；著重闡述了數字射頻存儲單元的設計思路, 給出了系統的設計方案, 并對系統中雷達模擬目標的各功能模塊進行了分析，實驗結果表明，所設計的DRFM滿足設計系統要求。
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FPGA DRFM 雷達 多目標
- FPGA與單片機實現低頻數字式相位測量儀,摘要：提出了以AVR ATmega128單片機和Altera公司的Cyclone系列EP1C3T100為核心的系統設計方案。分析了數字式低頻相位測量儀的測量原理和測量誤差及其消除的方法。主要介紹了系統的軟硬件設計。實踐表明，此方案設計的
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數字式相位 測量儀 低頻 實現 單片機 FPGA
- 基于TMS320C6416與FPGA的實時光電圖像識別系統,光電混合模式識別以其高速并行處理和無串擾的優點成為實現模式識別實用化和實時化的重要途徑，其在目標識別、指紋識別、光纖檢測、工業零件識別、汽車牌照識別等領域得到了廣泛的研究和應用[1.2]，并取得了很好的識別
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圖像 識別 系統 光電 實時 TMS320C6416 FPGA 基于
- FPGA設計中毛刺信號解析,在FPGA的設計中，毛刺現象是長期困擾電子設計工程師的設計問題之一, 是影響工程師設計效率和數字系統設計有效性和可靠性的主要因素。由于信號在FPGA的內部走線和通過邏輯單元時造成的延遲,在多路信號變化的瞬間，組合
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解析 信號 毛刺 設計 FPGA
- 摘要：為了降低超聲波流量檢測過程中噪聲對檢測精度的影響，采用FPGA器件構建了FIR濾波器，并提出一種新穎的查表法替代濾波器中的乘法運算。試驗結果表明，該濾波器設計方法顯著降低了FPGA的片內硬件開銷，提高了濾波
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FPGA 超聲波 信號處理
- 摘要：在現代數字通信系統中，為了擴大信道的傳輸容量提高信號傳輸效率，常采用數字復接的技術。在分析了PCM30／32路系統基群信號幀結構的基礎上，以EDA綜合仿真設計軟件QuartusⅡ8．0為開發平臺，利用Verilog HDL硬
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FPGA PCM 30 系統
- 摘要：基于長期演進(LTE)的Tail-biting卷積碼，介紹了維特比譯碼算法，它是一種最優的卷積碼譯碼算法。由于Tail-biting卷積碼的循環特性，采用固定延遲譯碼的方法，降低了譯碼復雜度。通過使用全并行的結構及簡單的回
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FPGA LTE 卷積碼 譯碼器
- I2C總線作為一種事實上的國際標準，在超過100種不同的IC上實現并且得到超過50家公司的許可。它具有連線少，結構簡單的特點。本文介紹了一種高速I2C從器件接口電路IP核設計。在系統應用中，單片機作為主控器件，本IP核作為從器件中的接口電路，它們通過I2C總線相連，實現MCU對IC或FPGA中相關寄存器的訪問。從而代替了MCU通用的地址數據接口，大大減少了IC或FPGA的管腳數量，節省了I/O資源，這對于I/O資源緊張的IC設計和FPGA開發是非常有意義的。
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FPGA I2C總線 IP核 201107
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