北京音視潮半導體技術有限公司宣布一筆重大捐贈，及參加清華大學微電子研究所的聯合教學和科研計劃。通過該協議，音視潮公司捐贈其全套DSP環境即Jazz™ Composer Tool Suite，用于開設一個實驗室，在先進的媒體處理半導體設計的最新方法方面培訓學生。此外， 音視潮公司在當年即參加微電子研究所“先進DSP體系結構和設計”研究生課程的教學，并為參加科研項目的教員、實驗室工作人員和研究生提供DSP講座。 清華大學計劃在今年秋季開始的新學年開設一個
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DSP 單片機 嵌入式系統 清華大學
“今天，FPGA越來越多地應用在多種DSP中。我們預計這一趨勢在未來幾年會更加明顯?！泵绹{查機構Berkeley設計技術公司做了上述預測。以Xilinx和Altera為主的兩大FPGA廠商多年前就涉足了DSP應用領域，近一、兩年，隨著3G通信、視頻成像等領域的發展，FPGA for DSP(FPGA的DSP)再次成為了熱點。為什么會用FPGA做DSP？Xilinx中國區運營總經理吳曉東從DSP的概念上進行了分析：DSP表示數字信號處理器，也可以表示為數字信號處理—并不代表某一種芯片。實際上，數字信號處理
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0706_A DSP FPGA 單片機 嵌入式系統 雜志_專題
問：現在DSP跟微處理器結合的情況比較多，實現DSP功能的FPGA是否也要和微處理器合作？答：現在90%以上的FPGA都運用在處理器上，這也正是FPGA這方面的優勢。你可以用FPGA的邏輯搭建一個軟處理器，也可以選用具有內嵌硬處理器的產品。因此，可以很容易在FPGA上實現微處理器的性能。
問：FPGA已經能夠實現DSP，為何還要專門開發為DSP應用的FGPA？答：首先，所有的FPGA都有乘法器，如果你可以拿這些乘法器做數字信號處理，但是不是最優化的。例如，如果你選擇Xilinx Spartan的產品，你
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0706_A DSP FPGA 單片機 嵌入式系統 雜志_專題
以基于TI公司TMS320F2812 DSP的視頻處理系統為例，在DSP／BIOS的基礎上設計GTO／FVID模型的視頻設備底層驅動程序，為高層應用程序開發人員提供方便的API接口函數來操作底層視頻設備，提高了視頻處理系統的開發效率。
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處理 驅動程序 視頻 DSP GIO FVID 基于
用TMS320F206實現了有源式光纖電流互感器二次側輸出信號的處理，包括真有效值（RMS）的計算、互感器低壓側顯示儀表的實現和電力系統繼電保護的數字接口的實現等，給出了硬件設計和軟件設計方法。
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信號處理 電流互感器 光纖 DSP 基于
介紹了在多個DSP之間或者DSP與其他CPU之間存儲器共享技術的基本設計方法，重點介紹了如何在設計上提高存儲器的訪問速度和克服訪問競爭的方法。
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技術 設計 訪問 快速 存儲器 共享 DSP
針對高密度接口設計中基于字節處理和整包處理的轉換問題，本文提出了分片輪詢調度和改進式欠賬輪詢調度相結合的調度策略
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FPGA 輪詢合路
用VHDL語言在FPGA內部編程實現組播復制。本文介紹其實現方法，并給出了時序仿真波形。通過擴展，該設計可以支持多位寬、多路復制，因而具有較好的應用前景。
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FPGA 位寬 多路
電子產品世界,為電子工程師提供全面的電子產品信息和行業解決方案,是電子工程師的技術中心和交流中心,是電子產品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網絡家園
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DSP 電源設計 FPGA 德州儀器
電子產品世界,為電子工程師提供全面的電子產品信息和行業解決方案,是電子工程師的技術中心和交流中心,是電子產品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網絡家園
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DSP 電源設計 FPGA
本文介紹了一種基于雙TMS320VC5416處理器的實時圖像搜索跟蹤處理系統，詳細闡述了該系統的硬件設計思想，并結合一種跟蹤算法實例敘述了基于DSP的圖像搜索與跟蹤處理系統軟件設計的一般流程。
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跟蹤 系統 設計 搜索 目標 DSP 實時 圖像 基于
基于MPEG-4的視頻編解碼技術已經成為當前多媒體技術發展的熱點。本文提出了一種以多DSP為核心的MPEG-4編解碼系統，并設計出了具體的硬件平臺方案。
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設計 系統 MPEG-4 DSP 基于
摘 要：針對高速圖像目標實時識別和跟蹤任務，需要利用系統中有限的硬件資源實現高速、準確的二值圖像連通域標記，提出了一種適合FPGA實現的二值圖像連通域標記快速算法。算法以快捷、有效的方式識別、并記錄區域間復雜的連通關系。與傳統的二值圖像標記算法相比，該算法具有運算簡單性、規則性和可擴展性的特點。利用FPGA實現該算法時，能夠準確有效的識別出圖像中復雜的連通關系，產生正確的標記結果。在100MHz工作時鐘下，處理384
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FPGA 單片機 二值圖像連通域標記 嵌入式系統
通用視頻標準和編解碼器
聯合視頻組（Joint Video Team, JVT）由 ITU的視頻編碼專家組（Video Coding Experts Group, VCEG）和ISO/IEC運動圖像專家組（Moving Picture Experts Group, MPEG）組成。VCEG開發自愿性標準，用于會話和非會話類音/視頻應用的先進移動圖像編碼。 MPEG開發國際標準，用于移動圖像、音頻及兩者組合的壓 縮、編碼、解壓縮、處理等，以滿足各種應用。總之，JVT已經開發了包括ITU H.262/MP
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DSP 單片機 頻編解碼 嵌入式系統
1 引 言
要求改變脈沖周期和輸出脈沖個數的脈沖輸出電路模塊在許多工業領域都有運用。采用數字器件設計周期和輸出個數可調節的脈沖發生模塊是方便可行的。為了使之具有高速、靈活的優點，本文采用Atelra公司的可編程芯片FPGA設計了一款周期和輸出個數可變的脈沖發生器。經過板級調試獲得良好的運行效果。
2 總體設計思路
脈沖的周期由高電平持續時間與低電平持續時間共同構成，為了改變周期，采用兩個計數器來分別控制高電平持續時間和低電平持續時間。計數器采用可并行加載初始值的N位減法計數器。設定：當要求的高電平
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FPGA 單片機 脈沖發生器 嵌入式系統
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