- 用DSP實現MPEG音頻層III壓縮的加速方法,1 概述 數字音頻壓縮技術給人們提供了一種更為有效的音頻存儲、傳輸方法。音頻壓縮的技術有很多種，它們的復雜度、音頻壓縮質量、以及壓縮比都有很大的差別。如：mu;-law音頻壓縮算法，其特點是簡單，但壓縮比很
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壓縮 加速 方法 III 音頻 實現 MPEG DSP
- 本文主要介紹一個基于串口屏、M0單片機、微打模塊、讀卡模塊的充電樁應用方案。此方案模擬了真實充電樁的絕大部分功能，通過使用本方案，設備制造商便能在短周期內完成整個充電樁的設計，迅速占領市場并取得成功。
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FPGA 單片機 TinyM0-CAN 201109
- 使用Xilinx公司的Spartan-6 FPGA系列芯片所提供的MCB，在生成控制模塊時設置不同參數，可以輕而易舉的實現對不同型號的DDR存儲芯片的測試，數據率可高達800Mb/s以上。由于時間利用率比使用計算機主板測試DDR芯片高得多，所以可以極大地節約測試時間。
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Xilinx FPGA DDR 201109
- 2011年9月27號，北京——Altera公司 (NASDAQ: ALTR) 今天宣布，開始提供業界第一款基于Serial RapidIO Gen2 FPGA的解決方案，進一步提高下一代3G和4G無線基站的帶寬，鏈路更加靈活。Altera成功的實現了Stratix IV GX FPGA中的RapidIO MegaCore 功能IP內核與集成器件技術公司 (IDT) Serial RapidIO Gen 2交換機的互操作性。Altera成熟的Serial RapidIO Gen2解決方案為高性能通信系統中
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Altera FPGA
- 基于DSP的語音采集與回音效果的系統實現,引言
數字技術的應用幾乎已經滲透到現代科技的每一個角落，而數字音頻技術則是應用最廣泛的領域之一。現在大量的數字音頻設備已相當成熟，利用軟件在已有的硬件平臺上實現不同的功能已成為一種趨勢，軟件編程的
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效果 系統 實現 回音 采集 DSP 語音 基于
- 基于DSP的SOPC技術設計,結合Altera公司推出的Nios II嵌入式軟核處理器，提出一種具有常規DSP處理器功能的NiosII系統SOPC解決方案；利用NiosII可自定叉指令的特點。 通過Matlab和DSP Builder或直接用VHDL設計并生成復數乘法器、整數乘法器
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設計 技術 SOPC DSP 基于
- 基于FPGA的信號發生器設計,以FPGA 芯片為載體， 通過QuartusII 的LPM_ROM 模塊和VHDL 語言為核心設計一個多功能信號發生器，根據輸入信號的選擇可以輸出遞增鋸齒波、遞減鋸齒波、三角波、階梯波和方波等5 種信號，通過QuartusII 軟件進行波形仿
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設計 信號發生器 FPGA 基于
- 為了解決基于LabVIEWFPGA模塊的DMAFIFO深度設定不當帶來的數據不連續問題，結合LabVIEWFPGA的編程特點和DMA FIFO的工作原理，提出了一種設定FIFO深度的方法。對FIFO不同深度的實驗表明，采用該方法設定的FIFO深度能夠
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LabVIEW FPGA FIFO 模塊
- 本文提出了一種基于FPGA的嵌入式UART模塊化設計方法，通過UART實現了FPGA與GPS_OEM板之間的數據通信。基于VHDL語言，通過有限狀態機，將UART模塊集成到FPGA上，給出了系統的功能仿真結果，驗證了系統設計的正確性，增強了設計的靈活性。
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FPGA UART 201109
- 設計的航空總線接口板測試平臺滿足通用設備CAN總線、RS485差分電平異步總線及LVDS差分電平異步總線數據傳輸要求。通過對各模塊功能分析，在仿真軟件中通過功能仿真驗證，并在工程應用中得到驗證。此設計通過RS232接口連接上位機實現數據收發，并能對CAN總線及高速異步總線參數進行動態配置。
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CAN FPGA MCU 201109
- FPGA的功耗高度依賴于用戶的設計，沒有哪種單一的方法能夠實現這種功耗的降低，如同其它多數事物一樣，降低功耗的...
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低功耗 FPGA
- 作為基于FPGA原型方法的擁護者，有人可能會認為我們只片面地看到了這種方法的優點，而對其缺陷視而不見。但那...
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FPGA 原型設計
- 引言DSP有著處理速度快、功能強大等優點，該設計以TMS320F2812為控制芯片，以HS12864液晶顯示模塊為顯示...
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DSP TMS320F2812
- intevac是商用和軍用市場光學產品的前沿開發商。本文介紹該公司nightvista嵌入式電子系統的開發，該產品是高...
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可配置軟核處理器 FPGA DSP
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