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        cpld/fpga 文章 最新資訊

        基于FPGA片上PowerPC在VxWorks下的千兆網(wǎng)通信

        • 當(dāng)前,SoC向著面積更小,速度更高的方向發(fā)展,百兆網(wǎng)通信已不能滿足人們的生產(chǎn)和工作需要,用千兆網(wǎng)通信成為工...
        • 關(guān)鍵字: VxWorks  PowerPC  千兆網(wǎng)通信  FPGA  SoC  

        基于CPLD的可編程寬頻高精度CCD信號(hào)發(fā)生器設(shè)計(jì)

        • 本文設(shè)計(jì)了一種基于CPLD的可編程高精度CCD信號(hào)發(fā)生器。充分利用CPLD的可編程性.模擬出滿足系統(tǒng)要求的CD信號(hào),輸出信號(hào)頻率達(dá)到1IMHZ。
        • 關(guān)鍵字: CPLD  CCD  可編程  高精度    

        微型打印機(jī)與FPGA的硬件接口及軟件設(shè)計(jì)

        • 摘要:為了實(shí)現(xiàn)便攜式、實(shí)時(shí)打印數(shù)據(jù)的目的,在分析EP3C25型FPGA和RD-E型微型打印機(jī)性能特點(diǎn)的基礎(chǔ)上,基于嵌入式技術(shù)設(shè)計(jì)了 FPGA與微型打印機(jī)的硬件接口電路、軟件流程及控制程序。利用FPGA控制微型打印機(jī)正常工作,
        • 關(guān)鍵字: FPGA  微型打印機(jī)  軟件設(shè)計(jì)  硬件接口    

        利用FPGA實(shí)現(xiàn)的任意波形發(fā)生器的研究設(shè)計(jì)

        • 波形發(fā)生器廣泛應(yīng)用于電子電路、自動(dòng)控制和科學(xué)試驗(yàn)領(lǐng)域,是一種為電子測(cè)量工作提供符合嚴(yán)格技術(shù)要求的電...
        • 關(guān)鍵字: FPGA  任意波形發(fā)生器  

        Altium與蘇州大學(xué)共建電子設(shè)計(jì)聯(lián)合實(shí)驗(yàn)室

        •   Altium日前宣布與蘇州大學(xué)合作共建電子設(shè)計(jì)聯(lián)合實(shí)驗(yàn)室,通過(guò)開(kāi)展電子電路設(shè)計(jì)、FPGA數(shù)字電路設(shè)計(jì)及SoPC嵌入式系統(tǒng)設(shè)計(jì)領(lǐng)域相關(guān)的教學(xué)合作,進(jìn)一步提升江蘇省及周邊地區(qū)電子設(shè)計(jì)人才的綜合素養(yǎng)。長(zhǎng)久以來(lái),Altium一直堅(jiān)持深耕教育領(lǐng)域,通過(guò)不斷加強(qiáng)與大專院校的合作,支持中國(guó)高校電子設(shè)計(jì)人才的培養(yǎng),從而為中國(guó)電子設(shè)計(jì)行業(yè)的發(fā)展貢獻(xiàn)力量。   
        • 關(guān)鍵字: Altium  FPGA  大學(xué)  

        利用CPLD解決便攜式產(chǎn)品設(shè)計(jì)的挑戰(zhàn)

        • 移動(dòng)電話、便攜式媒體播放器、掌上游戲機(jī)和數(shù)碼相機(jī)等便攜式產(chǎn)品的激增,使得系統(tǒng)設(shè)計(jì)人員承受著越來(lái)越大的壓力。他們必須不停地開(kāi)發(fā)提供擁有新特性和功能的產(chǎn)品,并盡量縮短產(chǎn)品的上市時(shí)間。那么,CPLD可微為便攜設(shè)
        • 關(guān)鍵字: 產(chǎn)品設(shè)計(jì)  挑戰(zhàn)  便攜式  解決  CPLD  利用  

        Turbo簡(jiǎn)化譯碼算法的FPGA設(shè)計(jì)與實(shí)現(xiàn)

        • Turbo碼雖然具有優(yōu)異的譯碼性能,但是由于其譯碼復(fù)雜度高,譯碼延時(shí)大等問(wèn)題,嚴(yán)重制約了Turbo碼在高速通信系統(tǒng)中的應(yīng)用。因此,如何設(shè)計(jì)一個(gè)簡(jiǎn)單有效的譯碼器是目前Turbo碼實(shí)用化研究的重點(diǎn)。本文主要介紹了短幀Turbo譯碼器的FPGA實(shí)現(xiàn),并對(duì)相關(guān)參數(shù)和譯碼結(jié)構(gòu)進(jìn)行了描述。
        • 關(guān)鍵字: Turbo  FPGA  譯碼算法    

        視頻圖像灰度信號(hào)直方圖均衡的FPGA實(shí)現(xiàn)

        • 本文主要介紹在FPGA上實(shí)現(xiàn)直方圖均衡算法的總體結(jié)構(gòu)和最重要的兩個(gè)子模塊的實(shí)現(xiàn)細(xì)節(jié),以及最終的實(shí)現(xiàn)結(jié)果。
        • 關(guān)鍵字: FPGA  視頻圖像  灰度  均衡    

        一種基于FPGA的誘發(fā)電位儀系統(tǒng)研究與設(shè)計(jì)

        • O引言誘發(fā)電位是指對(duì)神經(jīng)系統(tǒng)某一特定部位給予特定刺激后在大腦皮層所產(chǎn)生的特定電活動(dòng),對(duì)于神經(jīng)...
        • 關(guān)鍵字: FPGA  誘發(fā)電位儀  

        大型設(shè)計(jì)中FPGA的多時(shí)鐘設(shè)計(jì)策略

        • 利用FPGA實(shí)現(xiàn)大型設(shè)計(jì)時(shí),可能需要FPGA具有以多個(gè)時(shí)鐘運(yùn)行的多重?cái)?shù)據(jù)通路,這種多時(shí)鐘FPGA設(shè)計(jì)必須特別小心,需要注意最大時(shí)鐘速率、抖動(dòng)、最大時(shí)鐘數(shù)、異步時(shí)鐘設(shè)計(jì)和時(shí)鐘/數(shù)據(jù)關(guān)系。設(shè)計(jì)過(guò)程中最重要的一步是確定要
        • 關(guān)鍵字: FPGA  大型  策略  多時(shí)鐘    

        脈沖壓縮原理及FPGA實(shí)現(xiàn)

        • 摘要:為解決雷達(dá)作用距離和距離分辨力的問(wèn)題,分析了線性調(diào)頻脈沖壓縮的原理及工程實(shí)現(xiàn)方法,并利用Matlab軟件對(duì)加權(quán)前后的線性調(diào)頻信號(hào)脈沖壓縮波形進(jìn)行對(duì)比。簡(jiǎn)述了分布式(DA)算法的基本原理,給出一種基于FPGA分
        • 關(guān)鍵字: FPGA  脈沖壓縮  原理    

        基于FPGA的帶CRC校驗(yàn)的異步串口通信

        • 摘要:由于FPGA具有速度快,效率高,靈活穩(wěn)定,集成度高等優(yōu)點(diǎn),所以為了提高串口通信的速度和效率,在串行通信中采用FPGA來(lái)實(shí)現(xiàn)串口通信是十分必要的。由于通信傳輸?shù)牟淮_定性以及干擾等原因,串行通信經(jīng)常會(huì)出現(xiàn)異
        • 關(guān)鍵字: FPGA  CRC  異步串口  通信    
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