- 全球可編程平臺領導廠商賽靈思公司 (Xilinx, Inc. (NASDAQ:XLNX) )日前宣布Virtex?-7 X690T FPGA開始發貨，該器件將業界最可靠的高速串行收發器、最高系統帶寬和面向市場優化的 FPGA 資源完美結合在一起。Virtex-7 X690T FPGA，是7 系列產品中首款可滿足先進高性能有線通信應用對低功耗、單芯片解決方案需求的器件。該系列器件可支持快速、可擴展、易于實現的芯片間串行接口;穩健可靠的 10GBASE-KR 背板(不僅支持下一代通信系統各種不同的板間距，而且
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賽靈思 FPGA Virtex-7
- 電子產品世界,為電子工程師提供全面的電子產品信息和行業解決方案,是電子工程師的技術中心和交流中心,是電子產品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網絡家園
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DSP 激光標記 CPLD 控制系統
- 摘要：文章主要闡述以單片機+CPLD的方案進行的LED大屏幕顯示控制系統的設計。以單片機作為系統的數據通信控制和擴展其它功能，CPLD作為顯示屏正常動態顯示的硬件控制，采用模塊化的設計，使結構簡單，修改功能方便，
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控制系統 設計 顯示屏 LED CPLD 基于
- 基于FPGA的CAN總線通信節點設計,摘要：以FPGA代替傳統的單片機和外圍擴展芯片，給出了CAN總線通信節點的詳細設計方案。其中以SJA1000為CAN總線控制器、FPGA為主控制器，設計實現通信節點的硬件接口電路。基于對CAN總線控制器的功能分析，并應用Veri
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節點 設計 通信 總線 FPGA CAN 基于
- 1 引言 HDLC（High-level Data Link Control Procedures, 高級數據鏈路控制規程）廣泛應用于數據通信領域，是確保數據信息可靠互通的重要技術。實施HDLC的一般方法通常是采用ASIC（Application Specific Integr
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HDLC FPGA 實現方法
- 設計嵌入系統的主要挑戰來自于需要同時優化眾多設計因素。這些需要優化的設計因素包括單位成本、NRE（不可回收工程）成本、功率、尺寸、性能、靈活性、原型制造時間、產品上市時間、產品在市場生存時間、可維護性、可
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FPGA 架構 嵌入式系統
- 醫療電子平臺選擇：FPGA、ARM、DSP還是GPU？,“邁瑞對于處理器平臺的選擇有兩個看似矛盾的原則：lsquo;多rsquo;和lsquo;少rsquo;。其中lsquo;多rsquo;是指多樣性，我們知道無論是DSP、ARM、X86還是FPGA、GPU，每個平臺都有各自的優點和缺陷，因此在設
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FPGA ARM DSP GPU
- 采用CPLD的專用鍵盤接口芯片的方案設計,在單片機應用系統中，存在多種形式的外部數據輸入接口界面，例如RS-232C串行通信、鍵盤輸入等[1,4] 。其中利用鍵盤接口輸入數據，是實現現場實時調試、數據調整和控制最常用的方法。單片機的外圍鍵盤擴展電路有多種實
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芯片 方案設計 接口 鍵盤 CPLD 專用 采用
- 基于Linux平臺下的FPGA的ARM驅動開發方法,Linux操作系統的全稱是GNU／Linux，它是由GNU工程和Linux內核兩個部分共同組成的一個操作系統。該系統中所有組件的源代碼都是自由的，可以有效保護學習成果，因而在嵌入式領域得到了廣泛的應用。
FPGA是英文Field
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驅動 開發 方法 ARM FPGA Linux 平臺 基于
- 全球領先的電子器件和系統設計、驗證和制造軟件及知識產權（IP）供應商新思科技公司日前宣布：推出其最新版的Synplify Pro? 和Synplify? Premier 現場可編程門陣列（FPGA）綜合工具。Synplify 2012.03產品包括改進的綜合算法，它將運行時間提速最高達30%。此外，Synplify Premier軟件通過一種新的容錯并繼續功能而得到增強，以滿足FPGA設計師對快速周轉時間的需求；該軟件能使設計師在最后的硬件描述語言（HDL）編譯環節生成一份報告，并修正所有源自丟失或不正
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新思科技 Synplify FPGA
- 進一步延續其在基于FPGA的視頻監控解決方案上的領先優勢，Altera公司 (NASDAQ: ALTR)日前發布了面向監控系統數字視頻錄像機(DVR)和網絡視頻錄像機(NVR)的四通道標準清晰度(SD)視頻分析解決方案。與Eutecus公司聯合開發，Altera最新的視頻分析解決方案支持用戶使用一片FPGA同時分析四路D1 480p/30fps (每秒幀數)視頻通道。用戶可以在現有SD監控投入上迅速高效的增加功能，不需要購買集成了分析功能的新攝像機。
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Altera FPGA
- Altera公司(Nasdaq: ALTR)日前宣布，goHDR作為FPGA OpenCL計劃的早期試用客戶，通過Altera的FPGA OpenCL計劃，大幅度縮短了開發時間，顯著提高了性能。與Altera密切合作，goHDR將其專用C代碼導入到OpenCL標準中，不到一星期的時間便在FPGA中實現了這些代碼——使用傳統的HDL流程，這一過程一般需要3到6個月的時間。
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Altera FPGA
- 1 概述在WCDMA中，加擾就是用一個偽隨機碼序列對擴頻碼進行相乘，對信號進行加密。上行鏈路物理信道加擾的作用是區分用戶，下行鏈路加擾可以區分小區和信道。WCDMA采用Gold碼作為擴頻序列的擾碼。Gold由兩個M序列相
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WCDMA FPGA
- 摘要：提出了一種基于FPGA的數字選頻器設計方案，該數字選頻器應用于八通道的GSM系統直放站，采用低成本的FPGA芯片Xilink Spartan-3A DSP XC3SD3400A進行數字信號處理。給出了較詳細的硬件設計方案，并通過Agilent T
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FPGA 數字 選頻
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