asic ip核 文章 進入asic ip核技術社區(qū)
DARPA：人工智能需要ASIC芯片 我們正在努力
- 上周三，美國國防部高級研究計劃局(DARPA)宣布，為了幫助人工智能技術獲得長足發(fā)展，他們即將開展兩項新項目，開發(fā)新一代計算機芯片。DARPA相信，開發(fā)專門應用于人工智能領域的特制芯片將推動該領域的不斷發(fā)展。 特制芯片 50年來，摩爾定律作為一項基本原理，一直推動著計算機芯片微處理器的發(fā)展。 20世紀60年代，英特爾聯(lián)合創(chuàng)始人Gordon Moore在經(jīng)過一系列的觀察后，得出了一個推測，他推測集成電路上晶體管的數(shù)量，約每隔18-24個月便會增加一倍，微芯片的性能也會得到有效的提升。但現(xiàn)在的
- 關鍵字： 人工智能 ASIC
ASIC廠商大戰(zhàn)AI芯片市場，這家公司可能成為最大黑馬？
- 人工智能(AI)現(xiàn)在的熱度節(jié)節(jié)攀升。這項技術存在了數(shù)十年之久，一直不溫不火，但它最近已經(jīng)成為數(shù)據(jù)中心分析、自動駕駛汽車和增強現(xiàn)實等應用的焦點。這項技術怎么就重獲新生了呢?在我看來，人工智能迅速走熱的趨勢是由兩種力量所推動的：訓練人工智能系統(tǒng)所需要的數(shù)據(jù)的大爆發(fā)和可以大大加快訓練進程的新技術的出現(xiàn)。下面，我們分別從這兩個方面進行一下解讀。 數(shù)據(jù)就是人工智能世界的貨幣。沒有大量的已知結果，就無法進行推論和機器學習。得益于數(shù)據(jù)中心領域幾個巨無霸的強力推動，各種數(shù)據(jù)庫正處于如火如荼的建設中。谷歌已經(jīng)積累
- 關鍵字： ASIC AI
如何采用SystemVerilog來改善基于FPGA的ASIC原型
- ASIC在解決高性能復雜設計概念方面提供了一種解決方案,但是ASIC也是高投資風險的,如90nm ASIC/SoC設計大約需要2000萬美元開發(fā)成本.為了降低成本,現(xiàn)在可采用FPGA來實現(xiàn)ASIC.但是,但ASIC集成度較大時,需要幾個FPGA來實現(xiàn),這就需要考慮如何來連接ASIC設計中所有的邏輯區(qū)塊.采用SystemVerilog,可以簡化這一問題.
- 關鍵字： SystemVerilog ASIC FPGA
SoC設計中的IP核保護方法研究
- 對現(xiàn)有主要IP核保護方法的原理和性能進行了研究分析,指出了各種方法的優(yōu)缺點,同時指出了IP核保護方法的發(fā)展方向。 隨著集成電路的規(guī)模依據(jù)摩爾定律不斷呈指數(shù)增長,目前已經(jīng)可以將整個系統(tǒng)集成到一塊單硅芯片上,片上系統(tǒng)(Sys-tem on a Chip, SoC)的概念也應運而生。然而對于大型的SoC 來說,無論從設計的費用、周期還是可靠性來考慮,傳統(tǒng)的設計方法均已不能滿足需求,因此,基于知識產(chǎn)權( Intellectual Pro-perty, IP)核復用的設計方法也就隨之出現(xiàn)。
- 關鍵字： 片上系統(tǒng) 知識產(chǎn)權核 數(shù)字水印 簽名 IP核
IP核互連策略及規(guī)范
- 摘要：IP核有關標準及IP核互連規(guī)范目前正處于一個發(fā)展的關鍵時期，受到了業(yè)界的普遍關注。本文就IP核互連采取的策略進行了分析，對目前幾種使用較多的IP核互連規(guī)范作了介紹。
- 關鍵字： 片上系統(tǒng)SOC 片上總線（On-ChipBus） IP核 互連策略 互連規(guī)范
ASIC中的異步時序設計
- 絕大部分的ASIC設計工程師在實際工作中都會遇到異步設計的問題，本文針對異步時序產(chǎn)生的問題，介紹了幾種同步的策略，特別是結繩法和異步FIFO的異步比較法都是比較新穎的方法。
- 關鍵字： ASIC
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