- 相對其他成熟的計算機體系，SOPC系統現在還沒有命令行。為了更好的推廣SOPC應用，筆者開發了一個智能的命令行模塊，可以調用系統中的任意函數，降低了開發人員的使用難度。
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SOPC 命令行 FPGA
- 基于IEEE浮點表示格式及FFT算法，提出一種基2FFT的FPGA方法，完成了基于FPGA高精度浮點運算器的FFT的設計。利用VHDL語言描述了蝶形運算過程及地址產生單元，其仿真波形基本能正確的表示輸出結果。
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蝶形運算 FFT FPGA
- 本節旨在通過給定的工程實例——“數字鐘”來熟悉Altera軟嵌入式系統的軟硬件設計方法。同時使用基于Altera FPGA的開發板將該實例進行下載驗證，完成工程設計的硬件實現。在本節中，將主要講解以下知識點。
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SOPC NiosII FPGA 數字鐘
- 以基于靜態隨機存儲器(SRAM)的現場可編程門陣列(FPGA)為例，在傳統的三次測試方法的基礎上提出了一種新穎的針對FPGA互聯資源的測試方法。該方法運用了層次化的思想，根據開關矩陣中可編程互聯點(PIP)兩端連線資源的區別將互聯資源進行層次化分類，使得以這種方式劃分的不同類別的互聯資源能夠按一定方式進行疊加測試，這就從根本上減少了實際需要的測試配置圖形和最小配置次數。
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互聯資源 分層測試 FPGA
- 本節旨在通過給定的工程實例——“Hello LED”來熟悉Altera軟嵌入式系統的軟硬件設計方法。同時使用基于Altera FPGA的開發板將該實例進行下載驗證，完成工程設計的硬件實現。本節主要講解下面一些
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SOPC NiosII FPGA
- 由于超級電容器單體性能參數的離散性，當多個單體串聯組成電容器組時，在充放電過程中容易造成過充或過放現象，嚴重危害超級電容器的使用壽命。文中提出以FPGA為檢測、控制單元，對電容進行有效地充放電控制，防止過充或過放，提高超級電容器的循環使用次數，降低不必要的能量消耗。
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超級電容 串聯均壓 FPGA
- NIOS II使用NIOS II IDE集成開發環境來完成整個軟件工程的編輯、編譯、調試和下載。在采用NIOS處理器設計嵌入式系統時，通常會按照以下步驟。
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片上可編程系統 SOPC FPGA NiosII
- LCD 顯示離不開背光源的輔助，而現在絕大多數顯示器采用恒定亮度背光源，存在顯示效果動態模糊以及低對比度等問題，并且耗能也較為嚴重。文章著重敘述一種基于視頻內容逐幀分析，然后選擇最佳背光亮度的一種由FPGA 控制的動態背光源設計方案。實驗采用的是TI 公司的TLC5947，具有多個輸出通道，可以適用于大規模顯示屏。
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RGB 背光 FPGA
- 介紹了一種在工程爆破振動數據采集中應用的控制器設計方案。系統采用Altera公司的FPGA作為主控制器芯片，其中集成控制邏輯單元與NiosII軟核嵌入式處理器二者結合成為單芯片控制器方案。
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NiosII 嵌入式處理器 FPGA
- SoC即System On Chip，是片上系統簡稱。它是IC設計與工藝技術水平不斷提高的結果。SoC從整個系統的角度出發，把處理機制、模型算法、芯片結構、各層次電路直至器件的設計緊密結合起來，在單個（或少數幾個）芯片上完成整個系統的功能。所謂完整的系統一般包括中央處理器、存儲器以及外圍電路等。
- 關鍵字：
片上可編程系統 SOPC FPGA
- 可以使用Quartus II Simulator在工程中仿真任何設計。根據所需的信息類型，可以進行功能仿真以測試設計的邏輯功能，也可以進行時序仿真。在目標器件中測試設計的邏輯功能和最壞情況下的時序，或者采用Fast Timing模型進行時序仿真，在最快的器件速率等級上仿真盡可能快的時序條件。
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QuartusII 編譯 FPGA 仿真
- 設計好工程文件后，首先要進行工程的約束。約束主要包括器件選擇、管腳分配及時序約束等。時序約束屬于較為高級的應用，通過時序約束可以使工程設計文件的綜合更加優化。下面對這幾種約束方式進行介紹。
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QuartusII 約束 FPGA 配置
- 邏輯鎖定方法學（LogicLock Methodology）內容就是在設計時采用邏輯鎖定的基于模塊設計流程（LogicLock block-based design flow），來達到固定單模塊優化的目的。這種設計方法學中第一次引入了高效團隊合作方法：它可以讓每個單模塊設計者獨立優化他的設計，并把所用資源鎖定。
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QuartusII LogicLock FPGA 邏輯鎖定工具
- 顯示器因為其輸出信息量大，輸出形式多樣等特點已經成為現在大多數設計的常用輸出設備。在 FPGA 的設計中可以使用很少的資源，就產生 VGA 各種控制信號。這個示例在 RHicSP2200B FPGA 開發板/學習板上使用 VGA 接口在顯示器上顯示了文字以及簡單的圖形，可以作為VGA 顯示設計的參考，如果在使用這個例子的過程
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VGA 接口 FPGA
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