為存儲(chǔ)器測(cè)試開發(fā)低成本的解決方案
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存儲(chǔ)器的功能測(cè)試由數(shù)字測(cè)試設(shè)備執(zhí)行的一系列讀寫操作構(gòu)成。每次執(zhí)行讀操作之后，測(cè)試系統(tǒng)將讀取的數(shù)據(jù)與期望值做比較。測(cè)試數(shù)據(jù)線不需要重復(fù)通過(guò)存儲(chǔ)器中的每個(gè)地址。例如，一個(gè)4位存儲(chǔ)器只需要4次寫和讀操作，以完全驗(yàn)證數(shù)據(jù)線并核查粘著性(stuck-at)故障。通過(guò)選擇單一地址，初始化時(shí)存儲(chǔ)器各位均置為“0”，采用“進(jìn)位置1”模式寫入數(shù)據(jù)，工程師就可以高效地測(cè)試數(shù)據(jù)線。圖2所示為4位存儲(chǔ)器件的“進(jìn)位置1”模式。測(cè)試的第一步是把“1000”寫入期望的位置，然后，對(duì)該地址進(jìn)行初始化讀操作。如果存儲(chǔ)器返回的數(shù)據(jù)與所寫入的數(shù)據(jù)相匹配，那么就表明該數(shù)據(jù)線功能正確。采用不同的測(cè)試模式，工程師可通過(guò)類似步驟驗(yàn)證地址線和每一個(gè)存儲(chǔ)位。 本文引用地址：http://www.104case.com/article/202576.htm
盡管一些數(shù)字儀器可以執(zhí)行這種簡(jiǎn)單的測(cè)試，但要測(cè)試更復(fù)雜的存儲(chǔ)器件則需要成百上千的讀寫操作。如果用軟件執(zhí)行比較讀入數(shù)據(jù)與每次讀操作后的期望響應(yīng)，那么測(cè)試時(shí)間可能會(huì)成指數(shù)級(jí)增長(zhǎng)。
為了將使空閑時(shí)間減到最小，先進(jìn)的測(cè)試設(shè)備支持基于每個(gè)周期和每個(gè)通道的雙向通信。先進(jìn)的測(cè)試儀器可以在一個(gè)時(shí)鐘周期內(nèi)從存儲(chǔ)器讀取并比較數(shù)據(jù)，而無(wú)需讓存儲(chǔ)器件停下來(lái)重新配置，或把數(shù)據(jù)傳輸?shù)絇C上進(jìn)行比較。隨著基于FPGA的儀器的應(yīng)用增多，除了0和1之外，新型和現(xiàn)有硬件還支持邏輯狀態(tài)的測(cè)量。為了驗(yàn)證來(lái)自存儲(chǔ)器的數(shù)據(jù)，測(cè)試向量利用特定的狀態(tài)來(lái)定義何時(shí)數(shù)字儀器應(yīng)該主動(dòng)接收數(shù)據(jù)以及期望響應(yīng)值是什么。例如，國(guó)家儀器公司的PXI- 6552數(shù)字波形發(fā)生器/分析儀利用能支持6個(gè)不同通道狀態(tài)的FPGA，根據(jù)測(cè)試向量中的數(shù)據(jù)重新配置儀器的行為。
圖2. “進(jìn)位置1”模式。
評(píng)論