數頻率校正的FPGA實現
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2 CORDIC算法的FPGA實現
用FPGA實現CORDIC算法，最常用的方法有迭代算法和基于流水線的算法。CORDIC迭代算法只有一級迭代單元，在系統時鐘的驅動下，可將迭代單元的輸出作為本級的輸入，并通過同一級迭代完成計算。迭代算法的硬件開銷很小，但完成一次CORDIC運算需要多個時鐘周期，其運算速度相對較慢。
在CORDIC流水線結構算法中，每一級CORDIC迭代運算都使用單獨的運算單元，當流水線填滿之后，每個時鐘周期都馬上會計算出一組結果，所以計算速度很快。
雖然流水線結構算法的計算速度很快，但其精度會受到流水線級數的限制。而要提高精度，就必須增加流水線級數，從而增大硬件開銷，因此，流水線級數的選擇要兼顧速度和精度的要求。
3 實現方案與仿真結果
3．1 實現方案
CORDIC算法的流水線流程圖如圖2所示，該方法采用7級流水線，故可大大提高計算速度。本文引用地址：http://www.104case.com/article/191478.htm
3．2 仿真結果
基于CORDIC算法的正余弦信號發生器的仿真結果如圖3所示，由圖3可見，該算法可以實現標準的正弦波和余弦波，并可直接作為頻偏校正單元。
4 結束語
本文通過對CORDIC算法的工作原理進行分析，給出了基于CORDIC算法和FPGA實現數字頻率校正的實現方案。仿真結果證明，該方法可以實現標準的正弦波和余弦波信號，可以直接作為頻偏校正單元來對數字頻率信號進行校正。
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