近年來，隨著集成電路技術的發展，用傳統的方法進行芯片或系統設計已不能滿足要求，迫切需要提高設計效率。在這樣的技術背景下，能大大降低設計難度的VHDL設計方法正越來越廣泛地被采用。但是VHDL設計是行為級的設計?熕?帶來的問題是設計者的設計思考與電路結構相脫節。設計者主要是根據VHDL的語法規則，行為進行描述，綜合工具進行電路結構的綜合、編譯、優化，通過仿真工具進行邏輯功能仿真和系統時延的仿真。實際設計過程中，由于每個工程師對語言規則、對電路行為的理解程度不同，每個人的編程風格不同，往往同樣的系統功能，
關鍵字：
VHDL 電路 集成電路
1、Modelsim 及 FLI接口介紹
Modelsim是 Model Technology（Mentor Graphics的子公司）的 HDL 硬件描述語言仿真軟件，可以實現 VHDL, Verilog，以及 VHDL-Verilog 混合設計的仿真。除此之外，Modelsim還能夠與 C 語言一起實現對 HDL 設計文件的協同仿真。同時，相對于大多數的 HDL 仿真軟件來說，Modelsim 在仿真速度上也有明顯優勢。這些特點使 Modelsim 越來越受到 EDA設計者、尤其是 FPGA
關鍵字：
FPGA 仿真 Modelsim FLI VHDL
是一種將脈沖信號轉換成角位移的伺服執行器件。其特點是結構簡單、運行可靠、控制方便。尤其是步距值不受電壓、溫度的變化的影響、誤差不會長期積累，這給實際的應用帶來了很大的方便。它廣泛用于消費類產品(打印機、照相機)、工業控制(數控機床、工業機器人)、醫療器械等機電產品中。
通常的步進電機控制方法是采用CPU(PC機、等)配合專用的步進電機驅動控制器來實現，這存在成本較高、各個環節搭配不便(不同類的電機必須要相應的驅動控制器與之配對)等問題。
器件具有速度快、功耗低、保密性好、程序設計靈活、抗干
關鍵字：
脈沖信號 CPU CPLD 電機 I/O
RAM（隨機存取存儲器 是一種在電子系統中應用廣泛的器件，通常用于數據和程序的緩存。隨著半導體工業的發展，RAM獲得了飛速的發展，從RAM、DRAM(Dynamic RAM，即動態RAM)發展到SDRAM(Synchronous Dynamic RAM，即同步動態RAM)，RAM的容量越來越大、速度越來越高，可以說存儲器的容量和速度已經成為半導體工業水平的標志。
１ 任務背景
SDRAM具有大容量和高速的優點，目前其存取速度可以達到100～133MHz，單片容量可以達到64Mbit或更高
關鍵字：
VHDL SDRAM 存儲器 微處理器
1 引言
自動測試設備在軍事及工業領域的應用越來越廣泛，然而在電路單元尤其是電路板測試中，由于被測單元種類多，被測通道數量大，傳統的開關矩陣體積大、切換速度慢、電氣性能差。已不能滿足現代測試儀器高速、便攜的要求。本文介紹了一種采用USB接口，利用I2C總線傳輸數據，由CPLD控制多路復用器件的大型開關矩陣結構，具有較高的切換速度及較好的電氣性能，并滿足了小型化的要求。
2 系統結構及功能
開關矩陣主要實現自動測試設備與被測電路單元之間的信息交換，功能如下：
(1)將程控電源系統
關鍵字：
I2C 開關矩陣 CPLD USB 自動測試
在電子測量技術中，測頻測相是最基本的測量之一。相位測量儀是電子領域的常用儀器，當前測頻測相主要是運用等精度測頻、PLL鎖相環測相的方法。研究發現，等精度測頻法具有在整個測頻范圍內保持恒定的高精度的特點，但是該原理不能用于測量相位。PLL鎖相環測相可以實現等精度測相，但電路調試較復雜。因此，選擇直接測相法作為低頻測相儀的測試方法[1、2、3、4]。
設計的低頻測相儀，滿足以下的技術指標：a .頻率20-20KHz；b .輸入阻抗≥100KΩ；c.相位測量絕對誤差≤1度； d
關鍵字：
CPLD 電子測量 相位測量 單片機 EDA
摘要：本音樂播放器依據MIDI音樂基本原理，結合EDA技術，采用ALTERA公司的可編程邏輯器件（CPLD）EPF10LC84-4作為控制核心而設計的。本文主要闡述了利用VHDL語言設計MIDI音樂發生器芯片，再配上必要的外圍電路，從而實現四首音樂選擇播放、并配有隨音樂節奏而閃爍變化的彩燈等功能的EDA應用系統。
關鍵字：EDA、CPLD、音樂播放器、VHDL語言
0? 引言
大規模可編程邏輯器件CPLD和FPGA是當今應用最廣泛的兩類可編程邏輯器件，電子設計工程師利用它可以在辦公室或實
關鍵字：
EDA CPLD 音樂播放器 VHDL語言
隨著計算機技術的飛速發展，嵌入式圖像系統廣泛應用于辦公設備、制造和流程設計、醫療、監控、衛生設備、交通運輸、通信、金融銀行系統和各種信息家電中。所謂嵌入式圖像系統，指以圖像應用為中心，以計算機技術為基礎，軟件、硬件可裁減，對功能、可靠性、成本、體積、功耗等嚴格要求的專用計算機系統。嵌入式圖像系統對圖像顯示技術提出了各種嚴格要求，必須選擇合適的顯示器，設計出合理的顯示控制方法。
系統硬件設計
本系統要構建一個嵌入式、高速、低功耗、低成本的圖像顯示硬件平臺，要求能真彩顯示靜態或動態彩色圖像。為
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DSP TFT-LCD 數字圖像 顯示技術 嵌入式 CPLD
采用雙端口RAM實現DSP與PCI總線芯片之間的數據交換接口電路。
提出了一種使用CPLD解決雙端口RAM地址譯碼和PCI接口芯片局部總線仲裁的的硬件設計方案，并給出了PCI總線接口芯片寄存器配置實例，介紹了軟件包WinDriver開發設備驅動程序的具體過程。
隨著計算機技術的不斷發展，為滿足外設間以及外設與主機間的高速數據傳輸，Intel公司于1991年提出了PCI總線概念。PCI總線是一種能為主CPU及外設提供高性能數據通訊的總線，其局部總線在33MHz總線時鐘、32位數據通路時，數據
關鍵字：
RAM DSP PCI總線 CPLD 數據通訊
隨著集成電路制造技術的迅速發展,SOC設計已經成為當今集成電路設計的發展方向。SO C設計的復雜性對集成電路設計的各個層次,特別是對系統級芯片設計層次,帶來了新挑戰，原有的HDL難以滿足新的設計要求。
硬件設計領域有2種主要的設計語言：VHDL和Verilog HDL。而兩種語言的標準不統一，導致軟硬件設計工程師之間工作交流出現障礙,工作效率較低。因此，集成電路設計界一直在尋找一種能同時實現較高層次的軟件和硬件描述的系統級設計語言。Synopsys公司與Coware公司針對各方對系統級設計語言的
關鍵字：
SOC SystemC 集成電路 VHDL Verilog HDL
PC104總線系統是一種新型的計算機測控平臺，作為嵌入式PC的一種，在軟件與硬件上與標準的臺式PC(PC/AT)體系結構完全兼容，它具有如下優點：體積小、十分緊湊，并采用模塊化結構，功耗低，總線易于擴充，緊固堆疊方式安裝，適合于制作高密度、小體積、便攜式測試設備，因此在軍用航空設備上有著廣泛的應用，但也正是PC104板的這種小尺寸結構、板上可用空間少給設計帶來了一定的困難，所以本設計采用了復雜可編程器件CPLD，用CPLD完成了PC104總線與429總線通訊的主要電路，大大節省了硬件資源，本文著重介紹
關鍵字：
CPLD 接口板 PC104 總線 嵌入式
若要問：半導體業哪個領域最有趣？我認為FPGA。作為記者，大家一提起FPGA公司就很興奮，太充滿活力了，有時過分得充滿戲劇性。
當中國第一高樓——上海金茂大廈剛剛落成時，A公司在上海成立辦事處，邀請記者從北京到上海觀摩，下榻金茂。一周后，X公司也宣布已經成立上海辦事處，也盛情邀請記者去那里看看，也同樣入住金茂。
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關鍵字：
FPGA 半導體 ASIC CPLD
目前比較常用的方法是在PC機或工控機內安裝ISA或PCI數據采集卡（如A/D卡及422,485卡）.但這些數據采集卡存在安裝麻煩,受計算機插槽數量、地址、中斷資源的限制，可擴展性差等缺點特別是在一些電磁干擾較強的工業現場。隨著USB總線的發展和應用以及USB接口芯片出現，現在USB接口卡應該是一個即實用又方便的選擇了。這項設計實現的是一個動態采集和存儲系統的計算機通信接口卡，基本上可分為CY7C68013 USB接口芯片、CPLD芯片擴展控制部分、軟件的實現部分。
一、 整體結構圖
關鍵字：
USB 接口卡 CPLD 芯片
近年來，DSP在SVPWM(空間矢量脈寬調制)控制領域得到了廣泛應用。
但是使用DSP單核心的控制方法仍然存在一些缺陷：基于軟件的：DSP在實現SVPWM觸發信號時需要較長的時鐘周期；微處理器中不確定的中斷響應會導致PWM脈沖的相位抖動。針對以上問題，本文提出了一種利用FPGA實現的SVPWM信號發生器，系統結構如圖1所示。作為DSP的外圍接口電路，該信號發生器能夠屏蔽DSP內部錯誤中斷對輸入時間信號的影響，保證輸出完整的SVPWM觸發信號波形，其三相并行處理結構還能夠有效提升系統的動態響應速度
關鍵字：
DSP SVPWM VHDL 信號發生器
電動車由于具有無廢氣污染、無噪音、輕便美觀等特點，受到眾多使用者的青睞。但使用中也暴露出它的局限性，那就是蓄電池的容量決定了它的使用范圍，而且存在充電時間長的缺點。目前隨著電動自行車的發展，急需解決的問題就是如何實現快速靈活的充電。
隨著電子技術、可編程邏輯器件(FPGA,CPLD)、EDA技術的飛速發展，基于硬件編程語言的自上而下(TOP-TO-DOWN)設計方法給數字系統的開發設計帶來了革命性變革，僅使用單片機來實現系統控制的傳統方法正在被越來越多的以MCU+FPGA/CPLD為核心的最新設
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CPLD SPCE061A FPGA EDA 充電 電動自行車
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