全球可編程平臺領導廠商賽靈思公司(Xilinx, Inc. (NASDAQ:XLNX) )今天宣布推出其第四代部分可重配置設計流程，以及智能時鐘門控技術的多項全新強化方案，可針對Virtex™®-6 FPGA設計中BRAM(block-RAM)降低24%的動態功耗。設計人員即日起即可下載ISE12.2設計套件，利用其簡便易用、直觀的部分可重配置設計流程，進一步降低功耗和整體系統成本。同時，最新推出的ISE版本還可提供一項低成本仿真方案， 支持嵌入式設計流程。
賽靈思 ISE
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Xilinx FPGA ISE12.2
引言隨著FPGA技術的發展，出現了一種新概念的嵌入式系統，即SOPC（SystemOnProgrammableChip）。SOPC技...
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FPGA SOPC NOR Flash 嵌入式
美國賽靈思(Xilinx)發布了抗輻射性和性能均高于其原產品的航天領域用FPGA“Virtex-5QV FPGA”。將耐輻射總劑量(TID)提高到了該公司原產品的2倍以上之外，其規模也達到了13萬個邏輯單元，作為航天領域用FPGA中屬業界最高水準。此外，還集成了最高速度為3.125Gbit/秒的高速收發器，并強化了DSP功能。主要面向人造衛星和宇宙飛船上的遙感處理、圖像處理以及導航儀等用途。目前正在樣品供貨，將從2011年1～3月開始65nm工藝的量產。賽靈思表示：&ldquo
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Xilinx Virtex FPGA
帶服務能夠支持三重應用（即支持語音、視頻和數據）至第一英里的客戶，例如持續發展的小商業和住宅。FTTx中的...
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FPGA GPON 低功耗
DDR3存儲器系統可以大大提升各種數據處理應用的性能。然而，和過去幾代（DDR和DDR2）器件相比，DDR3存儲器器件...
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FPGA IP核 DDR3 數據處理
為改善紅外圖像的視覺效果和后續處理質量，需要對圖像進行增強處理。在此介紹并實現了一種空間域圖像增強算法，自適應分段線性拉伸算法。首先簡要分析算法原理，對該算法基于Xilinx公司XC4VLXl5系列FPGA的實現方法進行了研究，以兼顧系統實時性和集成度為目的，提出灰度直方圖統計和拉伸運算等關鍵模塊的解決方案。通過試驗結果分析，對壓縮因子的選取提出建議。該設計的輸出延遲僅為62.-5ns，且具有實現簡單、集成度高、功耗低等優點，適合在精確制導武器和導航系統中應用。
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FPGA 圖像自適應 分段線性 算法
提出了一種基于高頻幀攝像頭的高頻幀實時圖像壓縮技術，以此技術為基礎，使用TMS320CDM642和EP2C35 FPGA相結合，設計了一種高頻幀實時圖像處理器硬件系統。該系統采用2片SRAM乒乓結構，以及基于TI公司DSP/BIOS和支持XDAIS的JPEG2000壓縮算法，實現了100幀/s的壓縮速度，系統同時解決了圖像壓縮中容量和速度的問題，實驗了采集和壓縮過程的同步進行，大大提高了圖像壓縮速度。
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FPGA DSP 實時圖像 壓縮系統
0引言快速傅里葉變換(FFT)在雷達、通信和電子對抗等領域有廣泛應用。近年來現場可編程門陣列(FPG...
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FPGA FFT 移位寄存器
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