介紹了一種基于LXI總線數字化儀模塊的總體設計方案。該數字化儀模塊以FPGA和DSP作為采集控制和信號處理核心單元，兼容兩種標準頻率中頻信號的采集與數據處理，采用基于IEEE1588精密時鐘協議提供的時間基準進行精確定時觸發。軟件系統在Windows NT平臺上實現，開發了基于Lab Windows/CVI的虛擬儀器軟面板，保證了模塊運行的穩定性和人機界面的友好。本數字化儀模塊的特點在于該模塊在高性能FPGA的控制下實現兩種中頻信號采集，最高采樣頻率可達130 MHz，可靠性、穩定性好，具有較好的實用價值
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LXI總線 FPGA DSP IEEE1588 201104
本作品設計并實現了一種基于近紅外手背靜脈檢測生物特征的個人身份認證系統(VAS系統)，在Xilinx公司提供的NetFPGA開發平臺上完成了系統開發。實現了手背靜脈圖像的采集、處理、存儲和匹配驗證等功能，充分發揮了FPGA硬件功能，采用軟硬件協同思想，流水線策略和并行處理的方法，移植和優化了軟件算法。同時對NetFPGA平臺進行了改造和擴展;還實現了靈活、友好的交互界面，安全級別高，擴展性強。
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嵌入式系統 FPGA 身份認證 生物特征 手背靜脈 201104
日前，晶圓代工龍頭企業臺積電宣布了其一季度業績，營收為12.9億美元，環比增長14.1%同比增長16.9%，這一切得益于其不斷進步的工藝制程，就目前28nm制程節點，臺積電一口氣推出了6款不同規格的產品，而其他代工廠則表示下半年才會推出28nm的產品。
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Xilinx FPGA
權威的市場分析、領先的技術方案、關鍵元器件展示與講解，2011年4月19日，眾多精彩內容伴隨著第四屆中國國際醫療電子大會(CMET2011)一同亮相深圳。深圳醫療器械行業協會會長陶篤純、藍韻集團產品市場部總監劉明宇、中國科學院深圳先進技術研究院 鄭海榮博士分別從深圳醫療器械產業發展概況、醫改兩年帶來的機遇與挑戰、多學科交叉驅動醫療儀器創新關鍵等角度出發，
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TI FPGA 醫療超聲
基于FPGA+DSP的高速中頻采樣信號處理平臺的實現,摘要：高速中頻采樣信號處理平臺在實際應用中有很大的前景，提出采用FPGA+DSP的處理結構，結合高性能A／D和D／A處理芯片，設計了一個通用處理平臺，并對其主要性能進行了測試。實驗與實際應用表明，該系統具有很強的
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信號處理 平臺 實現 采樣 中頻 FPGA DSP 高速 基于
本心率計在數字式心率計的基礎上，采用FPGA和VHDL語言實現，減少了元器件使用數量，提高了測量精度和可靠性。該電路能夠實時采集并測量人體心跳的瞬時和平均心跳速率，判斷并顯示心率狀態（即心跳是否正常、是否過快或過慢、是否有心率不齊現象）。如果心率過快或過慢或者有心率不齊現象，那么將用不同顏色發光管進行閃爍報警顯示。
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FPGA 數字式 電路 工作原理
摘要：飛行試驗振動信號具有采樣率高、數據量大、處理復雜的特點，在現有條件下，通過遙測鏈路很難將大量的振動數據實時傳輸至地面監控系統。針對試飛測試的需要，結合某型號的試飛關鍵技術攻關研究，突破試飛振動數
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POWER FPGA PC 架構
DDR SDRAM是Double Data Rate SDRAM的縮寫，即雙倍速率同步動態隨機存儲器。DDR內存是在SDRAM內存基礎上發展而來的，能夠在時鐘的上升沿和下降沿各傳輸一次數據，可以在與SDRAM相同的總線時鐘頻率下達到更高的數據傳輸率。雖然DDR2和DDR一樣,都采用相同采樣方式進行數據傳輸，但DDR2擁有兩倍于DDR的預讀取系統命令數據的能力。
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Cyclone FPGA DDR2 III
引言 串行接口常用于芯片至芯片和電路板至電路板之間的數據傳輸。隨著系統的帶寬不斷增加至多吉比特范圍，并行接口已經被高速串行鏈接，或SERDES （串化器/ 解串器）所取代 。起初， SERDES是獨立的ASSP或ASIC器
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SERDES FPGA 性能 接口
本設計使用硬件描述語言VHDL在FPGA數字邏輯層面上實現AES加解密，為了系統的擴展性和構建良好的人機交互，設計通過PS/2鍵盤輸入加密密鑰，并將其顯示在LCD上。在軟核MicroBlaze上，通過SPI總線讀寫FIFO和RAM控制射頻芯片CC2420，使系統具有信道選擇、地址識別、自動CRC校驗功能，使系統更加安全、通信誤碼率更低。
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保密 通信 終端 無線 系統 Xilinx FPGA 基于
摘要 基于FPGA基本數據流的下載控制方式，利用遺傳算法，通過單片機控制數據流的方式對FPGA進行編程配置，實現自身重構，使系統具有自適應、自組織和自修復的特性。
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FPGA 數據流 動態可重構
摘要 利用異步FIFO實現FPGA與DSP進行數據通信的方案。FPGA在寫時鐘的控制下將數據寫入FIFO，再與DSP進行握手后，DSP通過EMIFA接口將數據讀入。文中給出了異步FIFO的實現代碼和FPGA與DSP的硬件連接電路。經驗證，利用
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通信 運用 DSP FPGA FIFO 異步
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