介紹了軟件無線電平臺中基于FPGA的雙緩沖模式PCI Express（PCIE）總線的設計與實現。設計了基于Xilinx Virtex6 FPGA的通用軟件無線電平臺，開發了基于Linux系統的驅動程序和PCIE硬核的DMA控制器。雙緩沖提高了數據傳輸速度，節約了硬件資源。測試結果顯示，該系統工作穩定可靠，讀寫速度可達402 MB/s。
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PCIExpress總線 雙緩沖模式 FPGA
針對目前交叉路口交通控制信號燈的綠信比固定不變的問題，提出一種模糊控制的方案。根據當前相位的車流量和當前相位與下一相位車流量之差，實時控制相位綠信比，縮減車輛在交叉路口的排隊長度。綠信比可在FPGA上模擬實現，采用EElements ISE Development Kit開發套件，使用ISE10.1軟件設計工具，對上述控制方案進行仿真。
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模糊控制 交通燈控制方案 FPGA
基于最小平方 (LS) 算法，利用FPGA實現了一種適用于TD-LTE系統的上行信道估計算法。主要研究了如何利用FPGA實現LS算法，包括算法的介紹、方案的形成、FPGA實現的處理流程、FPGA實現結果及分析。以Virtex-5芯片為硬件平臺，完成了仿真、綜合、板級驗證等工作。實現結果表明，該信道估計算法應用到TD-LTE系統具有良好的穩
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PUSCH 信道估計仿真 FPGA
時鐘是整個電路最重要、最特殊的信號，系統內大部分器件的動作都是在時鐘的跳變沿上進行， 這就要求時鐘信號時延差要非常小， 否則就可能造成時序邏輯狀態出錯；因而明確FPGA設計中決定系統時鐘的因素，盡量較小時鐘的延時對保證設計的穩定性有非常重要的意義。
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信號時延 系統時鐘 FPGA
介紹了一種基于FPGA技術的紅外視頻采集系統組成架構，給出了各功能模塊的實現方法,包括主要的HDL代碼、SignaltapII波形以及QuartusII頂層原理，并制作電路板進行調試，最終的紅外圖像通過VGA實時顯示。結果表明該系統能充分利用FPGA技術的優勢，具有擴展性好、控制靈活、開發周期短等特點。
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紅外視頻采集系統 ADV7181B FPGA
給出了一種基于微碼的JavaCard指令處理器的FPGA設計和實現，以此JavaCard CPU為核心搭建的測試平臺已集成在一塊FPGA上實現。
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JavaCard 復雜指令集 FPGA
通過對LBS控制器的控制信號、LBS總線讀寫操作時序、LBS狀態機進行分析，設計并實現了一個高效、可靠的LBS控制器來實現FPGA和PEX8311的通信系統，在PEX8311和FPGA接口中運行狀態正常，穩定性強，成功應用于某視頻采集卡、某PCIe數據采集卡等，基于FPGA設計的LBS控制器具有靈活性強、可編程能力強、適應性強等優點。
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LBS控制器 PEX8311 FPGA
電路設計與輸入是指通過某些規范的描述方式，將工程師電路構思輸入給EDA工具。常用的設計方法有硬件描述語言（HDL）和原理圖設計輸入方法等。原理圖設計輸入法在早期應用得比較廣泛，它根據設計要求，選用器件、繪制原理圖、完成輸入過程。這種方法的有點是直觀、便于理解、元器件庫資源豐富。但是在大型設計中，這種方法的可維護性較差，不利于模塊構造與重用
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布線資源 功能仿真 FPGA
最近幾年，FPGA以其應用的靈活方便蓬勃發展，在通信、航空航天、醫療設備、消費類電子產品等領域一展身手。使用FPGA控制CF的技術到目前為止還沒有成熟，本文從硬件和軟件角度出發，介紹了FPGA與CF卡的接口設計、給出了用雙RAM訪問CF卡的編程，并且利用FPGA作為FIFO對AD采集的數據進行緩沖，然后存儲到大容量的CF卡中。
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海量數據采集 THS4052 MAX4125 FPGA
提出一種基于FPGA的空間電場信號數據采集與處理系統的設計方案，FPGA為主控制器控制A／D采樣和同步422發送。X，Y，Z三個方向的空間電場信號經過信號處理和A／D采樣，在FPGA片內濾波劃分為不同的頻段，通過同步422接口發送到后續設備。該系統性能可靠穩定，致力于應用在探空火箭有效載荷——箭載電場儀上，對其他電場信號采集與處理系統也有
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空間電場 數據采集 FPGA
本跳頻系統中，FPGA是硬件邏輯的載體，完成基帶信號采樣后的混頻、濾波等操作及對DDS、ADC等外部邏輯的控制；dsp控制FPGA內部邏輯以及DDS、ADC等邏輯單元完成跳頻通信系統基帶部分的發射與接收及其一系列計算任務；高精度時鐘源為整個系統提供時間基準，經過dsp、FPGA、DDS等器件內部鎖相環倍頻，為各器件提供主時鐘。
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跳頻通信 基帶模塊 FPGA
著重討論基于FPGA的64點高速FFT算法的實現方法。采用高基數結構和流水線結構，大大提高了FFT處理器的運行速度。同時塊浮點結構的引入，也大幅減少了浮點操作占用FPGA器件的資源數目，兼顧了FPGA高精度、低資源、低功耗的特點。
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高速FFT算法 高基數結構 FPGA 流水線結構
電子屏的出現，不僅可以使企業更全面的展示產品，推廣企業文化，而且可以滿足不同讀者的需求，改善城市環境，提升人民生活質量，更重要的是廣告能夠更及時、更準確、更全面的展示自己的新產品，第一時間與消費者進行溝通，贏得市場，獲取利潤，以及根據市場動態更及時更全面的做出市場決策。基于以上原因，我們采用Nios II軟核設計了能及時發布戶外廣告、電子公告的多媒體廣告系統。
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NiosII處理器 多媒體廣告 FPGA
提出一種基于FPGA 的實時視頻信號處理平臺的設計方法，該系統接收低幀率數字YCbCr 視頻信號，對接收的視頻信號進行格式和彩色空間轉換、像素和，利用片外SDRAM 存儲器作為幀緩存且通過時序控制器進行幀率提高，最后通過VGA 控制模塊對圖像信號進行像素放大并在VGA 顯示器上實時顯示。整個設計使用Verilog HDL 語言實現，
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實時視頻信號處理 CCD圖像傳感器 FPGA YCbCr
fpga：quartusⅡ介紹
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