- 無線TEM（電信設備制造商）正受到布署基站架構的壓力，這就是用更小體積、更低功耗、更低制造成本來建立，部署和運營。達到此目的的關鍵策略是從基站中分離出RF接收器和功率放大器，用它們來直接驅動各自的天線。這稱為射頻拉遠技術(RRH)。通過基于SERDES的公共無線接口(CPRI)將基帶數據傳回到基站。本文主要闡述特定的低延遲變化的設計思想，在低成本FPGA上利用嵌入式SERDES收發器和CPRI IP（知識產權）核實現。
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CPRI 遠程基站 FPGA
- 實時操作系統RTOS(Real Time Operating System)由于具有調度的實時性、響應時間的可確定性、系統高度的可靠性等特點，被越來越多地應用在嵌入式系統中，如：航空航天、工業控制、汽車電子和核電站建設等眾多領域。
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μC／OS－II FPGA RTOS
- FPGA概述 現場可編程門陣列(FPGA)是一種可編程邏輯器件，由成千上萬個完全相同的可編程邏輯單元組成，周圍是輸入/輸出單元構成的外設。制造完成后，FPGA可以在工作現場編程，以
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I/O模塊 VCCINT FPGA
- 引言隨著大規模集成電路的快速發展，系統設計已從傳統的追求大規模、高密度逐漸轉向提高資源利用率，使有限的資源可以實現更大規模的邏輯設計。利用現場可編程邏輯器件FPGA的多次可編程配置特點，通過重新下
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VC＋＋ PCI總線 FPGA
- 電機在現代生活中扮演著重要角色。出于對安全、成本及效率的考慮，工程師——尤其是混合電動力汽車(HEV)工程師——往往希望在特定的真實環境下通過仿真電機模型對電機控制器進行測試。
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環仿真器 電機控制器 FPGA
- 數字波束形成技術充分利用陣列天線所獲取的空間信息，通過信號處理技術使波束獲得超分辨率和低副瓣的性能，實現了波束的掃描、目標的跟蹤以及空間干擾信號的零陷，因而數字波束形成技術在雷達信號處理
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數字波束形成技術 信號處理器 FPGA
- 可編程邏輯器件FPGA以其開發周期短、成本低、功耗低、可靠性高等優勢，廣泛應用于通信、航空、醫療等領域，近年來在消費電子領域中的應用也日漸增加。為進一步挖掘FPGA在家庭娛樂如游戲機開發與應用中的巨大
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LED 控制器 FPGA
- 可編程邏輯解決方案領導廠商賽靈思公司（Xilinx, Inc. (NASDAQ: XLNX)）在德國紐倫堡召開的 2010 年全球嵌入式展覽會（Embedded World 2010）上推出賽靈思 Spartan?-6 FPGA 工業影像目標設計平臺，為低成本、低功耗的工業影像系統加速高性能視頻處理應用開發。工業設備 OEM 廠商現在就可快速構建并評估具有高清影像分辨率、專用影像傳感器接口，以及智能視頻和高級影像處理算法的可再編程影像解決方案。
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賽靈思 OEM FPGA
- 系統采用現場FPGA作為硬件設計核心，使用Veritog語言。進行硬件描述，使系統更靈活，可在線編程，便于擴展和升級。這里的CCD驅動時序采用狀態機與分頻相結合的新方法，實際測試驅動波形穩定且沒有毛刺，CCD輸出信號質量高。USB應用于Slave FIFO高速傳輸模式，滿足了高速CCD聲光信號采集的要求，具有實時性、高速、穩定、可靠等特點。
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USB2.0 CCD FPGA 聲光信號采集
- FPGA 設計人員可以通過增大tMET ，采用增加同步寄存器時序余量等設計方法來提高系統可靠性，增大亞穩態MTBF。Altera 確定了其 FPGA 的MTBF 參數，改進器件技術，從而增大了亞穩態MTBF。使用Altera FPGA 的設計人員可以利用Quartus II 軟件功能來報告設計的亞穩態MTBF，優化設計布局以增大MTBF。
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壓穩態 MTBF FPGA
- 在上世紀最后的十年里，重復可編程邏輯器件大放異彩，在通信行也得到了廣泛的應用，這一時期FPGA 競爭基本上集中在容量，性能， IO 標準方面。而在便攜應用方面因為FPGA 的高昂的價格，驚人的功耗基本上很少應用。
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Actel 便攜式系統 FPGA
- 交織技術能很好地糾正信息傳輸過程中出現的突發性錯誤。在數字信息傳輸系統中得到了廣泛應用。本文將在討論信息產業部重點支持發展的TETRA數字集群通信系統語音信道編碼結構和流程的基礎上，重點研究交織技術在其語音信道編碼中的應用及用FPGA實現該交織器的方法。
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TETRA 數字集群 FPGA 通信系統 語音信道編碼 交織器
- 從制造的角度來講，FPGA測試是指對FPGA器件內部的邏輯塊、可編程互聯線、輸入輸出塊等資源的檢測。完整的FPGA測試包括兩步，一是配置FPGA、然后是測試FPGA，配置FPGA是指將FPGA通過將配置數據下載編程使其內部的待測資源連接成一定的結構，在盡可能少的配置次數下保證FPGA內部資源的測試覆蓋率，配置數據稱為TC，配置FPGA的這部分時間在整個測試流程占很大比例；測試FPGA則是指對待測FPGA施加設計好的測試激勵并回收激勵，測試激勵稱為TS。
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重復配置 測試 FPGA
- 在對H．264標準中二進制化部分研究和分析的基礎上，提出其FPGA電路結構，采用并行結構及流水線方式設計電路。該結構經Spartan3 FPGA實現，其吞吐量為每周期1 bit，最大時鐘頻率為100 MHz，能夠滿足H．264中第3級及其以上檔次實時視頻編碼的要求。
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H.264 二進制化 編碼器 FPGA
- ISE設計套件11的全功能版本將作為Virtex-6 FPGA套件的一部分推出，器件支持僅限于Vitex-6 LX240T-FF1156。Spartan-6 FPGA 套件包括ISE設計套件11 WebPACK軟件。ISE設計套件作為獨立產品另外提供，可提供全面的器件支持，邏輯版本的起價為2995美元。客戶可從賽靈思網站免費下載 ISE設計套件11的全功能30天評估版本。
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目標設計平臺 Virtex-6 FPGA 系統開發
fpga：quartusⅡ介紹
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