- Altera公司今天發布其Stratix® 10 FPGA和SoC體系結構和產品細節，這一下一代高端可編程邏輯器件在性能、集成度、密度和安全特性方面實現全面突破，勢必將云時代的網絡通信技術推向又一個巔峰。
Stratix 10 FPGA和SoC采用了Altera革命性的HyperFlex™ FPGA架構，由Intel® 14 nm三柵極工藝技術制造，內核性能是前一代FPGA的2倍。業界性能最好、密度最高、具有先進的嵌入式處理功能的FPGA與GPU級別浮點計算性能和異構
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Altera FPGA
- FPGA(Field-Programmable Gate Array)，即現場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎上進一步發展的產物。它是作為專用集成電路(ASIC)領域中的一種半定制電路而出現的，既解決了定制電路的不足，又克服了原有可編程器件門電路數有限的缺點。FPGA的開發相對于傳統PC、單片機的開發有很大不同。FPGA以并行運算為主，以硬件描述語言來實現;相比于PC或單片機(無論是馮諾依曼結構還是哈佛結構)的順序操作有很大區別，也造成了FPGA開發入門較難。目前國內有專
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FPGA A/D
- 射頻識別(RFID)技術是一種非接觸式的自動識別技術，通過射頻信號自動識別目標對象并獲取相關信息。通常RFID系統主要由應用軟件、射頻卡以及讀卡器三部分構成[1]。相對于低頻段的RFID系統，工作在860 MHz～960 MHz的超高頻段(UHF)RFID系統有著讀取距離遠、閱讀速度快等優點，是目前國際上RFID技術發展的熱點[2]。讀卡器的設計是RFID系統設計中的關鍵部分，設計方案有很多種。FPGA[3]具有開發簡單、靜態可重復編程和動態在線編程的特點，已經成為當今應用最廣泛的可編程專用集成電路。
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FPGA 讀卡器
- 通常來講，“一個好漢三個幫”，一個完整的嵌入式系統中由單獨一個FPGA使用的情況較少。通常由多個器件組合完成，例如由一個FPGA+CPU來構成。通常為一個FPGA+ARM，ARM負責軟件配置管理，界面輸入外設操作等操作，FPGA負責大數據量運算，可以看做CPU的專用協處理器來使用，也常會用于擴展外部接口。常用的有ARM+FPGA，DSP+FPGA，或者網絡處理器+FPGA等種種架構形式，這些架構形式構成整個高速嵌入式設備的處理形態。
不得不說的是，隨著技術的進步，現在CP
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ARM FPGA
- 引言
脈寬調制(PWM)是從微控制器或FPGA等數字器件產生模擬電壓的一種常用方法。大多數微控制器都具有內置的專用PWM產生外設，而且其僅需幾行RTL代碼即可從FPGA產生一個PWM信號。如果模擬信號的性能要求不是太嚴格，那么這就是一種簡單和實用的方法，因為它只需要一個輸出引腳，而且與具有一個SPI或I2C接口的數模轉換器(DAC)相比，其代碼開銷是非常低。圖1示出了一款典型應用，其采用一個經濾波的數字輸出引腳來產生一個模擬電壓。
該方案的諸多不足之處您不必深究就能發現。理想情況下，一個1
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PWM FPGA
- 1引言
DDS同DSP(數字信號處理)一樣，是一項關鍵的數字化技術。DDS是直接數字式頻率合成器(DirectDigitalSynthesizer)的英文縮寫。與傳統的頻率合成器相比，DDS具有低成本、低功耗、高分辨率和快速轉換時間等優點，廣泛使用在電信與電子儀器領域，是實現設備全數字化的一個關鍵技術。在各行各業的測試應用中，信號源扮演著極為重要的作用。但信號源具有許多不同的類型，不同類型的信號源在功能和特性上各不相同，分別適用于許多不同的應用。目前，最常見的信號源類型包括任意波形發生器，函數發
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FPGA DDS
- 光纖陀螺是激光陀螺的一種，是慣性技術和光電子技術緊密結合的產物。它利用Sagnac干涉效應，用光纖構成環形光路，并檢測出隨光纖環的轉動而產生的兩路超輻射光束之間的相位差，由此計算出光纖環旋轉的角速度。光纖陀螺儀主要由兩個部分組成。伺服于表頭的調制解調電路根據輸進的電信號，經過相應的變換后形成反饋信號送至表頭的相位調制器中。在實際的應用過程中，相應的調制解調電路應該根據溫度、振動等情況做出相應的改變，才能最大限度地保證陀螺的精度要求。本文設計了一種基于FPGA的測試系統，模擬光纖陀螺儀的表頭，并檢測調制
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FPGA 陀螺儀
- 引言
Altera公司的Nios II處理器是可編程邏輯器件的軟核處理器。NiosII軟核處理器和存儲器、I/O接口等外設可嵌入到FPGA中，組成一個可編程單芯片系統(SOPC)，大大降低了系統的成本、體積和功耗。適合網絡、電信、數據通信、嵌入式和消費市場等各種嵌入式應用場合。
本文提出一個基于Nios II處理器結構的系統用于實現機器人實時運動檢測跟蹤，使用線性卡爾曼濾波器算法來快速完成運動估計及進一步分析和校正，算法中的乘除利用MATLAB/DSP Builder生成的模塊作為Nios
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Nios II FPGA
- 目前伺服控制器的設計多以DSP或MCU為控制核心，但DSP的靈活性不如FPGA，且在某些環境比較惡劣的條件如高溫高壓下DSP的應用效果會大打折扣，因此以FPGA為控制核心，對應用于機載三軸伺服控制平臺的控制器進行了設計與優化。
1 總體方案
FPGA(Field-Prograromable Gate Array，現場可編程門陣列)是在PAL，GAL，CPLD等可編程器件的基礎上進一步發展的產物。FPGA采用了邏輯單元陣列LCA(Logic Cell Array)這樣一個概念，內部包括可配置
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FPGA 伺服控制器
- 引 言
電動機是各類數控機床的重要執行部件。要實現對電動機的精確位置控制，轉子的位置必須能夠被精確的檢測出來。光電編碼器是目前最常用的檢測器件。光電編碼器分為增量式、絕對式和混合式。其中，增量式以其構造簡單，機械壽命長，易實現高分辨率等優點，已被廣泛采用。增量式光電編碼器輸出有A，B，Z三相信號，其中A相和B相相位相差90°，Z相是編碼器的“零位”，每轉只輸出一個脈沖。在應用中，經常需要對A相、B相正交脈沖按照一定的比例，即分周比進行分頻。分頻的難點是，無論設定分
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FPGA VHDL
- 圖中存在較多的模塊，因此在此將每個模塊的功能做簡單介紹：
另外，Clock_Control模塊為綜合模塊，內部包含了時、分、秒、時鐘計數器模塊和時間設定模塊，該模塊的內部結構這里小梅哥不做過多介紹，詳細請參看代碼。
五、 代碼組織方式
本實驗主要學習由頂向下的設計流程，代碼均為常見風格，這里不多做介紹。希望讀者能夠通過代碼架構，學習領會這種自頂向下的設計結構的優勢。
六、 關鍵代碼解讀
本設計中，頂層模塊主要實現了各個模塊的例化和數碼管顯示使能的多路控制，相信看了圖4
- 關鍵字：
FPGA 數碼鐘
- 對FPGA技術來說，早期研發在5年前就已開始嘗試采用多核和硬件協處理加速技術朝系統并行化方向發展。在實際設計中，FPGA已經成為CPU的硬件協加速器，很多芯片廠商采用了硬核或軟核CPU+FPGA的模式，今后這一趨勢也將繼續下去。
CPU+FPGA模式的興起
賽靈思根據市場需求，率先于2010年4月28日發布了集成ARM Cortex-A9CPU和28nmFPGA的可擴展式處理平臺(Extensible Processing Platform)架構。
該公司全球市場營銷及業務開發高級副
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FPGA DSP
- 在線結構光視覺三維測量系統中，為了實現對結構光圖像線條紋中心的實時高精度提取，本文采用了極值法、閾值法和灰度重心法相結合的中心線提取方法。利用現場可編程門陣列器件(FPGA)的流水線技術以及并行技術的硬件設計來完成運算，保證了光條紋中心點的實時準確提取。實驗表明采用FPGA 實現圖像處理的專用算法能滿足圖像數據進行實時準確提取的要求。
- 關鍵字：
結構光圖像 中心線提取 FPGA 201506
- 本文設計實現了一款基于FPGA的PCM-FM遙測中頻接收機，在FPGA中實現遙測信號解調、位同步、幀同步等功能，系統碼速率、幀長、幀同步碼可靈活設置。接收機硬件結構簡單，主要包括FPGA、ADC、電源轉換芯片、USB接口芯片等常用器件，可單板實現，達到低成本、小型化設計要求。性能測試表明，中頻接收機滿足設計指標要求，目前該接收機已服務于多個項目。
- 關鍵字：
遙測系統 中頻接收機 位同步 幀同步 FPGA 201506
fpga：quartusⅡ介紹
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