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基于FPGA的自適應(yīng)均衡器的研究與設(shè)計(jì)
- 摘要：近年來(lái)，自適應(yīng)均衡技術(shù)在通信系統(tǒng)中的應(yīng)用日益廣泛，利用自適應(yīng)均衡技術(shù)在多徑環(huán)境中可以有效地提高數(shù)字接收機(jī)的性能。為了適應(yīng)寬帶數(shù)字接收機(jī)的高速率特點(diǎn)，本文闡述了自適應(yīng)均衡器的原理并對(duì)其進(jìn)行改進(jìn)。最
- 關(guān)鍵字： 自適應(yīng)均衡器 寬帶數(shù)字接收機(jī) FPGA Verilog HDL
基于FPGA的北斗QPSK調(diào)制實(shí)現(xiàn)與解調(diào)驗(yàn)證
- 摘要 為研制北斗衛(wèi)星導(dǎo)航模擬信號(hào)源，設(shè)計(jì)實(shí)現(xiàn)了北斗QPSK信號(hào)調(diào)制器。文中在分析了北斗衛(wèi)星導(dǎo)航系統(tǒng)B1頻段信號(hào)的正交相移鍵控調(diào)制信號(hào)的基礎(chǔ)上，基于軟件無(wú)線電的思想，在FPGA硬件平臺(tái)上實(shí)現(xiàn)了QPSK信號(hào)調(diào)制器，通過(guò)
- 關(guān)鍵字： 北斗 QPSK 調(diào)制解調(diào) FPGA StratixⅡ
基于CPLD/FPGA的出租車計(jì)費(fèi)器系統(tǒng)的設(shè)計(jì)實(shí)現(xiàn)
- 1 引言隨著EDA技術(shù)的發(fā)展及大規(guī)模可編程邏輯器件CPLD/FPGA的出現(xiàn)，電子系統(tǒng)的設(shè)計(jì)技術(shù)和工具發(fā)生了巨大的變化，通過(guò)EDA技術(shù)對(duì)CPLD/FP-GA編程開發(fā)產(chǎn)品，不僅成本低、周期短、可靠性高，而且可隨時(shí)在系統(tǒng)中修改其邏輯功
- 關(guān)鍵字： CPLD FPGA 出租車 計(jì)費(fèi)器
基于FPGA多波束成像的聲納系統(tǒng)設(shè)計(jì)
- 摘要：給出了一種基于FPGA的多波束成像聲納整機(jī)的硬件電路設(shè)計(jì)方案，介紹了該方案中各分系統(tǒng)的具體電路實(shí)現(xiàn)，以Xilinx公司的FPGA芯片作為核心器件，根據(jù)干端PC下發(fā)的控制指令實(shí)現(xiàn)對(duì)180個(gè)基元的發(fā)射接收電路的控制，完
- 關(guān)鍵字： 多波束成像聲納 發(fā)射接收電路 波束形成器 千兆網(wǎng)傳輸 控制指令 FPGA
基于FPGA的視頻圖像畫面分割器設(shè)計(jì)
- 摘要：為了解決在一個(gè)屏幕上收看多個(gè)信號(hào)源的問(wèn)題，對(duì)基于FPGA技術(shù)的視頻圖像畫面分割器進(jìn)行了研究。研究的主要特色在于構(gòu)建了以FPGA為核心器件的視頻畫面分割的硬件平臺(tái)，首先，將DVI視頻信號(hào)，經(jīng)視頻解碼芯片轉(zhuǎn)換為
- 關(guān)鍵字： FPGA DDR2 SDRAM 視頻提取 圖像合成
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