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        fpga+dsp 文章 最新資訊

        低成本人機(jī)交互設(shè)計(jì):基于FPGA的體感游戲

        • 體感游戲是視覺與本體感覺和動(dòng)作控制的集合,伴隨著虛擬現(xiàn)實(shí)技術(shù)的迅猛發(fā)展,正逐步走入市場(chǎng)。為了達(dá)到視覺、運(yùn)動(dòng)相結(jié)合的目的,采用加速度傳感器與VGA顯示器相結(jié)合的方法,通過戴有速度手套的手的運(yùn)動(dòng)來完成對(duì)游戲
        • 關(guān)鍵字: 加速度傳感器    FPGA    VGA    體感游戲  

        基于DSP的海量實(shí)時(shí)多媒體數(shù)據(jù)分析系統(tǒng)設(shè)計(jì)

        • 隨著計(jì)算機(jī)應(yīng)用系統(tǒng)的不斷發(fā)展和完善,在各個(gè)領(lǐng)域產(chǎn)生了海量實(shí)時(shí)多媒體數(shù)據(jù)。這些海量數(shù)據(jù)可能已不被應(yīng)用系統(tǒng)直接引用,但存在著大量的查詢和分析價(jià)值。而對(duì)海量信息的利用離不開底層對(duì)數(shù)據(jù)的操作。然而,數(shù)據(jù)不斷膨
        • 關(guān)鍵字: DSP  多媒體數(shù)據(jù)  一體化  

        帶自舉功能的DSP外設(shè)擴(kuò)展模塊設(shè)計(jì)

        • 摘要:TMS320VC54x系列DSP(Digital Signal processor)沒有AD、DA等常用外設(shè)且缺少程序存儲(chǔ)器,故其應(yīng)用系統(tǒng)通常需進(jìn)行外設(shè)擴(kuò)展模塊與自舉模塊設(shè)計(jì),針對(duì)傳統(tǒng)解決方案將兩個(gè)模塊分別實(shí)現(xiàn)存在擴(kuò)展器件多、系統(tǒng)集成度不
        • 關(guān)鍵字: TMS320VC54x  DSP  外設(shè)擴(kuò)展  自舉  

        關(guān)于可編程邏輯,你可能已經(jīng)遺忘的8件事

        • 曾幾何時(shí),原理圖就是工程師們的一切,一張羊皮圖紙,一支自動(dòng)鉛筆,一把直尺,一個(gè)綠色邏輯模版,一塊橡皮擦,一塊金屬擦除模板,直到上世紀(jì)80年代,計(jì)算機(jī)的出現(xiàn),使原理圖的制作技術(shù)得到了一個(gè)大的飛躍。到上世紀(jì)
        • 關(guān)鍵字: 可編程邏輯    FPGA    FPLA  

        基于FPGA的水聲信號(hào)采集與存儲(chǔ)系統(tǒng)設(shè)計(jì)

        • 摘要:為實(shí)現(xiàn)對(duì)水聲信號(hào)的多通道同步采集并存儲(chǔ),提出了一種基于FPGA的多通道信號(hào)同步采集、高速大容量實(shí)時(shí)存儲(chǔ)的系統(tǒng)設(shè)計(jì)方案,并完成系統(tǒng)的軟硬件設(shè)計(jì)。該系統(tǒng)的硬件部分采用模塊化設(shè)計(jì),通過FPGA豐富的外圍接口實(shí)
        • 關(guān)鍵字: FPGA  水聲信號(hào)  同步采集  高速存儲(chǔ)  

        便攜式邏輯分析儀的設(shè)計(jì)與實(shí)現(xiàn)

        • 摘要 介紹一種16通道便攜式邏輯分析儀,通過FPGA將高速數(shù)據(jù)采樣并緩存,采用USB控制芯片和FPCA協(xié)同控制將數(shù)據(jù)通過USB接口發(fā)送到電腦的上位機(jī)上顯示,簡化了以往邏輯分析儀硬件電路部分,降低了邏輯分析儀的成本且便
        • 關(guān)鍵字: 邏輯分析儀  USB接口  FPGA  FIFO傳輸  

        MATLAB與DSP使用RTDX的實(shí)時(shí)數(shù)據(jù)交換

        • 采用MATLAB輔助DSP程序的開發(fā)和調(diào)試,能加快DSP應(yīng)用程序的開發(fā)。實(shí)時(shí)數(shù)據(jù)交換(RTDX)為設(shè)計(jì)、驗(yàn)證DSP算法提供了一個(gè)快速、方便的解決方案。本文對(duì)RTDX的工作原理進(jìn)行了分析,討論了MATLAB與DSP使用RTDX插件實(shí)現(xiàn)雙向數(shù)據(jù)傳輸?shù)膶?shí)現(xiàn)方式,并通過一個(gè)簡單的實(shí)例說明RTDX的具體實(shí)現(xiàn)過程。
        • 關(guān)鍵字: MATLAB  DSP  實(shí)時(shí)數(shù)據(jù)交換  

        利用信號(hào)平均技術(shù),消除噪聲干擾,提升重復(fù)信號(hào)采樣的精準(zhǔn)度

        • 許多高速數(shù)據(jù)采集應(yīng)用,如激光雷達(dá)或光纖測(cè)試等,都需要從嘈雜的環(huán)境中采集小的重復(fù)信號(hào),因此對(duì)于數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)來說,最大的挑戰(zhàn)就是如何最大限度地減少噪聲的影響。利用信號(hào)平均技術(shù),可以讓您的測(cè)量測(cè)試系統(tǒng)
        • 關(guān)鍵字: FPGA  DSP  PCIe-9852  網(wǎng)絡(luò)通信  多媒體處理  

        通過FPGA設(shè)計(jì)安全的高級(jí)輔助駕駛系統(tǒng)

        • 隨著道路上汽車數(shù)量的增加,我們需要更多的技術(shù)來進(jìn)一步減少交通事故。過去幾年,基于雷達(dá)和攝像機(jī)的新系統(tǒng)功能的出現(xiàn)使駕駛更加安全。很多高級(jí)輔助駕駛系統(tǒng)(ADAS)應(yīng)用,如自動(dòng)巡航控制、道路偏離報(bào)警、交通信號(hào)標(biāo)志
        • 關(guān)鍵字: FPGA  駕駛系統(tǒng)  汽車電子  

        基于DSP Builder的CIC梳狀濾波器的設(shè)計(jì)

        • 摘要:CIC梳狀濾波器具有結(jié)構(gòu)簡單、規(guī)整,占用存儲(chǔ)量小,不需要乘法器,實(shí)現(xiàn)簡單且速度高等特點(diǎn),在高速抽取或插值系統(tǒng)應(yīng)用廣泛。采用DSP Builder軟件工具,在Simulink平臺(tái)上構(gòu)建了一級(jí)4階CIC梳狀濾波器仿真模型,通
        • 關(guān)鍵字: DSP Builder  FPGA  CIC梳狀濾波器  仿真模型  

        采用MTK+DSP的雙目視角非接觸3D指紋識(shí)別系統(tǒng)

        • 采用指紋信息作為身份識(shí)別手段的應(yīng)用已經(jīng)很廣泛,但傳統(tǒng)的指紋信息識(shí)別身份時(shí)存在容易被仿造的缺點(diǎn)。3D指紋信息不但可以進(jìn)一步提高指紋識(shí)別率而且可以很好地克服該缺點(diǎn)。在此主要介紹利用雙目視角技術(shù)采集3D指紋信息
        • 關(guān)鍵字: MTK  DSP  指紋識(shí)別  

        FPGA 101:計(jì)算復(fù)雜數(shù)學(xué)函數(shù)

        • 由于其靈活性與高性能,F(xiàn)PGA已經(jīng)在眾多需要計(jì)算復(fù)雜數(shù)學(xué)題或傳遞函數(shù)的工業(yè)、科研、軍事及其它應(yīng)用中找到用武之地??量痰木纫笈c計(jì)算時(shí)延在更關(guān)鍵的應(yīng)用中并不少見。在采用FPGA實(shí)現(xiàn)數(shù)學(xué)函數(shù)時(shí),工程師一般選擇定
        • 關(guān)鍵字: FPGA  函數(shù)  

        關(guān)于Spartan-3E的低成本顯示器解決方案

        • 曾幾何時(shí),高清晰度平板顯示電視機(jī)對(duì)普通消費(fèi)者來說價(jià)格高昂。如今,它們已能夠被經(jīng)濟(jì)地大量生產(chǎn),而且價(jià)格能為大多數(shù)家庭所接受。顯示板制造商正在擴(kuò)大生產(chǎn)能力,以滿足需求并促進(jìn)更高的消費(fèi)量。根據(jù) iSuppli 公司
        • 關(guān)鍵字: Spartan-3E  FPGA  

        基于MSP430與FPGA的多功能數(shù)字頻率儀設(shè)計(jì)*

        • 本文采用以FPGA為主,MSP430為輔的框架系統(tǒng)處理方式設(shè)計(jì)了多功能數(shù)字頻率儀。該裝置采用低頻直接測(cè)周期,高頻等精度多周期同步測(cè)量的方法,通過進(jìn)一步優(yōu)化標(biāo)準(zhǔn)時(shí)鐘頻率的設(shè)置,克服了傳統(tǒng)測(cè)頻方法在高精度要求方面的缺陷。將MSP430作為控制處理核心、FPGA作為信號(hào)處理單元,將高效控制與快速運(yùn)算能力相結(jié)合,實(shí)現(xiàn)正弦波頻率、兩路方波信號(hào)時(shí)間間隔以及矩形脈沖占空比的測(cè)量。測(cè)試表明,該裝置具有高精度、高穩(wěn)定性、裝配簡易和操作便利的特點(diǎn)。
        • 關(guān)鍵字: 多周期同步測(cè)量  標(biāo)準(zhǔn)時(shí)鐘頻率  占空比  FPGA  MSP430  201611  

        基于Cortex-M3的北斗二代基帶芯片設(shè)計(jì)

        • 我國自主研制的北斗衛(wèi)星導(dǎo)航系統(tǒng),日益在經(jīng)濟(jì)、軍事和民用領(lǐng)域得到越來越廣的應(yīng)用。本文提出并設(shè)計(jì)了基于Cortex-M3處理器的北斗接收機(jī)基帶處理芯片,設(shè)計(jì)了時(shí)域頻域二維并行捕獲模塊,同時(shí)闡述了基于Cortex-M3處理器的控制流程,包括對(duì)捕獲引擎、跟蹤引擎的調(diào)度,電文解調(diào)和定位解算等。本設(shè)計(jì)最后在FPGA上完成原型驗(yàn)證,定位結(jié)果符合算法預(yù)期。
        • 關(guān)鍵字: 北斗衛(wèi)星導(dǎo)航系統(tǒng)  Cortex-M3  FPGA  201611  
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